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TC94A04AFD

更新时间： 2024-11-28 22:25:27
品牌 Logo 应用领域
东芝 - TOSHIBA 消费电路商用集成电路
页数 文件大小 规格书
42页 557K
描述
1 CHIP AUDIO DIGITAL PROCESSOR

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TC94A04AFD 技术参数

生命周期：Active零件包装代码：QFP
包装说明：QFP,针数：80
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.62Is Samacsys：N
商用集成电路类型：CONSUMER CIRCUITJESD-30 代码：R-PQFP-G80
JESD-609代码：e0长度：20 mm
功能数量：1端子数量：80
最高工作温度：75 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：QFP
封装形状：RECTANGULAR封装形式：FLATPACK
认证状态：Not Qualified座面最大高度：3.05 mm
最大压摆率：146 mA最大供电电压 (Vsup)：5.25 V
最小供电电压 (Vsup)：4.75 V表面贴装：YES
技术：CMOS温度等级：OTHER
端子面层：TIN LEAD端子形式：GULL WING
端子节距：0.8 mm端子位置：QUAD
宽度：14 mmBase Number Matches：1

TC94A04AFD 数据手册

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TC94A04AF/AFD  
TOSHIBA CMOS Digital Integrated Circuit Silicon Monolithic  
TC94A04AF,TC94A04AFD  
1 chip Audio Digital Processor  
TC94A04AF/AFD is a single-chip audio Digital Signal Processor,  
incorporating 4 way stereo analog switch, 2 ch AD converter, 4 ch  
DA converter, and electronic volume for trimming.  
TC94A04AF  
It is possible to realize many applications, such as sound field  
control -hall simulation, for example-, digital filter for equalizers,  
surround, base boost and something.  
Features  
•
Incorporates a 4 ch-stereo analog switch for AD converter  
input.  
•
•
Incorporates a 1 ch stereo line-out.  
TC94A04AFD  
Incorporates a 1 bit ∑ ∆-type AD converter (two channels).  
THD: −82dB (typ.) S/N: 95dB (typ.)  
•
•
•
Incorporates a 1 bit ∑ ∆-type DA converter (four channels).  
THD: −86dB (typ.) S/N: 98dB (typ.)  
Incorporates a trimming analog volume for each output of DA  
converter. 0dB to −24dB (1dB step)  
As digital input/output port, this has 3 input port (6 ch) and 1  
output port (2 ch), enabling input/output of sampling of 96  
kHz/24 bit.  
Weight  
•
•
•
Incorporates a built-in digital de-emphasis filter.  
Incorporates a digital attenuator.  
Incorporates a boot ROM to set a coefficient automatically,  
QFP60-P-1414-0.80D: 1.08 g (typ.)  
QFP80-P-1420-0.80B: 1.57 g (typ.)  
which enables to transfer an initial data from built-in ROM/RAM to registers at the time of resetting  
Boot ROM: 512 words  
•
The DSP block specifications are as follows:  
Data bus: 24 bits  
Multiplier/adder: 24 bits × 16 bits + 43 bits → 43 bits  
Accumulator: 43 bits (sign extension: 4 bits)  
Program ROM: 1024 words × 32 bits  
Coefficient RAM: 384 words × 16 bits  
Coefficient ROM: 256 words × 16 bits  
Offset RAM: 16 words × 11 bits  
Data RAM: 256 words × 24 bits  
Interface buffer RAM: 32 words × 16 bits  
Operation speed: 22.5 MIPS (510 step/fs: master clock = 768 fs, fs = 44.1 kHz)  
Note 1: At the time of an analog input, approximately 170 steps (85 step/ch) in 510 step are used for the operation  
of the decimation filter for AD converters.  
•
Incorporates data delay RAM (32 kbits).  
Delay RAM: 2048 words × 16 bits (32 kbits)  
2
•
•
•
•
The microcontroller interface can be selected between Toshiba original 3 line mode and I C mode.  
CMOS silicon structure supports high speed.  
Power supply is a single 5 V.  
The package are 60-pin and 80 pin flat package.  
1
2001-11-15  
1234567...42

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