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Datasheet > 逻辑 > 延迟线> SY100EP196VTGTR
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SY100EP196VTGTR

更新时间： 2024-09-30 07:20:11
品牌 Logo 应用领域
麦瑞 - MICREL 延迟线逻辑集成电路
页数 文件大小 规格书
18页 630K
描述
3.3V/5V 2.5GHz PROGRAMMABLE DELAY WITH FINE TUNE CONTROL

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SY100EP196VTGTR 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Transferred零件包装代码：QFP
包装说明：TQFP,针数：32
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.16其他特性：NECL MODE: VCC=0 WITH VEE=-3.0 V TO -3.6 V
系列：100EJESD-30 代码：S-PQFP-G32
JESD-609代码：e4长度：7 mm
逻辑集成电路类型：ACTIVE DELAY LINE湿度敏感等级：2
功能数量：1抽头/阶步数：1023
端子数量：32最高工作温度：85 °C
最低工作温度：-40 °C输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：TQFP
封装形状：SQUARE封装形式：FLATPACK, THIN PROFILE
峰值回流温度（摄氏度）：260可编程延迟线：YES
认证状态：Not Qualified座面最大高度：1.2 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.8 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
总延迟标称（td）：12.2 ns宽度：7 mm
Base Number Matches：1

SY100EP196VTGTR 数据手册

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ECLPro®
SY100EP196V  
3.3V/5V 2.5GHz PROGRAMMABLE  
DELAY WITH FINE TUNE CONTROL  
FEATURES  
■ Pin-for-pin, plug-in compatible to the ON  
Semiconductor MC100EP196  
®
ECL Pro  
■ Maximum frequency > 2.5GHz  
■ Programmable range: 2.2ns to 12.2ns  
■ 10ps increments  
DESCRIPTION  
The SY100EP196V is a programmable delay line, varying  
the time a logic signal takes to traverse from IN to Q. This  
delay can vary from about 2.2ns to about 12.2ns. The input  
can be PECL, LVPECL, NECL, or LVNECL.  
The delay varies in discrete steps based on a control  
word presented to SY100EP196V. The 10-bit width of this  
latched control register allows for delay increments of  
approximately 10ps. In addition, delay may be varied  
continuously in about a 30ps range by setting the voltage at  
the FTUNE pin.  
■ 30ps fine tuning range  
■ PECL mode operating range: V = 3.0V to 5.5V  
with V = 0V  
CC  
EE  
■ NECL mode operating range: V = 0V  
with V = –3.0V to –5.5V  
CC  
EE  
■ Open input default state  
■ Safety clamp on inputs  
■ A logic high on the /EN pin will force Q to logic low  
■ D[0:10] can accept either ECL, CMOS, or TTL inputs  
An eleventh control bit allows the cascading of multiple  
SY100EP196V devices, for a wider delay range. Each  
additional SY100EP196V effectively doubles the delay range  
available.  
■ V output reference voltage  
BB  
■ Available in a 32-pin TQFP package  
For maximum flexibility, the control register interface  
accepts CMOS or TTL level signals, as well as the input  
level at the IN± pins.  
All support documentation can be found on Micrel’s web  
site at: www.micrel.com.  
CROSS REFERENCE TABLE  
APPLICATIONS  
■ Clock de-skewing  
■ Timing adjustment  
■ Aperture centering  
Micrel Semiconductor  
SY100EP196VTI  
ON Semiconductor  
MC100EP196FA  
SY100EP196VTITR  
MC100EP196FAR2  
TYPICAL PERFORMANCE  
TYPICAL APPLICATIONS CIRCUIT  
Delay vs. Tap  
12000  
Data Signal  
of Unknown Phase  
D
Q+  
Q–  
10000  
8000  
6000  
4000  
2000  
0
Flip-Flop  
SY100EP196V  
CLOCK+  
IN  
Q
CK  
/IN  
CLOCK–  
Fine Tune Voltage  
FTUNE /Q  
D[9:0]  
CONTROL  
LOGIC  
0
200 400 600 800 1000 1200  
TAP (DIGITAL WORD)  
ECL Pro is a registered trademark of Micrel, Inc.  
Rev.: E  
Amendment: /0  
M9999-072706  
hbwhelp@micrel.com or (408) 955-1690  
1
Issue Date: July 2006  
1234567...18

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SY100EP196VTGTR 替代型号

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