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Datasheet > 逻辑 > 总线驱动器/收发器> SNJ54ACT564FK
SNJ54ACT564FK PDF预览

SNJ54ACT564FK

更新时间： 2024-11-27 05:04:39
品牌 Logo 应用领域
德州仪器 - TI 总线驱动器总线收发器触发器逻辑集成电路输出元件
页数 文件大小 规格书
15页 556K
描述
OCTAL D-TYPE EDGE-TRIGGERED FLIP-FLOPS WITH 3-STATE OUTPUTS

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SNJ54ACT564FK 技术参数

生命周期：Obsolete零件包装代码：DFP
包装说明：DFP, LCC20,.35SQ针数：20
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.63Is Samacsys：N
其他特性：BROADSIDE VERSION OF 534系列：ACT
JESD-30 代码：R-GDFP-F20长度：13.09 mm
负载电容（CL）：50 pF逻辑集成电路类型：BUS DRIVER
最大I（ol）：0.024 A位数：8
功能数量：1端口数量：2
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
输出极性：INVERTED封装主体材料：CERAMIC, GLASS-SEALED
封装代码：DFP封装等效代码：LCC20,.35SQ
封装形状：RECTANGULAR封装形式：FLATPACK
包装方法：TUBE电源：5 V
Prop。Delay @ Nom-Sup：12.5 ns传播延迟（tpd）：12.5 ns
认证状态：Not Qualified筛选级别：MIL-PRF-38535
座面最大高度：2.54 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子形式：FLAT端子节距：1.27 mm
端子位置：DUAL触发器类型：POSITIVE EDGE
宽度：6.92 mmBase Number Matches：1

SNJ54ACT564FK 数据手册

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SN54ACT564, SN74ACT564  
OCTAL D-TYPE EDGE-TRIGGERED FLIP-FLOPS  
WITH 3-STATE OUTPUTS  
SCAS549B – NOVEMBER 1995 – REVISED NOVEMBER 2002  
SN54ACT564 . . . J OR W PACKAGE  
SN74ACT564 . . . DB, DW, N, NS, OR PW PACKAGE  
(TOP VIEW)  
4.5-V to 5.5-V V  
Operation  
CC  
Inputs Accept Voltages to 5.5 V  
Max t of 8.5 ns at 5 V  
pd  
OE  
1D  
2D  
3D  
4D  
5D  
6D  
7D  
8D  
V
CC  
1
2
3
4
5
6
7
8
9
10  
20  
19  
18  
17  
16  
15  
14  
Inputs Are TTL-Voltage Compatible  
1Q  
2Q  
3Q  
4Q  
5Q  
6Q  
3-State Inverted Outputs Drive Bus Lines  
Directly  
Flow-Through Architecture to Optimize  
PCB Layout  
Full Parallel Access for Loading  
13 7Q  
12 8Q  
description/ordering information  
11  
GND  
CLK  
The ’ACT564 devices are octal D-type  
edge-triggered flip-flops that feature 3-state  
outputs designed specifically for driving highly  
capacitive or relatively low-impedance loads.  
They are particularly suitable for implementing  
buffer registers, I/O ports, bidirectional bus  
drivers, and working registers.  
SN54ACT564 . . . FK PACKAGE  
(TOP VIEW)  
3
2
1
20 19  
18  
4
5
6
7
8
3D  
4D  
5D  
6D  
7D  
2Q  
3Q  
4Q  
5Q  
6Q  
On the positive transition of the clock (CLK) input,  
the Q outputs are set to the complements of the  
logic levels set up at the data (D) inputs.  
17  
16  
15  
14  
A buffered output-enable (OE) input places the  
eight outputs in either a normal logic state (high or  
low logic levels) or the high-impedance state. In  
the high-impedance state, the outputs neither  
load nor drive the bus lines significantly. The  
high-impedance state and increased drive  
provide the capability to drive bus lines without  
interface or pullup components.  
9 10 11 12 13  
ORDERING INFORMATION  
ORDERABLE  
PART NUMBER  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
PDIP – N  
Tube  
SN74ACT564N  
SN74ACT564N  
Tube  
SN74ACT564DW  
SN74ACT564DWR  
SN74ACT564NSR  
SN74ACT564DBR  
SN74ACT564PWR  
SNJ54ACT564J  
SOIC – DW  
ACT564  
Tape and reel  
Tape and reel  
Tape and reel  
Tape and reel  
Tube  
–40°C to 85°C  
SOP – NS  
SSOP – DB  
TSSOP – PW  
CDIP – J  
ACT564  
AD564  
AD564  
SNJ54ACT564J  
SNJ54ACT564W  
SNJ54ACT564FK  
–55°C to 125°C  
CFP – W  
Tube  
SNJ54ACT564W  
SNJ54ACT564FK  
LCCC – FK  
Tube  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines are  
available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2002, Texas Instruments Incorporated  
UNLESS OTHERWISE NOTED this document contains PRODUCTION  
DATA information current as of publication date. Products conform to  
specifications per the terms of Texas Instruments standard warranty.  
Production processing does not necessarily include testing of all  
parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...15

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型号 品牌 获取价格 描述 数据表
SNJ54ACT564J TI

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