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SN751508FT-00

更新时间： 2024-11-25 14:38:35
品牌 Logo 应用领域
德州仪器 - TI 驱动光电二极管接口集成电路
页数 文件大小 规格书
13页 182K
描述
DC PLASMA DISPLAY DRIVER, PDSO48

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SN751508FT-00 技术参数

生命周期：ObsoleteReach Compliance Code：unknown
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.84Is Samacsys：N
数据输入模式：PARALLEL接口集成电路类型：DC PLASMA DISPLAY DRIVER
JESD-30 代码：R-PDSO-G48复用显示功能：NO
功能数量：1区段数：32
端子数量：48最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE认证状态：Not Qualified
最大供电电压：5.5 V最小供电电压：4.5 V
标称供电电压：5 V表面贴装：YES
温度等级：COMMERCIAL端子形式：GULL WING
端子位置：DUAL最小 fmax：5 MHz
Base Number Matches：1

SN751508FT-00 数据手册

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SLDS035 − JANUARY 1987 − REVISED NOVEMBER 1989  
SN751508 . . . FT PACKAGE  
(TOP VIEW)  
D
D
D
D
D
D
Each Device Drives 32 Lines  
−120-V PNP Open-Collector Parallel  
Outputs  
Q32  
Q31  
Q1  
Q2  
1
2
3
4
5
6
7
8
9
48  
47  
46  
45  
44  
43  
42  
41  
40  
High-Speed Serially Shifted Data Inputs  
CMOS-Compatible Inputs  
Q30  
Q3  
Q29  
Q4  
Strobe and Sustain Inputs Provided  
Serial Data Output for Cascade Operation  
Q28  
Q5  
Q27  
Q6  
Q26  
Q7  
Q25  
Q8  
description  
Q24  
Q9  
The SN751508 and SN751518 are monolithic  
10 39  
11 38  
12 37  
13 36  
14 35  
15 34  
16 33  
17 32  
18 31  
19 30  
20 29  
21 28  
22 27  
23 26  
24 25  
Q23  
Q22  
Q21  
Q20  
Q19  
Q18  
Q17  
GND  
NC  
Q10  
Q11  
Q12  
Q13  
Q14  
Q15  
Q16  
GND  
SUSTAIN  
NC  
LATCH ENABLE  
NC  
integrated circuits designed to drive the data lines  
of a dc plasma panel display. The SN751518 pin  
sequence is reversed from the SN751508 for  
ease in printed-circuit-board layout.  
Each device consists of two 16-bit shift registers,  
32 latches, 32 OR gates, and 32 pnp open-  
collector output AND gates. Typically, a 32-bit  
data string is split into two 16-bit data strings  
externally and then entered in parallel into the shift  
registers on the high-to-low transition of the clock  
signal. A high LATCH ENABLE transfers the data  
from the shift registers to the inputs of 32 OR gates  
through the latches. Data present in the latch  
during the high-to-low transition of LATCH  
ENABLE is stored. When STROBE is high, the  
latch is masked and a high is placed on the data  
input of the output AND gates. When STROBE is  
low and SUSTAIN is high, data from the latches is  
reflected at the outputs. When low, SUSTAIN  
forces all outputs to their off state. Drivers can be  
cascaded via the serial data outputs of the static  
shift registers. These outputs are not affected by  
LATCH ENABLE, STROBE, or SUSTAIN.  
STROBE  
NC  
CLOCK  
V
V
CC  
CC  
SERIAL OUT2  
SERIAL OUT1  
DATA IN2  
DATA IN1  
SN751518 . . . FT PACKAGE  
(TOP VIEW)  
Q1  
Q2  
Q3  
Q4  
Q5  
Q6  
Q7  
Q8  
Q9  
Q32  
Q31  
Q30  
Q29  
Q28  
Q27  
Q26  
Q25  
1
2
3
4
5
6
7
8
9
48  
47  
46  
45  
44  
43  
42  
41  
The SN751508 and the SN751518 are  
characterized from 0°C to 70°C.  
40 Q24  
39 Q23  
Q10 10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
28  
27  
26  
25  
Q11  
Q12  
Q13  
Q14  
Q15  
Q16  
GND  
Q22  
Q21  
Q20  
Q19  
Q18  
Q17  
GND  
NC  
STROBE  
NC  
SUSTAIN  
NC  
LATCH ENABLE  
NC  
CLOCK  
V
V
CC  
CC  
DATA IN2  
DATA IN1  
SERIAL OUT2  
SERIAL OUT1  
NC − No internal connection  
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Copyright 1989, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443  
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