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SN74LVC2G08IDCURQ1 PDF预览

SN74LVC2G08IDCURQ1

更新时间： 2024-02-04 09:44:00
品牌 Logo 应用领域
德州仪器 - TI 栅极触发器逻辑集成电路光电二极管输入元件
页数 文件大小 规格书
7页 122K
描述
DUAL 2-INPUT POSITIVE-AND GATE

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SN74LVC2G08IDCURQ1 技术参数

生命周期：Obsolete零件包装代码：SOIC
包装说明：VSSOP, TSSOP8,.12,20针数：8
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.14系列：LVC/LCX/Z
JESD-30 代码：R-PDSO-G8长度：2.3 mm
负载电容（CL）：50 pF逻辑集成电路类型：AND GATE
最大I（ol）：0.024 A功能数量：2
输入次数：2端子数量：8
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：VSSOP
封装等效代码：TSSOP8,.12,20封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, VERY THIN PROFILE, SHRINK PITCH包装方法：TAPE AND REEL
电源：3.3 VProp。Delay @ Nom-Sup：4.7 ns
传播延迟（tpd）：9 ns认证状态：Not Qualified
施密特触发器：NO筛选级别：AEC-Q100
座面最大高度：0.9 mm子类别：Gates
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：1.65 V
标称供电电压 (Vsup)：1.8 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：0.5 mm
端子位置：DUAL宽度：2 mm
Base Number Matches：1

SN74LVC2G08IDCURQ1 数据手册

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SCES557A − MARCH 2004 − REVISED MAY 2004  
D
Qualification in Accordance With  
AEC-Q100  
D
D
D
I
Supports Partial-Power-Down Mode  
off  
†
Operation  
D
Qualified for Automotive Applications  
Latch-Up Performance Exceeds 100 mA Per  
JESD 78, Class II  
D
Customer-Specific Configuration Control  
Can Be Supported Along With  
Major-Change Approval  
ESD Protection Exceeds JESD 22  
− 2000-V Human-Body Model (A114-A)  
− 1000-V Charged-Device Model (C101)  
D
D
D
D
D
D
Supports 5-V V  
Operation  
CC  
Inputs Accept Voltages to 5.5 V  
DCT OR DCU PACKAGE  
(TOP VIEW)  
Max t of 4.7 ns at 3.3 V  
pd  
Low Power Consumption, 10-µA Max I  
CC  
1
2
3
4
8
7
6
5
24-mA Output Drive at 3.3 V  
1A  
1B  
2Y  
V
CC  
1Y  
2B  
2A  
Typical V  
<0.8 V at V  
(Output Ground Bounce)  
OLP  
CC  
= 3.3 V, T = 25°C  
A
GND  
D
Typical V  
(Output V  
Undershoot)  
OHV  
OH  
>2 V at V  
= 3.3 V, T = 25°C  
CC  
A
†
Contact factory for details. Q100 qualification data available on  
request.  
description/ordering information  
This dual 2-input positive-AND gate is designed for 1.65-V to 5.5-V V  
operation.  
CC  
Y + A • B or Y + A ) B  
The SN74LVC2G08 performs the Boolean function  
in positive logic.  
This device is fully specified for partial-power-down applications using I . The I circuitry disables the outputs,  
off  
off  
preventing damaging current backflow through the device when it is powered down.  
ORDERING INFORMATION  
ORDERABLE  
TOP-SIDE  
‡
PACKAGE  
T
A
§
PART NUMBER  
SN74LVC2G08IDCTRQ1  
SN74LVC2G08IDCURQ1  
MARKING  
C08_ _ _  
C08_  
SSOP − DCT  
Tape and reel  
Tape and reel  
−40°C to 85°C  
VSSOP − DCU  
‡
§
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines are available at  
www.ti.com/sc/package.  
DCT: The actual top-side marking has three additional characters that designate the year, month, and assembly/test site.  
DCU: The actual top-side marking has one additional character that designates the assembly/test site.  
Product Preview  
FUNCTION TABLE  
(each gate)  
INPUTS  
OUTPUT  
Y
A
B
H
X
L
H
L
H
L
L
X
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
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Copyright 2004, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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