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Datasheet > 逻辑 > 栅极> SN74LV21ADBRG4
SN74LV21ADBRG4 PDF预览

SN74LV21ADBRG4

更新时间： 2024-11-25 05:17:03
品牌 Logo 应用领域
德州仪器 - TI 栅极触发器逻辑集成电路光电二极管
页数 文件大小 规格书
16页 385K
描述
DUAL 4-INPIT POSITIVE-AND GATES

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SN74LV21ADBRG4 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SSOP
包装说明：GREEN, PLASTIC, SSOP-14针数：14
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.73Is Samacsys：N
系列：LV/LV-A/LVX/HJESD-30 代码：R-PDSO-G14
JESD-609代码：e4长度：6.2 mm
负载电容（CL）：50 pF逻辑集成电路类型：AND GATE
最大I（ol）：0.006 A湿度敏感等级：1
功能数量：2输入次数：4
端子数量：14最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装等效代码：SSOP14,.3
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：260
电源：3.3 VProp。Delay @ Nom-Sup：12 ns
传播延迟（tpd）：19 ns认证状态：Not Qualified
施密特触发器：NO座面最大高度：2 mm
子类别：Gates最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：2.5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：5.3 mmBase Number Matches：1

SN74LV21ADBRG4 数据手册

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SCES340E − SEPTEMBER 2000 − REVISED APRIL 2005  
SN54LV21A . . . J OR W PACKAGE  
SN74LV21A . . . D, DB, DGV, NS, OR PW PACKAGE  
(TOP VIEW)  
D
D
D
D
D
D
D
2-V to 5.5-V V  
Operation  
CC  
Max t of 6 ns at 5 V  
pd  
Typical V  
<0.8 V at V  
(Output Ground Bounce)  
OLP  
CC  
= 3.3 V, T = 25°C  
1A  
1B  
V
CC  
1
2
3
4
5
6
7
14  
13  
12  
11  
A
2D  
2C  
NC  
Typical V  
>2.3 V at V  
(Output V  
Undershoot)  
OHV  
CC  
OH  
NC  
1C  
= 3.3 V, T = 25°C  
A
I
Supports Partial-Power-Down Mode  
off  
1D  
10 2B  
Operation  
9
8
1Y  
2A  
2Y  
Latch-Up Performance Exceeds 100 mA Per  
JESD 78, Class II  
GND  
ESD Protection Exceeds JESD 22  
− 2000-V Human-Body Model (A114-A)  
− 200-V Machine Model (A115-A)  
SN54LV21A . . . FK PACKAGE  
(TOP VIEW)  
− 1000-V Charged-Device Model (C101)  
description/ordering information  
3
2
1
20 19  
18  
2C  
NC  
NC  
NC  
NC  
1C  
NC  
1D  
4
5
6
7
8
These dual 4-input positive-AND gates are  
17  
16  
designed for 2-V to 5.5-V V  
operation.  
CC  
15 NC  
14  
9 10 11 12 13  
The ’LV21A devices perform the Boolean function  
2B  
Y + A • B • C • D or Y + A ) B ) C ) D  
positive logic.  
in  
These devices are fully specified for  
partial-power-down applications using I . The I  
circuitry disables the outputs, preventing  
damaging current backflow through the devices  
when they are powered down.  
off  
off  
NC − No internal connection  
ORDERING INFORMATION  
ORDERABLE  
PART NUMBER  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
Tube of 50  
SN74LV21AD  
SOIC − D  
LV21A  
Reel of 2500  
Reel of 2000  
Reel of 2000  
Tube of 90  
SN74LV21ADR  
SN74LV21ANSR  
SN74LV21ADBR  
SN74LV21APW  
SN74LV21APWR  
SN74LV21APWT  
SN74LV21ADGVR  
SNJ54LV21AJ  
SOP − NS  
74LV21A  
LV21A  
SSOP − DB  
−40°C to 85°C  
Reel of 2000  
Reel of 250  
Reel of 2000  
Tube of 25  
TSSOP − PW  
LV21A  
TVSOP − DGV  
CDIP − J  
LV21A  
SNJ54LV21AJ  
SNJ54LV21AW  
SNJ54LV21AFK  
−55°C to 125°C  
CFP − W  
Tube of 150  
Tube of 55  
SNJ54LV21AW  
SNJ54LV21AFK  
LCCC − FK  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design  
guidelines are available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2005, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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SN74LV21ADBRG4 替代型号

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