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SN74LV138ATDRE4

更新时间： 2024-02-20 17:22:23
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德州仪器 - TI 解复用器
页数 文件大小 规格书
20页 867K
描述
3-LINE TO 8-LINE DECODER/DEMULTIPLEXER

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SN74LV138ATDRE4 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP, SOP16,.25针数：16
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.26
系列：LV/LV-A/LVX/H输入调节：STANDARD
JESD-30 代码：R-PDSO-G16JESD-609代码：e4
长度：9.9 mm负载电容（CL）：50 pF
逻辑集成电路类型：OTHER DECODER/DRIVER最大I（ol）：0.012 A
湿度敏感等级：1功能数量：1
端子数量：16最高工作温度：125 °C
最低工作温度：-40 °C输出极性：INVERTED
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP16,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：260电源：5 V
Prop。Delay @ Nom-Sup：14 ns传播延迟（tpd）：14 ns
认证状态：Not Qualified座面最大高度：1.75 mm
子类别：Decoder/Drivers最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：3.9 mmBase Number Matches：1

SN74LV138ATDRE4 数据手册

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SN74LV138AT  
3-LINE TO 8-LINE DECODER/DEMULTIPLEXER  
www.ti.com  
SCLS691–AUGUST 2005  
FEATURES  
•
•
•
•
Inputs Are TTL-Voltage Compatible  
4.5-V to 5.5-V VCC Operation  
Max tpd of 7.6 ns at 5 V  
•
•
•
Ioff Supports Partial-Power Down Mode  
Operation  
Latch-Up Performance Exceeds 250 mA Per  
JESD 17  
Typical VOLP (Output Ground Bounce)  
<0.8 V at VCC = 5 V, TA = 25°C  
ESD Protection Exceeds JESD 22  
– 2000-V Human-Body Model (A114-A)  
– 200-V Machine Model (A115-A)  
•
•
Typical VOHV (Output VOH Undershoot)  
>2.3 V at VCC = 5 V, TA = 25°C  
Support Mixed-Mode Voltage Operation on All  
Ports  
– 1000-V Charged-Device Model (C101)  
D, DB, DGV, NS, OR PW PACKAGE  
(TOP VIEW)  
RGY PACKAGE  
(TOP VIEW)  
A
B
V
CC  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
Y0  
Y1  
Y2  
1
16  
C
15  
14  
13  
12  
11  
10  
B
C
G2A  
G2B  
G1  
2
3
4
5
6
7
Y0  
Y1  
Y2  
Y3  
Y4  
Y5  
G2A  
G2B  
G1  
12 Y3  
11  
10  
9
Y4  
Y5  
Y6  
Y7  
GND  
Y7  
8
9
DESCRIPTION/ORDERING INFORMATION  
The SN74LV138AT is a 3-line to 8-line decoder/demultiplexer, designed for high-performance memory-decoding  
or data-routing applications requiring very short propagation delay times. In high-performance memory systems,  
this decoder can be used to minimize the effects of system decoding. When employed with high-speed memories  
utilizing a fast enable circuit, the delay times of the decoder and the enable time of the memory usually are less  
than the typical access time of the memory. This means that the effective system delay introduced by the  
decoder is negligible.  
ORDERING INFORMATION  
TA  
PACKAGE(1)  
ORDERABLE PART NUMBER  
SN74LV138ATRGYR  
SN74LV138ATD  
TOP-SIDE MARKING  
VV138AT  
QFN – RGY  
SOIC – D  
Reel of 1000  
Tube of 40  
LV138AT  
Reel fo 2500  
Reel of 2000  
Reel of 2000  
Reel of 2000  
Tube of 90  
SN74LV138ATDR  
SOP – NS  
SN74LV138ATNSR  
SN74LV138ATDBR  
SN74LV138ATDGVR  
SN74LV138ATPW  
74LV138AT  
LV138AT  
LV138AT  
–40°C to 125°C  
SSOP – DB  
TVSOP – DGV  
TSSOP – PW  
Reel of 2000  
Reel of 250  
SN74LV138ATPWR  
SN74LV138ATPWT  
LV138AT  
(1) Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines are available at  
www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of Texas  
Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
PRODUCTION DATA information is current as of publication date.  
Copyright © 2005, Texas Instruments Incorporated  
Products conform to specifications per the terms of the Texas  
Instruments standard warranty. Production processing does not  
necessarily include testing of all parameters.  
1234567...20

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型号 品牌 获取价格 描述 数据表
SN74LV138ATDRG4 TI

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