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Datasheet > 逻辑 > 栅极> SN74LS00PSRG4
SN74LS00PSRG4 PDF预览

SN74LS00PSRG4

更新时间： 2024-11-04 05:04:47
品牌 Logo 应用领域
德州仪器 - TI 栅极触发器逻辑集成电路光电二极管输入元件
页数 文件大小 规格书
21页 738K
描述
QUADRUPLE 2-INPUT POSITIVE-NAND GATES

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SN74LS00PSRG4 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：SOP, SOP8,.3针数：8
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.4Is Samacsys：N
系列：LSJESD-30 代码：R-PDSO-G8
JESD-609代码：e4长度：6.2 mm
负载电容（CL）：15 pF逻辑集成电路类型：NAND GATE
最大I（ol）：0.008 A湿度敏感等级：1
功能数量：4输入次数：2
端子数量：8最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP8,.3
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
包装方法：TR峰值回流温度（摄氏度）：260
电源：5 V最大电源电流（ICC）：4.4 mA
Prop。Delay @ Nom-Sup：15 ns传播延迟（tpd）：15 ns
认证状态：Not Qualified施密特触发器：NO
座面最大高度：2 mm子类别：Gates
最大供电电压 (Vsup)：5.25 V最小供电电压 (Vsup)：4.75 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：TTL温度等级：COMMERCIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：5.3 mm
Base Number Matches：1

SN74LS00PSRG4 数据手册

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SDLS025B − DECEMBER 1983 − REVISED OCTOBER 2003  
D
Package Options Include Plastic  
Small-Outline (D, NS, PS), Shrink  
Small-Outline (DB), and Ceramic Flat (W)  
Packages, Ceramic Chip Carriers (FK), and  
Standard Plastic (N) and Ceramic (J) DIPs  
D
Also Available as Dual 2-Input  
Positive-NAND Gate in Small-Outline (PS)  
Package  
SN5400 . . . J PACKAGE  
SN54LS00, SN54S00 . . . J OR W PACKAGE  
SN7400, SN74S00 . . . D, N, OR NS PACKAGE  
SN74LS00 . . . D, DB, N, OR NS PACKAGE  
(TOP VIEW)  
SN74LS00, SN74S00 . . . PS PACKAGE  
(TOP VIEW)  
V
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CC  
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4A  
4Y  
3B  
3A  
3Y  
GND  
2Y  
GND  
8
SN5400 . . . W PACKAGE  
(TOP VIEW)  
SN54LS00, SN54S00 . . . FK PACKAGE  
(TOP VIEW)  
1A  
1B  
1Y  
4Y  
4B  
4A  
GND  
3B  
1
2
3
4
5
6
7
14  
13  
12  
11  
10  
9
3
2 1 20 19  
18  
4A  
NC  
4Y  
NC  
3B  
1Y  
NC  
2A  
4
5
6
7
8
V
17  
16  
15  
14  
CC  
2Y  
2A  
2B  
3A  
3Y  
NC  
2B  
8
9 10 11 12 13  
NC − No internal connection  
description/ordering information  
These devices contain four independent 2-input NAND gates. The devices perform the Boolean function  
Y = A • B or Y = A + B in positive logic.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
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Copyright 2003, Texas Instruments Incorporated  
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POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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SN74LS00PSRG4 替代型号

型号 品牌 替代类型 描述 数据表
SN74LS00PSRE4 TI

完全替代

 QUADRUPLE 2-INPUT POSITIVE-NAND GATES
SN74LS00PSR TI

类似代替

 QUADRUPLE 2-INPUT POSITIVE-NAND GATES

与SN74LS00PSRG4相关器件

型号 品牌 获取价格 描述 数据表
SN74LS01 TI

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 		QUADRUPLE 2-INPUT POSITIVE-NAND GATES WITH OPEN-COLLECTOR OUTPUTS
SN74LS01D TI

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 		QUADRUPLE 2-INPUT POSITIVE-NAND GATES WITH OPEN-COLLECTOR OUTPUTS
SN74LS01D MOTOROLA

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 		QUAD 2-INPUT NAND GATE
SN74LS01DR TI

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 		QUADRUPLE 2-INPUT POSITIVE-NAND GATES WITH OPEN-COLLECTOR OUTPUTS
SN74LS01FN TI

获取价格

 		QUADRUPLE 2-INPUT POSITIVE-NAND GATES WITH OPEN-COLLECTOR OUTPUTS
SN74LS01J TI

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 		QUADRUPLE 2-INPUT POSITIVE-NAND GATES WITH OPEN-COLLECTOR OUTPUTS
SN74LS01J MOTOROLA

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 		LS SERIES, QUAD 2-INPUT NAND GATE, CDIP14, CERAMIC, DIP-14
SN74LS01J-00 TI

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 		IC LS SERIES, QUAD 2-INPUT NAND GATE, CDIP14, Gate
SN74LS01JD MOTOROLA

获取价格

 		LS SERIES, QUAD 2-INPUT NAND GATE, CDIP14, CERAMIC, DIP-14
SN74LS01JDS MOTOROLA

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 		LS SERIES, QUAD 2-INPUT NAND GATE, CDIP14, CERAMIC, DIP-14

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