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SN74HC20

更新时间： 2024-01-22 21:51:17
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德州仪器 - TI 输入元件
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5页 70K
描述
DUAL 4-INPUT POSITIVE-NAND GATES

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SN74HC20 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：TSSOP
包装说明：TSSOP, TSSOP14,.25针数：14
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.16系列：HC/UH
JESD-30 代码：R-PDSO-G14JESD-609代码：e4
长度：5 mm负载电容（CL）：50 pF
逻辑集成电路类型：NAND GATE最大I（ol）：0.0052 A
湿度敏感等级：1功能数量：2
输入次数：4端子数量：14
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP14,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH包装方法：TR
峰值回流温度（摄氏度）：260电源：2/6 V
最大电源电流（ICC）：0.02 mAProp。Delay @ Nom-Sup：28 ns
传播延迟（tpd）：140 ns认证状态：Not Qualified
施密特触发器：NO座面最大高度：1.2 mm
子类别：Gates最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：4.4 mmBase Number Matches：1

SN74HC20 数据手册

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SN54HC20, SN74HC20  
DUAL 4-INPUT POSITIVE-NAND GATES  
SCLS086D – DECEMBER 1982 – REVISED FEBRUARY 2000  
SN54HC20 . . . J OR W PACKAGE  
SN74HC20 . . . D, DB, N, OR PW PACKAGE  
(TOP VIEW)  
Package Options Include Plastic  
Small-Outline (D), Shrink Small-Outline  
(DB), Thin Shrink Small-Outline (PW), and  
Ceramic Flat (W) Packages, Ceramic Chip  
Carriers (FK), and Standard Plastic (N) and  
Ceramic (J) DIPs  
1A  
1B  
V
CC  
1
2
3
4
5
6
7
14  
13  
12  
11  
2D  
2C  
NC  
NC  
1C  
description  
1D  
10 2B  
The ’HC20 devices contain two independent  
4-input NAND gates. They perform the Boolean  
function Y = A • B • C • D or Y = A + B + C + D in  
positive logic.  
9
8
1Y  
2A  
2Y  
GND  
SN54HC20 . . . FK PACKAGE  
(TOP VIEW)  
The SN54HC20 is characterized for operation  
over the full military temperature range of –55°C  
to 125°C. The SN74HC20 is characterized for  
operation from –40°C to 85°C.  
3
2
1
20 19  
18  
2C  
NC  
NC  
NC  
NC  
1C  
NC  
1D  
4
5
6
7
8
FUNCTION TABLE  
(each gate)  
17  
16  
INPUTS  
OUTPUT  
Y
15 NC  
14  
9 10 11 12 13  
A
H
L
B
C
H
X
X
L
D
H
X
X
X
L
2B  
H
X
L
L
H
H
H
H
X
X
X
X
X
NC – No internal connection  
X
†
logic symbol  
1
1A  
1B  
1C  
1D  
2A  
2B  
2C  
2D  
&
2
6
4
1Y  
5
9
10  
12  
13  
8
2Y  
†
This symbol is in accordance with ANSI/IEEE Std 91-1984 and IEC Publication 617-12.  
Pin numbers shown are for the D, DB, J, N, PW, and W packages.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2000, Texas Instruments Incorporated  
On products compliant to MIL-PRF-38535, all parameters are tested  
unless otherwise noted. On all other products, production  
processing does not necessarily include testing of all parameters.  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
12345

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