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SN74AUC1G02YEAR PDF预览

SN74AUC1G02YEAR

更新时间： 2024-11-20 02:58:03
品牌 Logo 应用领域
德州仪器 - TI 栅极触发器逻辑集成电路输入元件
页数 文件大小 规格书
14页 480K
描述
SINGLE 2-INPUT POSITIVE-NOR GATE

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SN74AUC1G02YEAR 技术参数

是否Rohs认证：不符合生命周期：Obsolete
零件包装代码：DSBGA包装说明：MO-211EA, DSBGA-5
针数：5Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.63
Is Samacsys：N系列：AUC
JESD-30 代码：R-XBGA-B5长度：1.4 mm
负载电容（CL）：15 pF逻辑集成电路类型：NOR GATE
最大I（ol）：0.005 A功能数量：1
输入次数：2端子数量：5
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：UNSPECIFIED封装代码：VFBGA
封装等效代码：BGA5,2X3,20封装形状：RECTANGULAR
封装形式：GRID ARRAY, VERY THIN PROFILE, FINE PITCH包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：NOT SPECIFIED电源：1.2/2.5 V
Prop。Delay @ Nom-Sup：3.2 ns传播延迟（tpd）：3.2 ns
认证状态：Not Qualified施密特触发器：NO
座面最大高度：0.5 mm子类别：Gates
最大供电电压 (Vsup)：2.7 V最小供电电压 (Vsup)：0.8 V
标称供电电压 (Vsup)：1.2 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：BALL端子节距：0.5 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：0.9 mmBase Number Matches：1

SN74AUC1G02YEAR 数据手册

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SCES369M − SEPTEMBER 2001 − REVISED MAY 2005  
D
D
Available in the Texas Instruments  
NanoStarand NanoFreePackages  
Optimized for 1.8-V Operation and Is 3.6-V  
I/O Tolerant to Support Mixed-Mode Signal  
Operation  
D
D
D
D
Low Power Consumption, 10-µA Max I  
8-mA Output Drive at 1.8 V  
CC  
Latch-Up Performance Exceeds 100 mA Per  
JESD 78, Class II  
ESD Protection Exceeds JESD 22  
− 2000-V Human-Body Model (A114-A)  
− 200-V Machine Model (A115-A)  
D
I
Supports Partial-Power-Down Mode  
off  
Operation  
D
Sub 1-V Operable  
− 1000-V Charged-Device Model (C101)  
D
Max t of 2.4 ns at 1.8 V  
pd  
DCK PACKAGE  
(TOP VIEW)  
YEA, YEP, YZA,  
DRL PACKAGE  
DBV PACKAGE  
(TOP VIEW)  
OR YZP PACKAGE  
(TOP VIEW)  
(BOTTOM VIEW)  
1
2
3
5
4
A
B
V
1
2
3
5
A
B
V
Y
CC  
3
2
1
4
CC  
Y
GND  
B
1
2
3
5
4
A
B
V
Y
CC  
5
GND  
V
A
CC  
4
GND  
Y
GND  
See mechanical drawings for dimensions.  
description/ordering information  
This single 2-input positive-NOR gate is operational at 0.8-V to 2.7-V V , but is designed specifically for 1.65-V  
CC  
to 1.95-V V  
operation.  
CC  
The SN74AUC1G02 performs the Boolean function Y = A + B or Y = A • B in positive logic.  
ORDERING INFORMATION  
†
‡
T
A
PACKAGE  
ORDERABLE PART NUMBER  
TOP-SIDE MARKING  
NanoStar− WCSP (DSBGA)  
0.17-mm Small Bump − YEA  
SN74AUC1G02YEAR  
NanoFree− WCSP (DSBGA)  
0.17-mm Small Bump − YZA (Pb-free)  
SN74AUC1G02YZAR  
SN74AUC1G02YEPR  
SN74AUC1G02YZPR  
Tape and reel  
_ _ _UB_  
NanoStar− WCSP (DSBGA)  
0.23-mm Large Bump − YEP  
−40°C to 85°C  
NanoFree− WCSP (DSBGA)  
0.23-mm Large Bump − YZP (Pb-free)  
SOT (SOT-23) − DBV  
SOT (SC-70) − DCK  
Tape and reel  
Tape and reel  
SN74AUC1G02DBVR  
SN74AUC1G02DCKR  
U02_  
UB_  
SOT (SOT-553) − DRL  
Reel of 4000  
SN74AUC1G02DRLR  
UB_  
†
‡
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines are available at  
www.ti.com/sc/package.  
DBV/DCK/DRL: The actual top-side marking has one additional character that designates the assembly/test site.  
YEA/YZA, YEP/YZP: The actual top-side marking has three preceding characters to denote year, month, and sequence code, and one following  
character to designate the assembly/test site. Pin 1 identifier indicates solder-bump composition (1 = SnPb, • = Pb-free).  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
NanoStar and NanoFree are trademarks of Texas Instruments.  
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Copyright 2005, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...14

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SN74AUC1G02YEAR 替代型号

型号 品牌 替代类型 描述 数据表
SN74AUC1G02YZPR TI

完全替代

 SINGLE 2-INPUT POSITIVE-NOR GATE
SN74AUC1G02YEPR TI

完全替代

 SINGLE 2-INPUT POSITIVE-NOR GATE
SN74AUC1G02YZAR TI

类似代替

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型号 品牌 获取价格 描述 数据表
SN74AUC1G02YEPR TI

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