5秒后页面跳转
捷配首页

Datasheet > 逻辑 > 总线驱动器/收发器> SN74ALVC16721DLR
SN74ALVC16721DLR PDF预览

SN74ALVC16721DLR

更新时间： 2024-11-09 13:13:47
品牌 Logo 应用领域
德州仪器 - TI 触发器输出元件
页数 文件大小 规格书
8页 137K
描述
3.3-V 20-Bit Flip-Flop With 3-State Outputs 56-SSOP -40 to 85

阅读下载

中文翻译

获取价格

SN74ALVC16721DLR 技术参数

是否无铅：含铅是否Rohs认证：不符合
生命周期：Obsolete零件包装代码：SSOP
包装说明：SSOP, SSOP56,.4针数：56
Reach Compliance Code：not_compliant风险等级：5.4
Is Samacsys：N其他特性：WITH CLOCK ENABLE
系列：ALVC/VCX/AJESD-30 代码：R-PDSO-G56
长度：18.415 mm负载电容（CL）：50 pF
逻辑集成电路类型：BUS DRIVER最大频率@ Nom-Sup：150000000 Hz
最大I（ol）：0.024 A位数：20
功能数量：1端口数量：2
端子数量：56最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装等效代码：SSOP56,.4
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：NOT SPECIFIED
电源：3.3 VProp。Delay @ Nom-Sup：4.9 ns
传播延迟（tpd）：7 ns认证状态：Not Qualified
座面最大高度：2.79 mm子类别：FF/Latches
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：2.3 V
标称供电电压 (Vsup)：2.5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：7.5 mm
Base Number Matches：1

SN74ALVC16721DLR 数据手册

 浏览型号SN74ALVC16721DLR的Datasheet PDF文件第2页浏览型号SN74ALVC16721DLR的Datasheet PDF文件第3页浏览型号SN74ALVC16721DLR的Datasheet PDF文件第4页浏览型号SN74ALVC16721DLR的Datasheet PDF文件第5页浏览型号SN74ALVC16721DLR的Datasheet PDF文件第6页浏览型号SN74ALVC16721DLR的Datasheet PDF文件第7页 
ꢀ
ꢁ
ꢂ
ꢃ
ꢄ
ꢅ
ꢆ
ꢇ
ꢈ
ꢉ
ꢋ ꢌꢋ ꢍꢆ ꢊ ꢎ ꢍꢏꢐ ꢑ ꢒꢅ ꢐꢓ ꢍ ꢒꢅꢔ  
ꢂ
ꢊ
ꢈ
ꢓ
ꢀ
ꢕ
ꢐ
ꢑ
ꢖ
ꢋ
ꢍ
ꢀ
ꢑ
ꢄ
ꢑ
ꢗ
ꢔ
ꢘ
ꢑ
ꢓ
ꢘ
ꢑ
SCAS267A − MARCH 1993 − REVISED MAY 1995  
DGG OR DL PACKAGE  
(TOP VIEW)  
D Member of the Texas Instruments  
WidebusFamily  
D EPIC (Enhanced-Performance Implanted  
D ESD Protection Exceeds 2000 V Per  
MIL-STD-883C, Method 3015; Exceeds  
200 V Using Machine Model (C = 200 pF,  
R = 0)  
OE  
Q1  
Q2  
GND  
Q3  
Q4  
1
2
3
4
5
6
7
8
9
10  
56 CLK  
55 D1  
54 D2  
53 GND  
52 D3  
51 D4  
CMOS) Submicron Process  
D Latch-Up Performance Exceeds 250 mA  
V
50  
V
CC  
CC  
Per JEDEC Standard JESD-17  
Q5  
Q6  
Q7  
GND 11  
Q8 12  
49 D5  
48 D6  
D Bus Hold On Data Inputs Eliminates the  
Need for External Pullup/Pulldown  
Resistors  
47  
D7  
46 GND  
45 D8  
D Package Options Include Plastic 300-mil  
Shrink Small-Outline (DL) and Thin Shrink  
Small-Outline (DGG) Packages  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
25  
26  
27  
28  
44  
43  
42  
41  
40  
39  
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
Q9  
Q10  
Q11  
Q12  
Q13  
GND  
Q14  
Q15  
Q16  
D9  
D10  
D11  
D12  
D13  
GND  
D14  
D15  
D16  
description  
This 20-bit flip-flop is designed specifically for  
low-voltage (3.3-V) V operation; it is tested at  
CC  
2.5-V, 2.7-V, and 3.3-V V  
.
CC  
The SN74ALVC16721’s 20 flip-flops are edge-  
triggered D-type flip-flops with qualified clock  
storage. On the positive transition of the clock  
(CLK) input, the device provides true data at the  
Q outputs if the clock-enable (CLKEN) input is low.  
If CLKEN is high, no data is stored.  
V
V
CC  
CC  
Q17  
Q18  
GND  
Q19  
Q20  
NC  
D17  
D18  
GND  
D19  
D20  
A buffered output-enable (OE) input places the  
20 outputs in either a normal logic state (high  
or low level) or a high-impedance state. In the  
high-impedance state, the outputs neither load  
CLKEN  
nor drive the bus lines significantly. The high-impedance state and increased drive provide the capability to drive  
bus lines without interface or pullup components. OE does not affect the internal operation of the flip-flops. Old  
data can be retained or new data can be entered while the outputs are in the high-impedance state.  
Active bus-hold circuitry holds unused or floating data inputs at a valid logic level.  
The SN74ALVC16721 is available in TI’s shrink small-outline (DL) and thin shrink small-outline (DGG)  
packages, which provide twice the I/O pin count and functionality of standard small-outline packages in the  
same printed-circuit-board area.  
The SN74ALVC16721 is characterized for operation from −40°C to 85°C.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
EPIC and Widebus are trademarks of Texas Instruments Incorporated.  
ꢓ
ꢓ
ꢙ
ꢔ
ꢪ
ꢚ
ꢥ
ꢘ
ꢇ
ꢣ
ꢑ
ꢤ
ꢐ
ꢞ
ꢔ
ꢜ
ꢁ
ꢝ
ꢚ
ꢄ
ꢑ
ꢄ
ꢛ
ꢜ
ꢦ
ꢝ
ꢞ
ꢤ
ꢟ
ꢠ
ꢡ
ꢡ
ꢢ
ꢢ
ꢛ
ꢛ
ꢞ
ꢞ
ꢜ
ꢜ
ꢛ
ꢣ
ꢣ
ꢧ
ꢤ
ꢥ
ꢟ
ꢟ
ꢦ
ꢦ
ꢜ
ꢢ
ꢡ
ꢠ
ꢣ
ꢣ
ꢞ
ꢝ
ꢧ
ꢑꢦ  
ꢥ
ꢨ
ꢣ
ꢩ
ꢛ
ꢤ
ꢡ
ꢣ
ꢢ
ꢛ
ꢢ
ꢞ
ꢟ
ꢜ
ꢥ
ꢪ
ꢡ
ꢜ
ꢢ
ꢢ
ꢦ
ꢣ
ꢌ
Copyright 1995, Texas Instruments Incorporated  
ꢟ
ꢞ
ꢤ
ꢢ
ꢞ
ꢟ
ꢠ
ꢢ
ꢞ
ꢣ
ꢧ
ꢛ
ꢝ
ꢛ
ꢤ
ꢦ
ꢟ
ꢢ
ꢫ
ꢢ
ꢦ
ꢟ
ꢞ
ꢝ
ꢬ
ꢡ
ꢐ
ꢜ
ꢠ
ꢦ
ꢣ
ꢢ
ꢡ
ꢜ
ꢪ
ꢡ
ꢟ
ꢪ
ꢭ
ꢡ
ꢢ ꢦ ꢣ ꢢꢛ ꢜꢯ ꢞꢝ ꢡ ꢩꢩ ꢧꢡ ꢟ ꢡ ꢠ ꢦ ꢢ ꢦ ꢟ ꢣ ꢌ  
ꢟ
ꢟ
ꢡ
ꢜ
ꢢ
ꢮ
ꢌ
ꢓ
ꢟ
ꢞ
ꢪ
ꢥ
ꢤ
ꢢ
ꢛ
ꢞ
ꢜ
ꢧ
ꢟ
ꢞ
ꢤ
ꢦ
ꢣ
ꢣ
ꢛ
ꢜ
ꢯ
ꢪ
ꢞ
ꢦ
ꢣ
ꢜ
ꢞ
ꢢ
ꢜ
ꢦ
ꢤ
ꢦ
ꢣ
ꢣ
ꢡ
ꢟ
ꢛ
ꢩ
ꢮ
ꢛ
ꢜ
ꢤ
ꢩ
ꢥ
ꢪ
ꢦ
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443  
12345678

中文翻译

下载PDF

与SN74ALVC16721DLR相关器件

型号 品牌 获取价格 描述 数据表
SN74ALVC16821 TI

获取价格

 		3.3-V 20-BIT BUS-INTERFACE FLIP-FLOP WITH 3-STATE OUTPUTS
SN74ALVC16821DL TI

获取价格

 		3.3-V 20-BIT BUS-INTERFACE FLIP-FLOP WITH 3-STATE OUTPUTS
SN74ALVC16821DLR TI

获取价格

 		3.3-V 20-BIT BUS-INTERFACE FLIP-FLOP WITH 3-STATE OUTPUTS
SN74ALVC16827DGG TI

获取价格

 		ALVC/VCX/A SERIES, DUAL 10-BIT DRIVER, TRUE OUTPUT, PDSO56
SN74ALVC16827DLR TI

获取价格

 		ALVC/VCX/A SERIES, DUAL 10-BIT DRIVER, TRUE OUTPUT, PDSO56
SN74ALVC16828 TI

获取价格

 		20-BIT BUFFER/DRIVER WITH 3-STATE OUTPUTS
SN74ALVC16828DGG TI

获取价格

 		ALVC/VCX/A SERIES, DUAL 10-BIT DRIVER, INVERTED OUTPUT, PDSO56
SN74ALVC16828DL TI

获取价格

 		ALVC/VCX/A SERIES, DUAL 10-BIT DRIVER, INVERTED OUTPUT, PDSO56
SN74ALVC16834 TI

获取价格

 		18-BIT UNIVERSAL BUS DRIVER WITH 3-STATE OUTPUTS
SN74ALVC16834DGG TI

获取价格

 		18-BIT UNIVERSAL BUS DRIVER WITH 3-STATE OUTPUTS

与SN74ALVC16721DLR相关文章

您还可以找


热门产品
PCB打样/小批量
铝基板
BOM智能配单
PCBA制造
钣金
精密CNC
模具注塑
薄膜开关
精选活动
PCBA打样特惠
四六层板品质升级
铝基板品质升级
一体化电子制造
DFM下载
服务支持
企业认证
产品展示
工厂展示
工艺能力
积分商城
关于捷配
捷配简介
企业文化
公司动态
人才招聘
联系我们
帮助中心
下单流程
付款流程
开票流程
常见问题
全球PCB制造服务专线 400-613-0088

工作时间：9:00-21:00

CEO邮箱：ceo@jiepei.com

投诉邮箱：tousu@jiepei.com

捷配网-微信公众号 微信公众号
捷配网-微信公众号 抖音公众号
资质认证：
合作快递：
支付方式：
Copyright © 2024 Jiepei.com Inc. All Rights Reserved. 版权所有:杭州捷配信息科技有限公司 浙公网安备 33010502006866号 浙ICP备10014259号-119 营业执照ICP证