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Datasheet > 逻辑 > 栅极> SN74AHCT132PWRG4
SN74AHCT132PWRG4 PDF预览

SN74AHCT132PWRG4

更新时间： 2024-11-20 05:29:39
品牌 Logo 应用领域
德州仪器 - TI 栅极触发器逻辑集成电路光电二极管输入元件
页数 文件大小 规格书
10页 296K
描述
QUADRUPLE POSITIVE-NAND GATES WITH SCHMITT-TRIGGER INPUTS

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SN74AHCT132PWRG4 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：TSSOP
包装说明：TSSOP-14针数：14
Reach Compliance Code：compliantHTS代码：8542.39.00.01
Factory Lead Time：6 weeks风险等级：5.14
Is Samacsys：N系列：AHCT/VHCT/VT
JESD-30 代码：R-PDSO-G14JESD-609代码：e4
长度：5 mm负载电容（CL）：50 pF
逻辑集成电路类型：NAND GATE最大I（ol）：0.008 A
湿度敏感等级：1功能数量：1
输入次数：2端子数量：14
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP14,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH包装方法：TR
峰值回流温度（摄氏度）：260电源：5 V
最大电源电流（ICC）：0.02 mAProp。Delay @ Nom-Sup：10 ns
传播延迟（tpd）：10 ns认证状态：Not Qualified
施密特触发器：YES座面最大高度：1.2 mm
子类别：Gates最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：4.4 mmBase Number Matches：1

SN74AHCT132PWRG4 数据手册

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SN54AHCT132, SN74AHCT132  
QUADRUPLE POSITIVE-NAND GATES  
WITH SCHMITT-TRIGGER INPUTS  
SCLS366G – MAY 1997 – REVISED APRIL 2002  
SN54AHCT132 . . . J OR W PACKAGE  
SN74AHCT132 . . . D, DB, DGV, N, NS, OR PW PACKAGE  
(TOP VIEW)  
Inputs Are TTL-Voltage Compatible  
Operation From Very Slow Input  
Transitions  
1A  
1B  
V
CC  
Temperature-Compensated Threshold  
Levels  
1
2
3
4
5
6
7
14  
13  
12  
11  
4B  
4A  
4Y  
1Y  
High Noise Immunity  
2A  
Same Pinouts as ’AHCT00  
2B  
10 3B  
Latch-Up Performance Exceeds 250 mA Per  
JESD 17  
9
8
2Y  
3A  
3Y  
GND  
ESD Protection Exceeds JESD 22  
– 2000-V Human-Body Model (A114-A)  
– 200-V Machine Model (A115-A)  
SN54AHCT132 . . . FK PACKAGE  
(TOP VIEW)  
– 1000-V Charged-Device Model (C101)  
description  
3
2
1 20 19  
18  
The ’AHCT132 devices are quadruple  
positive-NAND gates.  
4A  
17 NC  
1Y  
NC  
2A  
4
5
6
7
8
16  
4Y  
NC  
3B  
These devices perform the Boolean function  
Y = A • B or Y = A + B in positive logic.  
15  
14  
NC  
2B  
9 10 11 12 13  
Each circuit functions as a NAND gate, but  
becauseoftheSchmittaction, ithasdifferentinput  
threshold levels for positive- and negative-going  
signals.  
NC – No internal connection  
These circuits are temperature compensated and  
can be triggered from the slowest of input ramps  
and still give clean jitter-free output signals.  
ORDERING INFORMATION  
ORDERABLE  
PART NUMBER  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
PDIP – N  
SOIC – D  
Tube  
SN74AHCT132N  
SN74AHCT132N  
Tube  
SN74AHCT132D  
AHCT132  
Tape and reel  
Tape and reel  
Tape and reel  
Tape and reel  
Tape and reel  
Tube  
SN74AHCT132DR  
SN74AHCT132NSR  
SN74AHCT132DBR  
SN74AHCT132PWR  
SN74AHCT132DGVR  
SNJ54AHCT132J  
SNJ54AHCT132W  
SNJ54AHCT132FK  
–40°C to 85°C  
SOP – NS  
AHCT132  
SSOP – DB  
TSSOP – PW  
TVSOP – DGV  
CDIP – J  
HB132  
HB132  
HB132  
SNJ54AHCT132J  
SNJ54AHCT132W  
SNJ54AHCT132FK  
–55°C to 125°C  
CFP – W  
Tube  
LCCC – FK  
Tube  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines  
are available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2002, Texas Instruments Incorporated  
UNLESS OTHERWISE NOTED this document contains PRODUCTION  
DATA information current as of publication date. Products conform to  
specifications per the terms of Texas Instruments standard warranty.  
Production processing does not necessarily include testing of all  
parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...10

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SN74AHCT132PWRG4 替代型号

型号 品牌 替代类型 描述 数据表
SN74AHCT132PWRE4 TI

完全替代

 QUADRUPLE POSITIVE-NAND GATES WITH SCHMITT-TRIGGER INPUTS
74AHCT132PW-Q100J NXP

类似代替

 74AHC(T)132-Q100 - Quad 2-input NAND Schmitt trigger TSSOP 14-Pin
SN74AHCT132PWR TI

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 QUADRUPLE POSITIVE-NAND GATES WITH SCHMITT-TRIGGER INPUTS

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