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SN65556N-10 PDF预览

SN65556N-10

更新时间： 2024-11-18 20:06:03
品牌 Logo 应用领域
德州仪器 - TI 驱动信息通信管理光电二极管接口集成电路
页数 文件大小 规格书
9页 146K
描述
EL DISPLAY DRIVER, PDIP40

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SN65556N-10 技术参数

生命周期：Obsolete包装说明：DIP,
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.84
数据输入模式：SERIAL接口集成电路类型：EL DISPLAY DRIVER
JESD-30 代码：R-PDIP-T40长度：52.455 mm
功能数量：1区段数：32
端子数量：40最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装形状：RECTANGULAR
封装形式：IN-LINE认证状态：Not Qualified
座面最大高度：5.08 mm最大供电电压：15 V
最小供电电压：10.8 V标称供电电压：12 V
电源电压1-最大：80 V电源电压1-分钟：
电源电压1-Nom：80 V表面贴装：NO
技术：BICMOS温度等级：INDUSTRIAL
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL宽度：15.24 mm
最小 fmax：6.25 MHzBase Number Matches：1

SN65556N-10 数据手册

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SLDS031A − APRIL 1985 − REVISED APRIL 1993  
SN75555 . . . N PACKAGE  
(TOP VIEW)  
• Each Device Drives 32 Electrodes  
• 90-V Output Voltage Swing Capability  
Using Ramped Supply  
Q17  
Q16  
Q15  
Q14  
Q13  
Q12  
Q11  
Q10  
Q9  
Q18  
Q19  
Q20  
Q21  
Q22  
1
40  
39  
38  
37  
36  
• 15-mA Output Source and Sink Current  
2
Capability  
3
• High-Speed Serially-Shifted Data Input  
• Totem-Pole Outputs  
4
5
6
35 Q23  
• Latches on All Driver Outputs  
7
34  
33  
32  
31  
30  
29  
28  
27  
26  
25  
24  
23  
22  
21  
Q24  
8
Q25  
description  
9
Q26  
The SN65555, SN75555, SN65556, and  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
Q8  
Q27  
†
SN75556 are monolithic BIDFET integrated  
Q7  
Q28  
circuits designed to drive the column electrodes of  
an electroluminescent display. The SN65556 and  
SN75556 output sequence is reversed from the  
SN65555 and SN75555 for ease in printed-circuit-  
board layout.  
Q6  
Q29  
Q5  
Q30  
Q4  
Q31  
Q3  
Q32  
Q2  
OUTPUT ENABLE  
DATA IN  
Q1  
The devices consist of a 32-bit shift register, 32  
latches, and 32 output AND gates. Serial data is  
entered into the shift register on the low-to-high  
transition of CLOCK. When high, LATCH ENABLE  
transfers the shift register contents to the outputs  
of the 32 latches. When OUTPUT ENABLE is  
high, all Q outputs are enabled. Data must be  
loaded into the latches and OUTPUT ENABLE  
SERIAL OUT  
CLOCK  
LATCH ENABLE  
V
CC1  
GND  
V
CC2  
SN65555, SN75555 . . . FN PACKAGE  
(TOP VIEW)  
must be high before supply voltage V  
ramped up.  
is  
CC2  
6 5  
4
3
2
1 44 43 42 41 40  
39  
Q23  
Q24  
Q25  
Q26  
Q27  
Q28  
Q29  
Q11  
Q10  
Q9  
Q8  
Q7  
Q6  
Q5  
Q4  
Q3  
Q2  
Q1  
7
Serial data output from the shift register can be  
used to cascade shift registers. This output is not  
affected by LATCH ENABLE or OUTPUT  
ENABLE.  
8
38  
37  
36  
35  
34  
33  
9
10  
11  
12  
13  
14  
15  
16  
17  
The SN65555 and SN65556 are characterized for  
operation from −40°C to 85°C. The SN75555 and  
SN75556 are characterized for operation from  
0°C to 70°C.  
32 Q30  
31  
30  
29  
Q31  
Q32  
NC  
18 19 20 21 22 23 24 25 26 27 28  
NC − No internal connection  
†BIDFET − Bipolar, double-diffused, N-channel and P-channel MOS transistors on same chip. This is a patented process.  
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Copyright 1993, Texas Instruments Incorporated  
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4−1  
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443  
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