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SN54LV05AJ

更新时间： 2024-10-31 22:59:15
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德州仪器 - TI 输出元件
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13页 324K
描述
HEX INVERTERS WITH OPEN-DRAIN OUTPUTS

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SN54LV05AJ 技术参数

生命周期：Obsolete零件包装代码：DIP
包装说明：DIP,针数：14
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.84系列：LV/LV-A/LVX/H
JESD-30 代码：R-GDIP-T14长度：19.56 mm
逻辑集成电路类型：INVERTER功能数量：6
输入次数：1端子数量：14
最高工作温度：125 °C最低工作温度：-55 °C
输出特性：OPEN-DRAIN封装主体材料：CERAMIC, GLASS-SEALED
封装代码：DIP封装形状：RECTANGULAR
封装形式：IN-LINE传播延迟（tpd）：19.5 ns
认证状态：Not Qualified座面最大高度：5.08 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：2.5 V表面贴装：NO
技术：CMOS温度等级：MILITARY
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL宽度：7.62 mm
Base Number Matches：1

SN54LV05AJ 数据手册

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SCLS391I − APRIL 1998 − REVISED APRIL 2005  
SN54LV05A . . . J OR W PACKAGE  
SN74LV05A . . . D, DB, DGV, NS, OR PW PACKAGE  
(TOP VIEW)  
D
D
2-V to 5.5-V V  
Operation  
CC  
Typical V  
OLP  
(Output Ground Bounce)  
= 3.3 V, T = 25°C  
<0.8 V at V  
CC  
A
1A  
1Y  
V
CC  
D
D
D
D
D
Typical V  
>2.3 V at V  
(Output V  
Undershoot)  
1
2
3
4
5
6
7
14  
13  
12  
11  
OHV  
CC  
OH  
= 3.3 V, T = 25°C  
6A  
6Y  
5A  
A
2A  
Support Mixed-Mode Voltage Operation on  
All Ports  
2Y  
3A  
10 5Y  
I
Supports Partial-Power-Down Mode  
off  
9
8
3Y  
4A  
4Y  
Operation  
GND  
Latch-Up Performance Exceeds 250 mA Per  
JESD 17  
SN54LV05A . . . FK PACKAGE  
(TOP VIEW)  
ESD Protection Exceeds JESD 22  
− 2000-V Human-Body Model (A114-A)  
− 200-V Machine Model (A115-A)  
− 1000-V Charged-Device Model (C101)  
3
2
1 20 19  
18  
6Y  
NC  
5A  
2A  
NC  
2Y  
4
5
6
7
8
description/ordering information  
17  
16  
The ’LV05A devices contain six independent  
inverters designed for 2-V to 5.5-V V  
operation.  
CC  
15 NC  
14  
9 10 11 12 13  
NC  
3A  
5Y  
These devices perform the Boolean function  
Y = A.  
The open-drain outputs require pullup resistors to  
perform correctly and can be connected to other  
open-drain outputs to implement active-low  
wired-OR or active-high wired-AND functions.  
NC − No internal connection  
This device is fully specified for partial-power-down applications using I . The I circuitry disables the outputs,  
off  
off  
preventing damaging current backflow through the device when it is powered down.  
ORDERING INFORMATION  
ORDERABLE  
PART NUMBER  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
Tube of 50  
SN74LV05AD  
SOIC − D  
LV05A  
Reel of 2500  
Reel of 2000  
Reel of 2000  
Tube of 90  
SN74LV05ADR  
SN74LV05ANSR  
SN74LV05ADBR  
SN74LV05APW  
SN74LV05APWR  
SN74LV05APWT  
SN74LV05ADGVR  
SNJ54LV05AJ  
SOP − NS  
74LV05A  
LV05A  
SSOP − DB  
−40°C to 85°C  
Reel of 2000  
Reel of 250  
Reel of 2000  
Tube of 25  
TSSOP − PW  
LV05A  
TVSOP − DGV  
CDIP − J  
LV05A  
SNJ54LV05AJ  
SNJ54LV05AW  
SNJ54LV05AFK  
−55°C to 125°C  
CFP − W  
Tube of 150  
Tube of 55  
SNJ54LV05AW  
SNJ54LV05AFK  
LCCC − FK  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design  
guidelines are available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2005, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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型号 品牌 获取价格 描述 数据表
SN54LV05AW TI

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 		LV/LV-A/LVX/H SERIES, HEX 1-INPUT NON-INVERT GATE, CQCC20, CERAMIC, QCC-20

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