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Datasheet > 逻辑 > 总线驱动器/收发器> SN54ABT646AFK
SN54ABT646AFK PDF预览

SN54ABT646AFK

更新时间： 2024-11-11 23:06:07
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德州仪器 - TI 总线驱动器总线收发器逻辑集成电路信息通信管理
页数 文件大小 规格书
21页 473K
描述
OCTAL BUS TRANSCEIVERS AND REGISTERS WITH 3-STATE OUPUTS

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SN54ABT646AFK 技术参数

生命周期：Obsolete零件包装代码：QFN
包装说明：CERAMIC, CC-28针数：28
Reach Compliance Code：unknown风险等级：5.56
Is Samacsys：N其他特性：WITH DIRECTION CONTROL
系列：ABTJESD-30 代码：S-CQCC-N28
长度：11.43 mm负载电容（CL）：50 pF
逻辑集成电路类型：REGISTERED BUS TRANSCEIVER位数：8
功能数量：1端口数量：2
端子数量：28最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：CERAMIC, METAL-SEALED COFIRED
封装代码：QCCN封装形状：SQUARE
封装形式：CHIP CARRIER最大电源电流（ICC）：30 mA
传播延迟（tpd）：6.7 ns认证状态：Not Qualified
座面最大高度：2.03 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：BICMOS
温度等级：MILITARY端子形式：NO LEAD
端子节距：1.27 mm端子位置：QUAD
宽度：11.43 mmBase Number Matches：1

SN54ABT646AFK 数据手册

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SCBS069H − JULY 1991 − REVISED MAY 2004  
D
Typical V  
(Output Ground Bounce)  
D
Latch-Up Performance Exceeds 500 mA Per  
JEDEC Standard JESD-17  
OLP  
<1 V at V  
= 5 V, T = 25°C  
CC  
A
D
High-Drive Outputs (−32-mA I , 64-mA I  
)
D
ESD Protection Exceeds JESD 22  
− 2000-V Human-Body Model (A114-A)  
− 200-V Machine Model (A115-A)  
OH  
OL  
D
I
Supports Partial-Power-Down Mode  
off  
Operation  
SN54ABT646A . . . JT OR W PACKAGE  
SN74ABT646A . . . DB, DGV, DW, NS, NT, OR PW PACKAGE  
(TOP VIEW)  
SN54ABT646A . . . FK PACKAGE  
(TOP VIEW)  
1
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
14  
13  
CLKAB  
SAB  
DIR  
A1  
A2  
A3  
A4  
A5  
A6  
A7  
A8  
GND  
V
CC  
2
CLKBA  
SBA  
OE  
B1  
B2  
B3  
B4  
B5  
B6  
B7  
4
3
2
1
28 27 26  
25  
3
A1  
A2  
A3  
NC  
A4  
OE  
B1  
B2  
NC  
B3  
B4  
B5  
5
6
7
8
9
4
24  
23  
22  
21  
20  
19  
5
6
7
8
A5 10  
11  
9
A6  
12 13 14 15 16 17 18  
10  
11  
12  
B8  
NC − No internal connection  
description/ordering information  
These devices consist of bus-transceiver circuits, D-type flip-flops, and control circuitry arranged for multiplexed  
transmission of data directly from the input bus or from the internal registers. Data on the A or B bus is clocked  
into the registers on the low-to-high transition of the appropriate clock (CLKAB or CLKBA) input. Figure 1  
illustrates the four fundamental bus-management functions that can be performed with the ’ABT646A devices.  
ORDERING INFORMATION  
ORDERABLE  
PART NUMBER  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
PDIP − NT  
SOIC − DW  
Tube  
SN74ABT646ANT  
SN74ABT646ADW  
SN74ABT646ADWR  
SN74ABT646ANSR  
SN74ABT646ADBR  
SN74ABT646APW  
SN74ABT646APWR  
SN74ABT646ADGVR  
SNJ54ABT646AJT  
SNJ54ABT646AW  
SNJ54ABT646AFK  
SN74ABT646ANT  
Tube  
ABT646A  
Tape and reel  
Tape and reel  
Tape and reel  
Tube  
SOP − NS  
ABT646A  
AB646A  
−40°C to 85°C  
SSOP − DB  
TSSOP − PW  
AB646A  
Tape and reel  
Tape and reel  
Tube  
TVSOP − DGV  
CDIP − JT  
AB646A  
SNJ54ABT646AJT  
SNJ54ABT646AW  
SNJ54ABT646AFK  
−55°C to 125°C  
CFP − W  
Tube  
LCCC − FK  
Tube  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines are  
available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
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Copyright 2004, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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