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Datasheet > 逻辑 > 触发器/锁存器> SN54ABT377J
SN54ABT377J PDF预览

SN54ABT377J

更新时间： 2024-09-22 23:06:07
品牌 Logo 应用领域
德州仪器 - TI 触发器时钟
页数 文件大小 规格书
14页 462K
描述
OCTAL EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLOCK ENABLE

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SN54ABT377J 技术参数

生命周期：Obsolete零件包装代码：DIP
包装说明：DIP,针数：20
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.32其他特性：WITH HOLD MODE
系列：ABTJESD-30 代码：R-GDIP-T20
长度：24.195 mm负载电容（CL）：50 pF
逻辑集成电路类型：D FLIP-FLOP位数：8
功能数量：1端子数量：20
最高工作温度：125 °C最低工作温度：-55 °C
输出极性：TRUE封装主体材料：CERAMIC, GLASS-SEALED
封装代码：DIP封装形状：RECTANGULAR
封装形式：IN-LINE最大电源电流（ICC）：30 mA
传播延迟（tpd）：7.6 ns认证状态：Not Qualified
座面最大高度：5.08 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：NO技术：BICMOS
温度等级：MILITARY端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
触发器类型：POSITIVE EDGE宽度：7.62 mm
最小 fmax：150 MHz

SN54ABT377J 数据手册

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SN54ABT377, SN74ABT377  
OCTAL EDGE-TRIGGERED D-TYPE FLIP-FLOPS  
WITH CLOCK ENABLE  
SCBS156B – FEBRUARY 1991 – REVISED JULY 1994  
SN54ABT377 . . . J PACKAGE  
SN74ABT377 . . . DB, DW, OR N PACKAGE  
(TOP VIEW)  
• State-of-the-Art EPIC-ΙΙB BiCMOS Design  
Significantly Reduces Power Dissipation  
• Latch-Up Performance Exceeds 500 mA  
Per JEDEC Standard JESD-17  
CLKEN  
1Q  
V
CC  
1
2
3
4
5
6
7
8
9
10  
20  
19  
18  
17  
16  
15  
14  
• Typical V  
(Output Ground Bounce)  
8Q  
8D  
7D  
7Q  
6Q  
6D  
OLP  
CC  
< 1 V at V  
= 5 V, T = 25°C  
1D  
2D  
2Q  
3Q  
A
• High-Drive Outputs (–32-mA I  
,
OH  
64-mA I  
)
OL  
• Package Options Include Plastic  
3D  
Small-Outline (DW) and Shrink  
4D  
4Q  
13 5D  
12 5Q  
Small-Outline (DB) Packages, Ceramic  
Chip Carriers (FK), and Plastic (N) and  
Ceramic (J) DIPs  
11  
GND  
CLK  
description  
SN54ABT377 . . . FK PACKAGE  
(TOP VIEW)  
The ′ABT377 are 8-bit positive-edge-triggered  
D-type flip-flops with a clock (CLK) input. They are  
particularly suitable for implementing buffer and  
storage registers, shift registers, and pattern  
generators.  
3
2
1
20 19  
18 8D  
2D  
2Q  
3Q  
3D  
4D  
4
5
6
7
8
Data (D) input information that meets the setup  
time requirements is transferred to the Q outputs  
on the positive-going edge of the clock pulse if the  
commonclock-enable(CLKEN)inputislow. Clock  
triggering occurs at a particular voltage level and  
is not directly related to the transition time of the  
positive-going pulse. When the buffered clock  
(CLK) input is at either the high or low level, the  
D input signal has no effect at the output. The  
circuits are designed to prevent false clocking by  
transitions at CLKEN.  
17  
16  
15  
14  
7D  
7Q  
6Q  
6D  
9 10 11 12 13  
The SN74ABT377 is available in TI’s shrink small-outline package (DB), which provides the same I/O pin count  
and functionality of standard small-outline packages in less than half the printed-circuit-board area.  
The SN54ABT377 is characterized for operation over the full military temperature range of –55°C to 125°C. The  
SN74ABT377 is characterized for operation from –40°C to 85°C.  
FUNCTION TABLE  
(each flip-flop)  
INPUTS  
OUTPUT  
Q
CLKEN CLK  
D
X
H
L
H
L
X
Q
0
↑
↑
H
L
L
X
H or L  
X
Q
0
EPIC-ΙΙB is a trademark of Texas Instruments Incorporated.  
Copyright 1994, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
2–1  
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...14

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