SM5859AF

更新时间： 2024-01-21 15:31:29

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NPC		内存控制器消费电路商用集成电路
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33页	172K
描述
compression and non compression type antishock memory controller

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SM5859AF 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
包装说明：	QFP, QFP44,.5SQ,32	Reach Compliance Code：	unknown
风险等级：	5.76	商用集成电路类型：	CONSUMER CIRCUIT
JESD-30 代码：	S-PQFP-G44	端子数量：	44
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	QFP
封装等效代码：	QFP44,.5SQ,32	封装形状：	SQUARE
封装形式：	FLATPACK	电源：	3/5 V
认证状态：	Not Qualified	子类别：	Other Consumer ICs
最大压摆率：	13 mA	表面贴装：	YES
温度等级：	INDUSTRIAL	端子形式：	GULL WING
端子节距：	0.8 mm	端子位置：	QUAD
Base Number Matches：	1

SM5859AF 数据手册

SM5859AF

compression and non compression type anti-

shock memory controller

NIPPON PRECISION CIRCUITS INC.

Overview

The SM5859 is a compression and non compres-

sion type anti-shock memory controller LSI for com-

pact disc players. The compression level can be set

in 4 levels, and external memory can be selected

from 4 options (1M, 1M×2, 4M, 4M×2). Digital atten-

uator, soft mute and related functions are also

incorporated. It operates from a 2.7 to 5.5 V wide

supply voltage range.

Features

- 2-channel processing

•Digital attenuator

- Serial data input

Full-bit setting

•2s complement, 16-bit/MSB first, rear-packed

format

•Soft attenuator function

Noiseless attenuation-level switching

(256- step switching in 23 ms max.)

•Soft mute function

- System clock input

•384fs (16.9344 MHz)

- Anti-shock memory controller

- ADPCM compression method

•4-level compression mode selectable

4-bit compression mode 2.78 s/Mbit

5-bit compression mode 2.22 s/Mbit

6-bit compression mode 1.85 s/Mbit

Full-bit non compression mode 0.74 s/Mbit

•4 external DRAM configurations selectable

2×4M DRAM (1M×4 bits)

Mute ON in 23 ms max.

Direct return after soft mute release

•Forced mute

- Extension I/O

Microcontroller interface for external control

using 5 extension I/O pins

- +2.7 to +5.5 V wide operating voltage range

- Schmitt inputs

All input pins (including I/O pins) except CLK

(system clock)

1×4M DRAM (1M×4 bits)

- Reset signal noise elimination

Approximately 3.8 µs or longer (65 system

clock pulses) continuous LOW-level reset

- 44-pin QFP package (0.8 mm pin pitch)

2×1M DRAM (256K×4 bits)

1×1M DRAM (256K×4 bits)

- Compression mode selectable

- Microcontroller interface

•Serial command write and state read-out

•Data residual quantity detector:

15-bit operation, 16-bit output

NIPPON PRECISION CIRCUITS-1

12 3 4 5 6 7...33

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