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SM34020AGBS40

更新时间： 2025-07-14 12:21:47
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德州仪器 - TI /
页数 文件大小 规格书
94页 1634K
描述
GRAPHICS SYSTEM PROCESSOR

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SM34020AGBS40 技术参数

生命周期：Not Recommended零件包装代码：PGA
包装说明：PGA, PGA145,15X15针数：145
Reach Compliance Code：not_compliantHTS代码：8542.31.00.01
Factory Lead Time：6 weeks风险等级：5.66
最大时钟频率：40 MHz外部数据总线宽度：32
JESD-30 代码：S-CPGA-P145每像素最大位数：32
端子数量：145最高工作温度：110 °C
最低工作温度：-40 °C封装主体材料：CERAMIC, METAL-SEALED COFIRED
封装代码：PGA封装等效代码：PGA145,15X15
封装形状：SQUARE封装形式：GRID ARRAY
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
认证状态：Not Qualified子类别：Graphics Processors
最大压摆率：280 mA最大供电电压：5.25 V
最小供电电压：4.75 V标称供电电压：5 V
表面贴装：NO技术：CMOS
温度等级：INDUSTRIAL端子形式：PIN/PEG
端子节距：2.54 mm端子位置：PERPENDICULAR
处于峰值回流温度下的最长时间：NOT SPECIFIEDuPs/uCs/外围集成电路类型：GRAPHICS PROCESSOR
Base Number Matches：1

SM34020AGBS40 数据手册

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Not Recommended for New Designs  
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SGUS057 − FEBRUARY 2005  
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Class B High-Reliability Processing  
145-PIN GRID ARRAY PACKAGE  
(TOP VIEW)  
1-µm CMOS Technology  
Military Operating Temperature Range  
1 2 3 4 5 6 7 8 9 10 11 12 13 14 15  
−40°C to 110°C  
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SM34020A-32/40  
125/100-ns Instruction Cycle Time  
Fully Programmable 32-Bit  
General-Purpose Processor With  
512-Megabyte Linear Address Range  
(Bit Addressable)  
D
Second-Generation Graphics System  
Processor  
− Object-Code Compatible With the  
SMJ34010  
− Enhanced Instruction Set  
− Optimized Graphics Instructions  
− Coprocessor Interface  
D
D
Pixel Processing, XY Addressing, and  
Window Checking Built Into the Instruction  
Set  
132-PIN QUAD FLATPACK  
(TOP VIEW)  
Programmable 1-, 2-, 4-, 8-, 16-, or 32-Bit  
Pixel Size With 16 Boolean and Six  
Arithmetic Pixel Processing Options  
(Raster Ops)  
D
D
Programmable CRT Control  
− Composite Sync Mode  
− Separate Sync Mode  
D
D
512-Byte LRU On-Chip Instruction Cache  
Optimized DRAM/VRAM Interface  
− Page-Mode for Burst Memory Operations  
− Dynamic Bus Sizing (16-Bit and  
32-Bit Transfers)  
− Synchronization to External Sync  
Direct Support for Special Features of  
1M VRAMs  
− Load Write Mask  
− Load Color Mask  
− Byte-Oriented CAS Strobes  
D
Flexible Host Processor Interface  
− Supports Host Transfers  
− Direct Access to All of the SMJ34020A  
Address Space  
− Implicit Addressing  
− Prefetch for Enhanced Read Access  
− Block Write  
− Write Using the Write Mask  
Flexible Multi-Processor Interface  
Packaging Options  
− 145-Pin Grid Array Ceramic Package  
(GB Suffix)  
D
D
description  
The SM34020A graphics system processor (GSP) is the second generation of an advanced high-performance  
CMOS 32-bit microprocessor optimized for graphics display systems. With a built-in instruction cache, the ability  
to simultaneously access memory and registers, and an instruction set designed to expedite raster graphics  
operations, the SM34020A provides user-programmable control of the CRT interface as well as the memory  
interface (both standard DRAM and multiport video RAM). The 4-gigabit (512-megabyte) physical address  
space is addressable on bit boundaries using variable width data fields (1 to 32 bits). Additional graphics  
addressing modes support 1-, 2-, 4-, 8-, 16- and 32-bit wide pixels.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
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Copyright 2004, Texas Instruments Incorporated  
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POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443  
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SM34020AGBS40 替代型号

型号 品牌 替代类型 描述 数据表
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