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Datasheet > 微控制器和处理器 > 数字信号处理器> SM320C6203GLPM20
SM320C6203GLPM20 PDF预览

SM320C6203GLPM20

更新时间： 2024-01-22 19:52:02
品牌 Logo 应用领域
德州仪器 - TI 微控制器和处理器外围集成电路数字信号处理器装置时钟
页数 文件大小 规格书
81页 1213K
描述
FIXED POINT SIGNAL PROCESSOR

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SM320C6203GLPM20 技术参数

生命周期：Active零件包装代码：BGA
包装说明：BGA, BGA429,21X21,50针数：429
Reach Compliance Code：not_compliantECCN代码：3A001.A.2.C
HTS代码：8542.31.00.01风险等级：5.71
其他特性：ALSO REQUIRES 3.3V SUPPLY地址总线宽度：22
桶式移位器：NO位大小：32
边界扫描：YES最大时钟频率：200 MHz
外部数据总线宽度：32格式：FIXED POINT
集成缓存：YES内部总线架构：MULTIPLE
JESD-30 代码：S-CBGA-B429JESD-609代码：e0
长度：27 mm低功率模式：YES
DMA 通道数量：4外部中断装置数量：4
端子数量：429计时器数量：2
最高工作温度：125 °C最低工作温度：-55 °C
封装主体材料：CERAMIC, METAL-SEALED COFIRED封装代码：BGA
封装等效代码：BGA429,21X21,50封装形状：SQUARE
封装形式：GRID ARRAY峰值回流温度（摄氏度）：NOT SPECIFIED
电源：1.5,3.3 V认证状态：Not Qualified
RAM（字数）：524288筛选级别：MIL-PRF-38535
座面最大高度：3.3 mm子类别：Digital Signal Processors
最大供电电压：1.57 V最小供电电压：1.43 V
标称供电电压：1.5 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：BALL
端子节距：1.27 mm端子位置：BOTTOM
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：27 mm
uPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHERBase Number Matches：1

SM320C6203GLPM20 数据手册

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SGUS033 – FEBRUARY 2002  
D
High-Performance Fixed-Point Digital  
Signal Processor (DSP) – SMJ320C62x  
– 5-ns Instruction Cycle Time  
– 200-MHz Clock Rate  
– Eight 32-Bit Instructions/Cycle  
– 1600 Million Instructions Per Second  
(MIPS)  
D
32-Bit External Memory Interface (EMIF)  
– Glueless Interface to Synchronous  
Memories: SDRAM or SBSRAM  
– Glueless Interface to Asynchronous  
Memories: SRAM and EPROM  
– 52M-Byte Addressable External Memory  
Space  
D
D
429-Pin Ball Grid Array (BGA) Package  
(GLP Suffix)  
D
D
Four-Channel Bootloading  
Direct-Memory-Access (DMA) Controller  
With an Auxiliary Channel  
VelociTI Advanced Very-Long-Instruction-  
Word (VLIW) C62x DSP Core  
– Eight Highly Independent Functional  
Units:  
32-Bit Expansion Bus  
– Glueless/Low-Glue Interface to Popular  
PCI Bridge Chips  
– Six Arithmetic Logic Units (ALUs)  
(32-/40-Bit)  
– Two 16-Bit Multipliers (32-Bit Result)  
– Load-Store Architecture With 32 32-Bit  
General-Purpose Registers  
– Glueless/Low-Glue Interface to Popular  
Synchronous or Asynchronous  
Microprocessor Buses  
– Master/Slave Functionality  
– Glueless Interface to Synchronous FIFOs  
and Asynchronous Peripherals  
– Instruction Packing Reduces Code Size  
– All Instructions Conditional  
D
Three Multichannel Buffered Serial Ports  
(McBSPs)  
– Direct Interface to T1/E1, MVIP, SCSA  
Framers  
– ST-Bus-Switching Compatible  
– Up to 256 Channels Each  
– AC97-Compatible  
D
D
D
Instruction Set Features  
– Byte-Addressable (8-, 16-, 32-Bit Data)  
– 8-Bit Overflow Protection  
– Saturation  
– Bit-Field Extract, Set, Clear  
– Bit-Counting  
– Normalization  
– Serial-Peripheral Interface (SPI)  
Compatible (Motorola )  
7M-Bit On-Chip SRAM  
– 3M-Bit Internal Program/Cache  
(96K 32-Bit Instructions)  
– 4M-Bit Dual-Access Internal Data  
(512K Bytes)  
D
D
D
D
Two 32-Bit General-Purpose Timers  
†
IEEE-1149.1 (JTAG )  
Boundary-Scan-Compatible  
0.15-µm/5-Level Metal Process  
– CMOS Technology  
– Organized as Two 256K-Byte Blocks  
for Improved Concurrency  
3.3-V I/Os, 1.5-V Internal  
Flexible Phase-Locked-Loop (PLL) Clock  
Generator  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
SMJ320C62x, VelociTI, and C62x are trademarks of Texas Instruments.  
Motorola is a trademark of Motorola, Inc.  
All trademarks are the property of their respective owners.  
†
IEEE Standard 1149.1-1990 Standard-Test-Access Port and Boundary Scan Architecture.  
Copyright 2002, Texas Instruments Incorporated  
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POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251–1443  
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