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SM320C6201BGLPS15 PDF预览

SM320C6201BGLPS15

更新时间： 2024-01-08 15:27:57
品牌 Logo 应用领域
德州仪器 - TI 时钟外围集成电路
页数 文件大小 规格书
62页 873K
描述
32-BIT, 150MHz, OTHER DSP, CBGA429, CERAMIC, MO-156, BGA-429

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SM320C6201BGLPS15 技术参数

生命周期：Obsolete零件包装代码：BGA
包装说明：BGA, BGA429,21X21,50针数：429
Reach Compliance Code：unknownECCN代码：3A001.A.2.C
HTS代码：8542.31.00.01风险等级：5.84
其他特性：-40 TO 90 OPERATING CASE TEMPERATURE地址总线宽度：22
桶式移位器：NO位大小：32
边界扫描：YES最大时钟频率：150 MHz
外部数据总线宽度：32格式：FIXED POINT
内部总线架构：MULTIPLEJESD-30 代码：S-CBGA-B429
长度：27 mm低功率模式：YES
端子数量：429最高工作温度：90 °C
最低工作温度：-40 °C封装主体材料：CERAMIC, METAL-SEALED COFIRED
封装代码：BGA封装等效代码：BGA429,21X21,50
封装形状：SQUARE封装形式：GRID ARRAY
电源：1.8,3.3 V认证状态：Not Qualified
RAM（字数）：65536筛选级别：MIL-PRF-38535
座面最大高度：3.3 mm子类别：Digital Signal Processors
最大供电电压：1.89 V最小供电电压：1.71 V
标称供电电压：1.8 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：BALL端子节距：1.27 mm
端子位置：BOTTOM宽度：27 mm
uPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHERBase Number Matches：1

SM320C6201BGLPS15 数据手册

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SGUS031B – APRIL 2000 – REVISED AUGUST 2001  
GLP  
D
D
Highest Performance Fixed-Point Digital  
Signal Processor (DSP) SM/SMJ320C6201B  
– 5-, 6.7-ns Instruction Cycle Time  
– 150 and 200-MHz Clock Rate  
– Eight 32-Bit Instructions/Cycle  
– 1200 and 1600 MIPS  
429-PIN BALL GRID ARRAY (BGA) PACKAGE  
(BOTTOM VIEW)  
AA  
Y
W
V
U
T
R
P
N
M
L
K
J
H
G
F
VelociTI Advanced Very Long Instruction  
Word (VLIW) C62x CPU Core  
– Eight Independent Functional Units:  
– Six ALUs (32-/40-Bit)  
– Two 16-Bit Multipliers (32-Bit Results)  
– Load-Store Architecture With 32 32-Bit  
General-Purpose Registers  
– Instruction Packing Reduces Code Size  
– All Instructions Conditional  
E
D
C
B
A
D
Instruction Set Features  
– Byte-Addressable (8-, 16-, 32-Bit Data)  
– 32-Bit Address Range  
– 8-Bit Overflow Protection  
– Saturation  
1
3
5
7
9
11 13 15 17 19 21  
10 12 14 16 18 20  
2
4
6
8
– Bit-Field Extract, Set, Clear  
– Bit-Counting  
– Normalization  
D
Two Multichannel Buffered Serial Ports  
(McBSPs)  
– Direct Interface to T1/E1, MVIP, SCSA  
Framers  
D
D
1M-Bit On-Chip SRAM  
– 512K-Bit Internal Program/Cache  
(16K 32-Bit Instructions)  
– 512K-Bit Dual-Access Internal Data  
(64K Bytes) Organized as Two Blocks for  
Improved Concurrency  
– ST-Bus-Switching Compatible  
– Up to 256 Channels Each  
– AC97-Compatible  
– Serial Peripheral Interface (SPI)  
Compatible (Motorola )  
32-Bit External Memory Interface (EMIF)  
– Glueless Interface to Synchronous  
Memories: SDRAM and SBSRAM  
– Glueless Interface to Asynchronous  
Memories: SRAM and EPROM  
D
D
D
Two 32-Bit General-Purpose Timers  
Flexible Phase-Locked Loop (PLL) Clock  
Generator  
†
IEEE-1149.1 (JTAG ) Boundary-Scan  
Compatible  
D
D
Four-Channel Bootloading  
Direct-Memory-Access (DMA) Controller  
with an Auxiliary Channel  
D
429-Pin BGA Package (GLP Suffix)  
D
CMOS Technology  
– 0.18-µm/5-Level Metal Process  
16-Bit Host-Port Interface (HPI)  
– Access to Entire Memory Map  
D
3.3-V I/Os, 1.8-V Internal  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
C62x and VelociTI are trademarks of Texas Instruments Incorporated.  
Motorola is a trademark of Motorola, Inc.  
†
IEEE Standard 1149.1-1990 Standard-Test-Access Port and Boundary Scan Architecture.  
Copyright 2001, Texas Instruments Incorporated  
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1
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251–1443  
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