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SK10E116PJT

更新时间： 2024-09-15 22:34:19
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商升特 - SEMTECH 线路驱动器或接收器驱动程序和接口接口集成电路
页数 文件大小 规格书
4页 113K
描述
Quint Differential Line Receiver

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SK10E116PJT 技术参数

生命周期：Obsolete零件包装代码：QLCC
包装说明：QCCJ, LDCC28,.5SQ针数：28
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.84
Is Samacsys：N输入特性：DIFFERENTIAL
接口集成电路类型：LINE RECEIVER接口标准：GENERAL PURPOSE
JESD-30 代码：S-PQCC-J28长度：11.505 mm
标称负供电电压：-5.2 V功能数量：5
端子数量：28最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：QCCJ封装等效代码：LDCC28,.5SQ
封装形状：SQUARE封装形式：CHIP CARRIER
电源：-5.2 V认证状态：Not Qualified
最大接收延迟：0.46 ns接收器位数：5
座面最大高度：4.57 mm子类别：Line Driver or Receivers
最大压摆率：35 mA最大供电电压：5.5 V
最小供电电压：4.2 V表面贴装：YES
技术：ECL10K温度等级：INDUSTRIAL
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD宽度：11.505 mm
Base Number Matches：1

SK10E116PJT 数据手册

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SK10/100E116  
Quint Differential  
Line Receiver  
HIGH-PERꢀORMANCE PRODUCTS  
ꢀeatures  
Description  
The SK10/100E116 is a quint differential line receiver  
designed for use in new, high-performance ECL systems.  
•
•
•
•
•
•
•
500 ps Maximum Propagation Delay  
Extended VEE Range of –4.2V to –5.5V  
VBB Output for Single-Ended Reception  
Internal 75KΩ Input Pull-Down Resistors  
ESD Protection of >4000V  
Fully Compatible with MC10E/100E116  
Specified Over Industrial Temperature Range:  
–40oC to +85oC  
The receiver design features clamp circuitry to cause a  
defined output state if both the inverting and non-inverting  
inputs are left open; in this case the Q output goes low,  
while the Q* output goes high. This feature makes the  
device ideal for twisted pair applications.  
•
Available in 28-Pin PLCC Package  
If both inverting and non-inverting inputs are at an equal  
potential of >–2.9V, the receiver does not go to a defined  
state, but rather shares current in normal differential  
amplifier fashion, producing output voltage levels midway  
between high and low. This may even cause the device to  
oscillate.  
PIN Description  
The SK10/100E116 provides VBB output for either single-  
ended use or as a DC bias for AC coupling to the device.  
The VBB output pin should be used only as a DC bias for  
the E116 as its current sink/source capability is limited.  
Whenever used, the VBB pin should be bypassed to VCC  
via a 0.01 µF capacitor.  
Pin  
D0, D0*–D4, D4*  
Q0, Q0*-Q4, Q4*  
VBB  
ꢀunction  
Differential Input Pairs  
Differential Output Pairs  
Reference Voltage Output  
VCC to Output  
VCC0  
ꢀunctional Block Diagram  
D0  
Q0  
D0*  
Q0*  
D1  
Q1  
D1*  
Q1*  
D3*  
D2  
26  
27  
28  
1
18  
17  
16  
15  
14  
13  
12  
Q3*  
Q3  
D2  
Q2  
D2*  
VEE  
VBB  
D0  
VCC  
Q2*  
Q2  
D2*  
Q2*  
PLCC  
TOPVIEW  
2
D3  
Q3  
3
VCC0  
Q1*  
D3*  
Q3*  
D0*  
4
D4  
Q4  
D4*  
Q4*  
VBB  
www.semtech.com  
Revision 1 /ꢀebruary 21, 2001  
1
1234

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