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SI53304-B-GM

更新时间： 2024-11-19 21:16:31

品牌	Logo	应用领域
芯科 - SILICON		接口集成电路
页数	文件大小	规格书
33页	1871K
描述
Interface Circuit, 5 X 5 MM, ROHS COMPLIANT, MO-220, QFN-32

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SI53304-B-GM 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	5 X 5 MM, ROHS COMPLIANT, MO-220, QFN-32	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	2.23
其他特性：	IT ALSO REQUIRES 2.5, 3.3 V	接口集成电路类型：	INTERFACE CIRCUIT
JESD-30 代码：	S-XQCC-N32	JESD-609代码：	e3
长度：	5 mm	功能数量：	1
端子数量：	32	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	260
座面最大高度：	1 mm	最大供电电压：	1.89 V
最小供电电压：	1.71 V	标称供电电压：	1.8 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn)	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	5 mm
Base Number Matches：	1

SI53304-B-GM 数据手册

Si53304

1:6 LOW JITTER UNIVERSAL BUFFER/LEVEL

TRANSLATOR WITH 2:1 INPUT MUX AND INDIVIDUAL OE

Features



6 differential or 12 LVCMOS outputs  Independent V_DDand V_DDO:

Ultra-low additive jitter: 45 fs rms

Wide frequency range: 1 to 725 MHz

Any-format input with pin selectable

output formats: LVPECL, Low Power

LVPECL, LVDS, CML, HCSL,

LVCMOS

1.8/2.5/3.3 V



1.2/1.5 V LVCMOS output support

Excellent power supply noise

rejection (PSRR)

Selectable LVCMOS drive strength to

tailor jitter and EMI performance

Small size: 32-QFN (5x5 mm)

RoHS compliant, Pb-free

Industrial temperature range:

–40 to +85 °C



2:1 mux with hot-swappable inputs

Glitchless input clock switching

Synchronous output enable

Individual output enable



Ordering Information:

Applications

See page 28.



High-speed clock distribution

Ethernet switch/router

Optical Transport Network (OTN)

SONET/SDH



Storage

Telecom

Industrial

Servers

Pin Assignments

Si53304

PCI Express Gen 1/2/3

Backplane clock distribution

Description

The Si53304 is an ultra low jitter six output differential buffer with pin-selectable

output clock signal format and individual OE. The Si53304 features a 2:1 mux with

glitchless switching, making it ideal for redundant clocking applications. The

Si53304 utilizes Silicon Laboratories' advanced CMOS technology to fanout

clocks from 1 to 725 MHz with guaranteed low additive jitter, low skew, and low

propagation delay variability. The Si53304 features minimal cross-talk and

provides superior supply noise rejection, simplifying low jitter clock distribution in

noisy environments. Independent core and output bank supply pins provide

integrated level translation without the need for external circuitry.

OE₅

OE₀

SFOUT_A[1]

SFOUT_A[0]

SFOUT_B[1]

SFOUT_B[0]

GND

PAD

V_DDOB

GND

V_DDOA

V_REF

V_DD

CLK_SEL

Functional Block Diagram

VDD

Patents pending

VDDO_A

SFOUT_A[1:0]

Power

Supply

Filtering

Vref

Generator

V_REF

OE[2:0]

CLK0

BANK A

/CLK0

VDDO_B

SFOUT_B[1:0]

OE[5:3]

CLK1

/CLK1

Switching

Logic

CLK_SEL

BANK B

Rev. 1.0 4/14

Si53304

12 3 4 5 6 7...33

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与SI53304-B-GM相关器件

型号	品牌	获取价格	描述	数据表
SI53305-B-GM	SILICON	获取价格	Interface Circuit, QFN-44
SI53305-B-GMR	SILICON	获取价格	Clock Driver
SI53307-B-GM	SILICON	获取价格	Low Skew Clock Driver, 53307 Series, 4 True Output(s), 0 Inverted Output(s), CMOS, 3 X 3 M
SI53307-B-GMR	SILICON	获取价格	IC CLK BUFFER 2:4 725MHZ 16QFN
SI53308-B-GM	SILICON	获取价格	Low Skew Clock Driver, 53308 Series, 6 True Output(s), 0 Inverted Output(s), CMOS, 5 X 5 M
SI5330A-A00200-GM	SILICON	获取价格	Supports single-ended or differential input clock singnals Generates four differential (LV
SI5330A-A00200-GMR	SILICON	获取价格	Clock Driver
SI5330A-A00202-GM	SILICON	获取价格	1.8/2.5/3.3 V LOW-JITTER, LOW-SKEW CLOCK BUFFER/LEVEL TRANSLATOR
SI5330A-B00200-GM	SILICON	获取价格	Low Skew Clock Driver, 5330 Series, 4 True Output(s), 0 Inverted Output(s), 4 X 4 MM, ROHS
SI5330A-B00202-GM	SILICON	获取价格	Low Skew Clock Driver, 5330 Series, 4 True Output(s), 0 Inverted Output(s), QFN-24

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