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S2071QF

更新时间： 2024-11-01 21:21:11

品牌	Logo	应用领域
AMCC		电信电信集成电路
页数	文件大小	规格书
11页	114K
描述
Telecom Circuit, 1-Func, Bipolar, PQFP44, PLASTIC, QFP-44

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S2071QF 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	PLASTIC, QFP-44
针数：	44	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.91
JESD-30 代码：	S-PQFP-G44	JESD-609代码：	e0
长度：	10 mm	功能数量：	1
端子数量：	44	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	QFP	封装等效代码：	QFP44,.5SQ,32
封装形状：	SQUARE	封装形式：	FLATPACK
电源：	3.3 V	认证状态：	Not Qualified
座面最大高度：	2.45 mm	子类别：	Other Telecom ICs
最大压摆率：	260 mA	标称供电电压：	3.3 V
表面贴装：	YES	技术：	BIPOLAR
电信集成电路类型：	TELECOM CIRCUIT	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	0.8 mm	端子位置：	QUAD
宽度：	10 mm	Base Number Matches：	1

S2071QF 数据手册

DEVICE

SPECIFICATION

FOUR PORT BYPASS FOR FC-AL

S2071

FOUR PORT BYPASS FOR FC-AL

FEATURES

GENERAL DESCRIPTION

•

Micropower Bipolar Technology

ANSI X3T11 Fibre Channel Compatible

Four Port Bypass Circuits

The Four Port Bypass for FC-AL Circuit is used in

full-speed (1.0625 Gbps) Disk Arrays. It contains

four port bypass circuits. The S2071 may be used to

implement a single chip Arbitrated Loop Port Bypass

Node. The S2071 performs the function of four port

bypass circuits.

Suitable for both Coaxial and Optical Link

Nominal deterministic Jitter ± 10ps

Low Power Operation 0.73 W Typical

44 Pin PQFP Package

FUNCTIONAL DESCRIPTION

3.3V Supply

The S2071 functional block diagram is shown in Fig-

ure 1. The S2071 performs the function of a Port

Bypass Circuit (PBC) for nodes in a FC-AL system.

The low jitter accumulation of the port bypass path is

essential in these systems.

APPLICATIONS

•

RAID

JBOD

Jitter Performance

FC-AL Nodes

The primary AC parameter of importance is

determinsitic jitter accumulation (data eye degrada-

tion) inserted by the port bypass circuit. The S2071

utilizes high bandwidth, low skew differential circuitry

to provide symmetric rise and fall times and excel-

lent noise immunity.

For arrays of disk drives greater than 4, it is recom-

mended that the S2071 be cascaded with the S2058

(Port Bypass with Repeater) in a ratio of 1:1 to per-

form clock and data retiming. This ensures optimal

jitter performance for the disk array system.

Figure 1. S2071 Functional Block Diagram

DDI3

DDO3

DDO1

DDO2

DDO0 DDI0

DDI1

DDI2

EN0

EN2

EN3

EN1

OUT

January 6, 2000 / Revision C

12 3 4 5 6 7...11

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与S2071QF相关器件

型号	品牌	获取价格	描述	数据表
S2072QF	AMCC	获取价格	Telecom Circuit, 1-Func, Bipolar, PQFP64, 10 X 10 MM, PLASTIC, QFP-64
S2073QF	AMCC	获取价格	Telecom Circuit, 1-Func, Bipolar, PQFP64, 10 X 10 MM, PLASTIC, QFP-64
S2074QF	AMCC	获取价格	Telecom Circuit, 1-Func, Bipolar, PQFP64, 14 X 14 MM, PLASTIC, QFP-64
S2076TBC	AMCC	获取价格	Telecom Circuit, 1-Func, Bipolar, PBGA208, 23 X 23 MM, TBGA-208
S2078TB	AMCC	获取价格	Telecom Circuit, 2-Func, Bipolar, PBGA156, 21 X 21 MM, TBGA-156
S2079	TE	获取价格	Drivers for GaAs FET Switches and Digital Attenuators
S2079B1LF	BOTHHAND	获取价格	ISDN S-INTERFACE DUAL TRANSFORMER MODULES SML
S207A1	HUTSON	获取价格	Silicon Controlled Rectifier, 6A I(T)RMS, 6000mA I(T), 100V V(DRM), 100V V(RRM), 1 Element
S207A2	HUTSON	获取价格	Silicon Controlled Rectifier, 6A I(T)RMS, 6000mA I(T), 100V V(DRM), 100V V(RRM), 1 Element
S207B1	HUTSON	获取价格	Silicon Controlled Rectifier, 6A I(T)RMS, 6000mA I(T), 200V V(DRM), 200V V(RRM), 1 Element

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