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PSD813F1AV-90MIT

更新时间： 2024-10-01 06:05:31
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 内存集成电路
页数 文件大小 规格书
110页 1681K
描述
Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 3.3V

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PSD813F1AV-90MIT 技术参数

生命周期：Transferred零件包装代码：QFP
包装说明：PLASTIC, QFP-52针数：52
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.32.00.51风险等级：5.62
最长访问时间：90 nsJESD-30 代码：S-PQFP-G52
长度：10 mm内存密度：1048576 bit
内存集成电路类型：FLASH内存宽度：8
功能数量：1端子数量：52
字数：131072 words字数代码：128000
工作模式：SYNCHRONOUS最高工作温度：85 °C
最低工作温度：-40 °C组织：128KX8
封装主体材料：PLASTIC/EPOXY封装代码：QFP
封装形状：SQUARE封装形式：FLATPACK
并行/串行：PARALLEL编程电压：3.3 V
认证状态：Not Qualified座面最大高度：2.35 mm
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：0.65 mm
端子位置：QUAD类型：NOR TYPE
宽度：10 mm最长写入周期时间 (tWC)：10 ms
Base Number Matches：1

PSD813F1AV-90MIT 数据手册

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PSD813F1V  
Flash In-System Programmable (ISP)  
Peripherals for 8-bit MCUs, 3.3V  
FEATURES SUMMARY  
■
DUAL BANK FLASH MEMORIES  
Figure 1. Packages  
–
–
–
1 Mbit of Primary Flash Memory (8  
Uniform Sectors)  
256 Kbit Secondary EEPROM (4 Uniform  
Sectors)  
Concurrent operation: read from one  
memory while erasing and writing the  
other  
PQFP52 (M)  
■
■
16 Kbit SRAM (BATTERY-BACKED)  
PLD WITH MACROCELLS  
–
–
–
Over 3,000 Gates Of PLD: DPLD and  
CPLD  
DPLD - User-defined Internal chip-select  
decoding  
CPLD with 16 Output Macrocells (OMCs)  
and 24 Input Macrocells (IMCs)  
PLCC52 (J)  
■
27 RECONFIGURABLE I/Os  
–
27 individually configurable I/O port pins  
that can be used for the following  
functions:  
MCU I/Os;  
PLD I/Os;  
TQFQ64 (U)  
Latched MCU address output; and  
Special function I/Os.  
Note: 16 of the I/O ports may be  
configured as open-drain outputs.  
ENHANCED JTAG SERIAL PORT  
■
HIGH ENDURANCE:  
–
100,000 Erase/WRITE Cycles of Flash  
Memory  
■
–
Built-in JTAG-compliant serial port allows  
full-chip In-System Programmability (ISP)  
Efficient manufacturing allows for easy  
product testing and programming  
–
–
–
10,000 Erase/WRITE Cycles of EEPROM  
1,000 Erase/WRITE Cycles of PLD  
Data Retention: 15-year minimum at 90°C  
(for Main Flash, Boot, PLD and  
Configuration bits).  
–
■
■
PAGE REGISTER  
–
Internal page register that can be used to  
expand the microcontroller address space  
by a factor of 256.  
■
■
SINGLE SUPPLY VOLTAGE:  
3.3V±10% for PSD813F1V  
STANDBY CURRENT AS LOW AS 50µA  
–
PROGRAMMABLE POWER MANAGEMENT  
June 2004  
1/110  
1234567...110

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型号 品牌 获取价格 描述 数据表
PSD813F1AV-90MT STMICROELECTRONICS

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 		Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 3.3V
PSD813F1AV-90UIT STMICROELECTRONICS

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 		Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 3.3V
PSD813F1AV-90UT STMICROELECTRONICS

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 		Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 3.3V
PSD813F1V STMICROELECTRONICS

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 		Flash In-System Programmable ISP Peripherals For 8-bit MCUs
PSD813F1V12J1T STMICROELECTRONICS

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 		PIA-GENERAL PURPOSE, PQCC52, ROHS COMPLIANT, PLASTIC, LCC-52
PSD813F1V-12JIT STMICROELECTRONICS

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 		Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 3.3V
PSD813F1V-12MIT STMICROELECTRONICS

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 		Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 3.3V
PSD813F1V12MT STMICROELECTRONICS

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 		PIA-GENERAL PURPOSE, PQFP52, ROHS COMPLIANT, PLASTIC, QFP-52

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