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PLL1708DBQG4 PDF预览

PLL1708DBQG4

更新时间： 2024-11-08 15:48:03
品牌 Logo 应用领域
德州仪器 - TI 时钟光电二极管外围集成电路晶体
页数 文件大小 规格书
25页 628K
描述
3.3 V Dual PLL Multi-Clock Generator 20-SSOP -25 to 85

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PLL1708DBQG4 技术参数

是否Rohs认证：符合生命周期：Obsolete
零件包装代码：QSOP包装说明：0.150 INCH, GREEN, PLASTIC, QSOP-20
针数：20Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.25Is Samacsys：N
JESD-30 代码：R-PDSO-G20JESD-609代码：e4
长度：8.65 mm湿度敏感等级：1
端子数量：20最高工作温度：85 °C
最低工作温度：-25 °C最大输出时钟频率：36.864 MHz
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装等效代码：SSOP20,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH峰值回流温度（摄氏度）：260
电源：3.3 V主时钟/晶体标称频率：27.27 MHz
认证状态：Not Qualified座面最大高度：1.75 mm
子类别：Clock Generators最大压摆率：25 mA
最大供电电压：3.6 V最小供电电压：2.7 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL EXTENDED
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：0.635 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：3.9 mm
uPs/uCs/外围集成电路类型：CLOCK GENERATOR, VIDEOBase Number Matches：1

PLL1708DBQG4 数据手册

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SLES065 – DECEMBER 2002  
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FEATURES  
APPLICATIONS  
D
27-MHz Master Clock Input  
D
D
D
D
D
D
D
HDD + DVD Recorders  
DVD Recorders  
HDD Recorders  
DVD Players  
D
Generated Audio System Clock (PLL1707):  
– SCKO0: 768 f (f = 44.1 kHz)  
S
S
– SCKO1: 768 f , 512 f (f = 48 kHz)  
S
S
S
– SCKO2: 256 f (f = 32, 44.1, 48, 64, 88.2,  
S
S
96 kHz)  
– SCKO3: 384 f (f = 32, 44.1, 48, 64, 88.2,  
S
S
DVD Add-On Cards for Multimedia PCs  
Digital HDTV Systems  
96 kHz)  
Generated Audio System Clock (PLL1708):  
– SCKO0: 768 f (f = 44.1 kHz)  
D
S
S
Set-Top Boxes  
– SCKO1: 768 f , 512 f , 384 f , 256 f  
S
S
S
S
(f = 48 kHz)  
S
– SCKO2: 256 f (f = 16, 22.05, 24, 32, 44.1,  
S
S
DESCRIPTION  
48, 64, 88.2, 96 kHz)  
– SCKO3: 384 f (f = 16, 22.05, 24, 32, 44.1,  
S
S
†
†
The PLL1707 and PLL1708 are low cost, phase-locked  
loop (PLL) multiclock generators. The PLL1707 and  
PLL1708 can generate four system clocks from a 27-MHz  
reference input frequency. The clock outputs of the  
PLL1707 can be controlled by sampling frequency-control  
pins and those of the PLL1708 can be controlled through  
serial-mode control pins. The device gives customers both  
cost and space savings by eliminating external  
components and enables customers to achieve the very  
low-jitter performance needed for high performance audio  
DACs and/or ADCs. The PLL1707 and PLL1708 are ideal  
for MPEG-2 applications which use a 27-MHz master  
clock such as DVD recorders, HDD recorders, DVD  
add-on cards for multimedia PCs, digital HDTV systems,  
and set-top boxes.  
48, 64, 88.2, 96 kHz)  
D
D
D
D
Zero PPM Error Output Clocks  
Low Clock Jitter: 50 ps (Typical)  
Multiple Sampling Frequencies (PLL1707):  
– f = 32, 44.1, 48, 64, 88.2, 96 kHz  
S
Multiple Sampling Frequencies (PLL1708):  
– f = 16, 22.05, 24, 32, 44.1, 48, 64, 88.2,  
S
96 kHz  
D
D
D
3.3-V Single Power Supply  
PLL1707: Parallel Control  
PLL1708: Serial Control  
Package: 20-Pin SSOP (150 mil), Lead-Free  
Product  
This integrated circuit can be damaged by ESD. Texas Instruments recommends that all integrated circuits be handled with appropriate  
precautions. Failure to observe proper handling and installation procedures can cause damage.  
ESD damage can range from subtle performance degradation to complete device failure. Precision integrated circuits may be more susceptible to  
damage because very small parametric changes could cause the device not to meet its published specifications.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of Texas Instruments  
semiconductor products and disclaimers thereto appears at the end of this data sheet.  
†
The PLL1707 and PLL1708 use the same die and they are electrically identical except for mode control.  
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Copyright 2002, Texas Instruments Incorporated  
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PLL1708DBQG4 替代型号

型号 品牌 替代类型 描述 数据表
PLL1708DBQRG4 TI

完全替代

 4.096MHz 至 36.864MHz、串行控制、3.3V 双路 PLL 多时钟发生器
PLL1708DBQ TI

完全替代

 3.3-V DUAL PLL MULTICLOCK GENERATOR
PLL1708DBQR TI

完全替代

 3.3-V DUAL PLL MULTICLOCK GENERATOR

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 		PHASE LOCKED LOOP
PLL1810A ETC

获取价格

 		PHASE LOCKED LOOP
PLL2_C0 ALTERA

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 		Cyclone III Device Handbook
PLL2_C1 ALTERA

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 		Cyclone III Device Handbook
PLL2_C2 ALTERA

获取价格

 		Cyclone III Device Handbook
PLL2_C3 ALTERA

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 		Cyclone III Device Handbook
PLL2_C4 ALTERA

获取价格

 		Cyclone III Device Handbook

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