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PI90LV14LX

更新时间： 2024-11-16 12:58:35
品牌 Logo 应用领域
百利通 - PERICOM 时钟
页数 文件大小 规格书
6页 123K
描述
Low Skew Clock Driver, 90LV Series, 5 True Output(s), 0 Inverted Output(s), PDSO20, 0.173 INCH, TSSOP-20

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PI90LV14LX 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP,针数：20
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.84
系列：90LV输入调节：DIFFERENTIAL MUX
JESD-30 代码：R-PDSO-G20长度：6.5 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER功能数量：1
反相输出次数：端子数量：20
实输出次数：5最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：NOT SPECIFIED传播延迟（tpd）：4 ns
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.19 ns
座面最大高度：1.2 mm标称供电电压 (Vsup)：3.3 V
表面贴装：YES温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：4.4 mmBase Number Matches：1

PI90LV14LX 数据手册

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PI90LV14/PI90LVT14  
1:5 Clock Distribution  
Features  
Description  
• Meets and Exceeds the Requirements of ANSI  
TIA/EIA-644-1995  
ThePI90LV14implementslowvoltagedifferentialsignaling(LVDS)  
to achieve clocking rates as high as 320MHz with low skew.  
• Designed for clocking rates up to 320MHz  
• Operates from a single 3.3V Supply  
• LowVoltageDifferentialSignaling(LVDS)withOutput  
Voltages of ±350mV into a 100Ωload  
• Choice between LVDS or TTL clock input  
• Synchronous Enable/Disable  
The PI90LV14 is a low-skew 1:5 clock distribution chip which  
incorporates multiplexed clock inputs to allow for distribution of a  
lower-speed, single-ended clock or a high-speed system clock.  
When LOWthe SEL pin will select the differential clock input.  
The common enable (EN) is synchronous so that the outputs will  
only be enabled/disabled when they are already in the LOW state.  
This avoids any chance of generating a runt clock pulse when the  
device is enabled/disabled as can happen with an asynchronous  
control.Becausetheinternalflip-flopisclockedonthefallingedge  
oftheinputclock, allassociatedspecificationlimitsarereferenced  
to the negative edge of the clock input.  
• Clock outputs default LOW when inputs open  
• Multiplexedclockinput  
- Internal 300kΩpullup resistor on input pins  
-CLKandCLKhave110Ωinternaltermination(PI90LVT14)  
• 50ps Output-to-Output Skew  
• 475ps typical propagation delay  
• Bus Pins are high impedance when disabled or with  
The intended application of these devices and signaling technique  
is for high-speed clock distribution between boards.  
V
CC  
less than 1.5V  
• TTL inputs are 5V Tolerant  
• Power Dissipation at 400Mbits/s of 150mW  
• FunctioncompatibletoMotorola(PECL)  
MC100EL14andMicrel/Synergy(PECL)  
SY100EL14V  
PI90LV14 Block Diagram  
• >9kVESDProtection  
1
CLK1OUT+  
• 20-pinTSSOP(L)andQSOP(Q)packages  
V
20  
19  
CC  
2
CLK1OUT–  
Pin Descriptions  
EN  
Pin  
CLK, CLK  
SCLK  
Funtion  
3
4
CLK2OUT+  
CLK2OUT–  
D
Differential Clock Outputs  
LVTTL Clock Input  
Synchronous Enable  
Clock Select Input  
V
18  
17  
CC  
Q
GND  
EN  
5
6
16  
15  
1
0
CLK3OUT+  
CLK3OUT–  
SCLK  
CLK  
SEL  
Ω
CLK1-5OUT±  
Differential Clock Inputs  
14  
13  
Function Table  
7
8
CLK  
CLK4OUT+  
CLK4OUT–  
CLK  
L
SCLK  
SEL  
L
EN*  
L
CLKOUT+  
GND  
X
X
L
L
H
12  
11  
SEL  
H
L
L
9
CLK5OUT+  
CLK5OUT–  
X
H
L
L
10  
X
H
↓
H
L
H
GND  
↓
X
H
Z*  
* On next negative transition of CLK, or SCLK  
PS8538  
04/25/01  
1
123456

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与PI90LV14LX相关器件

型号 品牌 获取价格 描述 数据表
PI90LV14Q PERICOM

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 		1:5 Clock Distribution
PI90LV14QE PERICOM

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 		Low Skew Clock Driver, 90LV Series, 5 True Output(s), 0 Inverted Output(s), PDSO20, 0.150
PI90LV14QX PERICOM

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