AN7333K

更新时间： 2024-01-03 19:42:15

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松下 - PANASONIC		无线
页数	文件大小	规格书
8页	124K
描述
Equalizer Circuit, 1 Channel(s), Bipolar, PDIP24, 0.300 INCH, SHRINK, PLASTIC, DIP-24

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AN7333K 技术参数

生命周期：	Obsolete	零件包装代码：	DIP
包装说明：	SDIP,	针数：	24
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.83
Is Samacsys：	N	商用集成电路类型：	EQUALIZER CIRCUIT
JESD-30 代码：	R-PDIP-T24	长度：	21.7 mm
频带数量：	4	信道数量：	1
功能数量：	1	端子数量：	24
封装主体材料：	PLASTIC/EPOXY	封装代码：	SDIP
封装形状：	RECTANGULAR	封装形式：	IN-LINE, SHRINK PITCH
认证状态：	Not Qualified	座面最大高度：	4.95 mm
最大供电电压 (Vsup)：	14 V	最小供电电压 (Vsup)：	4 V
表面贴装：	NO	技术：	BIPOLAR
端子形式：	THROUGH-HOLE	端子节距：	1.778 mm
端子位置：	DUAL	宽度：	7.62 mm
Base Number Matches：	1

AN7333K 数据手册

ICs for Audio Common Use

AN7333S

4-Element Graphic Equalizer IC for Radio/Radio Cassette Recorder

I Overview

Unit: mm

The AN7333S is an integrated circuit for 4-

ꢀ4

ꢀ3

ꢀꢀ

ꢀ1

ꢀ0

ꢀ

element graphic equalizers most suitable for radio

cassette / portable component stereo equipment.

2-channel 4-element graphic equalizer can be

configured by applying frequency setting capacitors

and variable resistors externally. Non-step adjust-

ment of the boost and the cutting quantitiy is possible

by variable resistors.

1ꢀ

I Features

• The resonance frequency can be freely set by op-

tional selection of the capacitor capacitance.

0.3

7.ꢀ 0.3

9.4 0.3

•

Low distortion rate: THD = 0.04% (V_CC= 5 V)

Wide dynamic range: V_O= 800 mV[rms] (at Boost

THD = 1%)

SOP024-P-0375A

Note) The package of this product will be changed to lead-free type

(SOP024-P-0375C). See the new package dimensions section

later of this datasheet.

•

Low noise level: V_no= 10 µV (V_CC= 5V)

I Block Diagram

GND

V_CC

Publication date: December 2001

SDC00022BEB

12 3 4 5 6 7 8

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型号	品牌	描述	获取价格	数据表
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