Datasheet > 可编程逻辑 > 可编程逻辑器件> PALCE22V10H-25PI/4

PALCE22V10H-25PI/4

更新时间： 2024-11-09 22:26:31

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莱迪思 - LATTICE		可编程逻辑器件光电二极管输入元件时钟
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34页	662K
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24-Pin EE CMOS (Zero Power) Versatile PAL Device

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PALCE22V10H-25PI/4 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	DIP	包装说明：	0.300 INCH, SKINNY, PLASTIC, DIP-24
针数：	24	Reach Compliance Code：	not_compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.18	Is Samacsys：	N
其他特性：	10 MACROCELLS, 1 EXTERNAL CLOCK, SHARED INPUT/CLOCK, VARIABLE PRODUCT TERMS	架构：	PAL-TYPE
最大时钟频率：	33.3 MHz	JESD-30 代码：	R-PDIP-T24
JESD-609代码：	e0	长度：	30.734 mm
专用输入次数：	11	I/O 线路数量：	10
输入次数：	22	输出次数：	10
产品条款数：	132	端子数量：	24
最高工作温度：	85 °C	最低工作温度：	-40 °C
组织：	11 DEDICATED INPUTS, 10 I/O	输出函数：	MACROCELL
封装主体材料：	PLASTIC/EPOXY	封装代码：	DIP
封装等效代码：	DIP24,.3	封装形状：	RECTANGULAR
封装形式：	IN-LINE	电源：	5 V
可编程逻辑类型：	EE PLD	传播延迟：	25 ns
认证状态：	Not Qualified	座面最大高度：	5.08 mm
子类别：	Programmable Logic Devices	最大供电电压：	5.5 V
最小供电电压：	4.5 V	标称供电电压：	5 V
表面贴装：	NO	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Tin/Lead (Sn85Pb15)
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	宽度：	7.62 mm
Base Number Matches：	1

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PALCE22V10 COM'L: H-5/7/10/15/25,Q-10/15/25 IND: H-10/15/20/25

PALCE22V10Z COM'L: -25 IND: -15/25

PALCE22V10 and PALCE22V10Z

Families

24-Pin EE CMOS (Zero Power) Versatile PAL Device

DISTINCTIVE CHARACTERISTICS

As fast as 5-ns propagation delay and 142.8 MHz f

Low -pow er EE CMOS

(external)

MAX

10 macrocells programmable as registered or combinatorial, and active high or active low to

match application needs

Varied product term distribution allow s up to 16 product terms per output for complex

functions

Peripheral Component Interconnect (PCI) compliant (-5/-7/-10)

Global asynchronous reset and synchronous preset for initialization

Pow er-up reset for initialization and register preload for testability

Extensive third-party softw are and programmer support

24-pin SKINNY DIP, 24-pin SOIC, and 28-pin PLCC

5-ns and 7.5-ns versions utilize split leadframes for improved performance

GENERAL DESCRIPTION

The PALCE22V10 provides user-programmable logic for replacing conventional SSI/MSI gates and

ﬂip-ﬂops at a reduced chip count.

The PALCE22V10Z is an advanced PAL device built with zero-power, high-speed, electrically-

erasable CMOS technology. It provides user-programmable logic for replacing conventional zero-

power CMOS SSI/MSI gates and ﬂip-ﬂops at a reduced chip count.

The PALCE22V10Z provides zero standby power and high speed. At 30 µA maximum standby

current, the PALCE22V10Z allows battery-powered operation for an extended period.

The PAL device implements the familiar Boolean logic transfer function, the sum of products. The

PAL device is a programmable AND array driving a ﬁxed OR array. The AND array is programmed

to create custom product terms, while the OR array sums selected terms at the outputs.

The product terms are connected to the ﬁxed OR array with a varied distribution from 8 to16 across

the outputs (see Block Diagram). The OR sum of the products feeds the output macrocell. Each

macrocell can be programmed as registered or combinatorial, and active-high or active low. The

output conﬁguration is determined by two bits controlling two multiplexers in each macrocell.

Publication# 1 6564

Amendment/0

Rev: E

Issue Date: November 1 998

12 3 4 5 6 7...34

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型号	品牌	获取价格	描述	数据表
PALCE22V10H-25PI/5	LATTICE	获取价格	EE PLD, 25ns, CMOS, PDIP24,
PALCE22V10H-25SC	ETC	获取价格	Electrically-Erasable PLD
PALCE22V10H-25SC/4	LATTICE	获取价格	24-Pin EE CMOS (Zero Power) Versatile PAL Device
PALCE22V10H-25SC/4	ROCHESTER	获取价格	EE PLD, 25 ns, PDSO24, PLASTIC, SOIC-24
PALCE22V10H-25SI/5	LATTICE	获取价格	EE PLD, 25ns, CMOS, PDSO24,
PALCE22V10H-30/B3A	ETC	获取价格	Electrically-Erasable PLD
PALCE22V10H-30/BKA	ETC	获取价格	Electrically-Erasable PLD
PALCE22V10H-30/BLA	ETC	获取价格	Electrically-Erasable PLD
PALCE22V10H-30E4/B3A	ETC	获取价格	Electrically-Erasable PLD
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