NTE1167

更新时间： 2024-02-15 17:06:58

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NTE		信号电路锁相环或频率合成电路光电二极管
页数	文件大小	规格书
2页	27K
描述
Integrated Circuit Phase Lock Loop(PLL) Frequency Synthesizer

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NTE1167 技术参数

生命周期：	Active	零件包装代码：	DIP
包装说明：	,	针数：	16
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.68	Is Samacsys：	N
模拟集成电路 - 其他类型：	PLL FREQUENCY SYNTHESIZER	JESD-30 代码：	R-PDIP-T16
功能数量：	1	端子数量：	16
最高工作温度：	70 °C	最低工作温度：	-30 °C
封装主体材料：	PLASTIC/EPOXY	封装形状：	RECTANGULAR
封装形式：	IN-LINE	认证状态：	Not Qualified
最大供电电压 (Vsup)：	6.5 V	最小供电电压 (Vsup)：	5 V
标称供电电压 (Vsup)：	5.5 V	表面贴装：	NO
技术：	CMOS	温度等级：	OTHER
端子形式：	THROUGH-HOLE	端子位置：	DUAL
Base Number Matches：	1

NTE1167 数据手册

NTE1167

Integrated Circuit

Phase Lock Loop (PLL) Frequency Synthesizer

Description:

The NTE1167 consists of a crystal oscillator, 10 bit divider, phase comparator, and a programmable

divide–by–N 9–bit counter in a single CMOS 16–Lead DIP type integrated circuit.

This device is designed for use in frequency synthesizers and phase locked loop applications for CB

transceivers since it includes a reference frequency selector pin.

Absolute Maximum Ratings: (T_A= +25°C unless otherwise specified)

Supply Voltage, V_DD– V_SS. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . –0.3V to +7V

Input Voltage, V_IN. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . V_SS≤ V_IN≤ V_DD

Power Dissipation, P_D. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 250mW

Operating Temperature Range, T_opr. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . –30° to +70°C

Storage Temperature Range, T_stg. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . –55° to +125°C

Lead Temperature (During Soldering, 5sec Max), T_L. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . +260°C

Electrical Characteristics: (V_DD– V_SS= 6V, –30° ≤ T_A≤ +70°C, f ꢀ Q = 10.24MHz unless otherwise

specified)

Parameter

Symbol

Test Conditions

Min Typ Max Unit

Input Voltage (All Inputs)

Low Level

V_IL

Note 1

–

5.5

–

0.5

–

High Level

V_IH

Pull–Up Resistance

Pull–Down Resistance

Supply Current

_UPꢀ F_S

2.0

MΩ

kΩ

_DNꢀ P₀– P₈

–

I_DD

V_DD= 5.5V, V_inꢀ F_in= 1V_P–P

Exclude sink current of preset pin

5.0 9.0 mA

Output Voltage

High Level

_OHꢀ LD

I_OH= 0.1mA

I_OL= 0.1mA

5.5

–

Low Level

_OLꢀ LD

0.5

Output Current

High Level

_SATꢀ H ꢀ D_OV_O= 0V

400

–

µA

Low Level

I_SATꢀ L ꢀ D_OV_O= 0V

Output Voltage

V_IFꢀ F_in

V_IFꢀ F_S

V_DD= 5V

1.7 2.2 2.8

5.5

–

0.5

–

V_IFꢀ P₀– P₈

_INꢀ Max Q_in

_INꢀ Max F_in

_FRꢀ Max ꢀ F_IN

V_DD

Max Input Frequency

MHz

3.3

3.5

5.0

–

Max Free Running Frequency

Operating Voltage

–

6.5

Note 1. All inputs refers to pins P₀to P₈, F_S, F_in, and Q_in. This parameter defins their input levels

at DC coupling.

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