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MT9040ANR1

更新时间： 2024-01-02 12:07:57

品牌	Logo	应用领域
赛灵思 - XILINX		电信光电二极管电信集成电路
页数	文件大小	规格书
26页	455K
描述
SPECIALTY TELECOM CIRCUIT, PDSO48, 0.300 INCH, LEAD FREE, MO-118AA, SSOP-48

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MT9040ANR1 技术参数

是否Rohs认证：	符合	生命周期：	Transferred
包装说明：	SSOP,	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.82
JESD-30 代码：	R-PDSO-G48	JESD-609代码：	e3
长度：	15.88 mm	湿度敏感等级：	3
功能数量：	1	端子数量：	48
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	认证状态：	Not Qualified
座面最大高度：	2.79 mm	标称供电电压：	3.3 V
表面贴装：	YES	电信集成电路类型：	TELECOM CIRCUIT
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	0.635 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	7.49 mm

MT9040ANR1 数据手册

MT9040

T1/E1 Synchronizer

Data Sheet

February 2009

Features

•

Supports AT&T TR62411 and Bellcore GR-1244-

CORE and Stratum 4 timing for DS1 interfaces

Ordering Information

MT9040AN

MT9040ANR

MT9040AN1

48 Pin SSOP

48 Pin SSOP*

Tubes

Tape & Reel

Tubes

Tape & Reel

Supports ETSI ETS 300 011, TBR 4, TBR 12 and

TBR 13 timing for E1 interfaces

Selectable 19.44 MHz, 1.544 MHz, 2.048 MHz or

8kHz input reference signals

MT9040ANR1 48 Pin SSOP*

*Pb Free Matte Tin

-40°C to +85°C

Provides C1.5, C2, C4, C6, C8, C16, and C19

(STS-3/OC3 clock divided by 8) output clock

signals

Description

•

Provides 5 different styles of 8 KHz framing

pulses

The MT9040 T1/E1 System Synchronizer contains a

digital phase-locked loop (DPLL), which provides timing

and synchronization signals for T1 and E1 primary rate

transmission links.

•

Attenuates wander from 1.9 Hz

Fast lock mode

The MT9040 generates ST-BUS clock and framing

signals that are phase locked to either a 19.44 MHz,

2.048 MHz, 1.544 MHz, or 8 kHz input reference.

JTAG Boundary Scan

Applications

The MT9040 is compliant with AT&T TR62411 and

Bellcore GR-1244-CORE, Stratum 4; and ETSI ETS

300 011. It will meet the jitter/wander tolerance, jitter

transfer, intrinsic jitter, frequency accuracy and capture

range for these specifications.

•

Synchronization and timing control for multitrunk

T1 and E1 systems

•

ST-BUS clock and frame pulse source

OSCi

OSCo

FLOCK

LOCK

VDD

VSS

Master Clock

C19o

TCK

TDI

TMS

TRST

TDO

C1.5o

C2o

C4o

C6o

C8o

C16o

F0o

F8o

F16o

RSP

DPLL

IEEE

1149.1a

Output

Interface

Circuit

REF

Input

Impairment

Monitor

TSP

Frequency

Select

Control State Machine

MUX

Feedback

FS1

FS2

RST

Figure 1 - Functional Block Diagram

Zarlink Semiconductor US Patent No. 5,602,884, UK Patent No. 0772912,

France Brevete S.G.D.G. 0772912; Germany DBP No. 69502724.7-08

Zarlink Semiconductor Inc.

Zarlink, ZL and the Zarlink Semiconductor logo are trademarks of Zarlink Semiconductor Inc.

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MT9041AP	MITEL	获取价格	Multiple Output Trunk PLL
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MT9041BP	MITEL	获取价格	T1/E1 System Synchronizer
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MT9041BP1	ZARLINK	获取价格	Telecom Circuit, 1-Func, CMOS, PQCC28, LEAD FREE, PLASTIC, MS-018AB, LCC-28
MT9041BPR	MICROSEMI	获取价格	SPECIALTY TELECOM CIRCUIT, PQCC28, PLASTIC, MS-018AB, LCC-28
MT9041BPR1	ZARLINK	获取价格	Telecom Circuit, 1-Func, CMOS, PQCC28, LEAD FREE, PLASTIC, MS-018AB, LCC-28
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