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MM54C175J/883

更新时间： 2024-01-26 04:35:23

品牌	Logo	应用领域
美国国家半导体 - NSC		输出元件逻辑集成电路触发器
页数	文件大小	规格书
6页	112K
描述
IC CMOS SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, CDIP16, FF/Latch

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技术参数
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MM54C175J/883 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
包装说明：	DIP, DIP16,.3	Reach Compliance Code：	compliant
风险等级：	5.92	JESD-30 代码：	R-XDIP-T16
JESD-609代码：	e0	负载电容（CL）：	50 pF
逻辑集成电路类型：	D FLIP-FLOP	最大频率@ Nom-Sup：	2000000 Hz
最大I（ol）：	0.00036 A	功能数量：	4
端子数量：	16	最高工作温度：	125 °C
最低工作温度：	-55 °C	封装主体材料：	CERAMIC
封装代码：	DIP	封装等效代码：	DIP16,.3
封装形状：	RECTANGULAR	封装形式：	IN-LINE
电源：	5/15 V	认证状态：	Not Qualified
筛选级别：	MIL-STD-883 Class C	子类别：	FF/Latches
表面贴装：	NO	技术：	CMOS
温度等级：	MILITARY	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	触发器类型：	POSITIVE EDGE
Base Number Matches：	1

MM54C175J/883 数据手册

February 1988

MM54C175/MM74C175 Quad D Flip-Flop

General Description

The MM54C175/MM74C175 consists of four positive-edge

All inputs are protected from static discharge by diode

clamps to V and GND.

triggered type flip-flops implemented with monolithic

CMOS technology. Both are true and complemented out-

puts from each flip-flop are externally available. All four flip-

flops are controlled by a common clock and a common

clear. Information at the D inputs meeting the set-up time

requirements is transferred to the Q outputs on the positive-

going edge of the clock pulse. The clearing operation, en-

abled by a negative pulse at Clear input, clears all four Q

outputs to logical ‘‘0’’ and Q’s to logical ‘‘1’’.

Features

Wide supply voltage range

Guaranteed noise margin

High noise immunity

3V to 15V

1.0V

0.45 V

(typ.)

Low power TTL compatibility

Fan out of 2

driving 74L

Connection Diagram & Truth Table

Dual-In-Line Package

TL/F/5900–1

Top View

Order Number MM54C175 or MM74C175

Each Flip-Flop

Inputs

Clock

Outputs

Clear

High level

Low level

Irrelevant

Transition from low to high level

No change

1995 National Semiconductor Corporation

TL/F/5900

RRD-B30M105/Printed in U. S. A.

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型号	品牌	描述	获取价格	数据表
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