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ML13055-5P

更新时间： 2024-01-01 13:20:25
品牌 Logo 应用领域
LANSDALE 电信集成电路光电二极管
页数 文件大小 规格书
9页 314K
描述
Wideband FSK Receiver

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ML13055-5P 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP,针数：16
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.27Is Samacsys：N
JESD-30 代码：R-PDSO-G16长度：9.9 mm
功能数量：1端子数量：16
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：NOT SPECIFIED座面最大高度：1.75 mm
标称供电电压：5 V表面贴装：YES
电信集成电路类型：TELECOM CIRCUIT温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：3.9 mmBase Number Matches：1

ML13055-5P 数据手册

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ML13055  
Wideband FSK Receiver  
Legacy Device: Motorola MC13055  
The ML13055 is intended for RF data link systems using  
carrier frequencies up to 40 MHz and FSK (frequency shift  
keying) data rates up to 2.0 M Baud (1.0 MHz). This design  
is similar to the ML3356, except that it does not include the  
oscillator/mixer. The IF bandwidth has been increased and  
the detector output has been revised to a balanced configura-  
tion. The received signal strength metering circuit has been  
retained, as has the versatile data slicer/comparator.  
P-DIP 16 = EP  
Plastic DIP  
SO 16 = -5P  
CROSS REFERENCE/ORDERING INFORMATION  
PACKAGE  
MOTOROLA  
LANSDALE  
• Input Sensitivity 20 µV @ 40 MHz  
P-DIP 16  
SO 16  
MC13055P  
MC13055D  
ML13055EP  
ML13055-5P  
• Signal Strength Indicator Linear Over 3 Decades  
• Easy Application, Few Peripheral Components  
Note: Lansdale lead free (Pb) product, as it  
becomes available, will be identified by a part  
number prefix change from ML to MLE.  
• Operating Temperature Range T = –40° to +85°C  
A
PIN ASSIGNMENT  
V
CC  
0.01  
0.01  
16  
Data  
Output  
1
15  
14  
+
–
2
3
1
2
3
4
5
6
7
8
16  
Data Out  
Comparator Gnd  
100pF  
–
+
0.8V  
13  
12  
Carrier  
Detect  
+
–
Comparator V  
CC  
15  
14  
13  
12  
40MHz  
IF  
Input  
4
Comparator  
IF Ground  
22pF  
27pF  
Squelch  
Adjust  
(meter)  
5
6
(50Ω)  
5.0k  
IF V  
CC  
Carrier Detect  
Meter Drive  
Limiter  
Limiter Input  
Limiter Bias  
Quad Bias  
L1  
11  
10  
68pF  
3.9k  
0.1  
7
8
11  
10  
9
Detector  
Out  
Quad Input  
0.01  
9
V
CC  
3.9k  
1.0k  
39pF  
L2  
Figure 1. Block Diagram and Application Circuit  
Page 1 of 9  
www.lansdale.com  
Issue B  
1234567...9

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