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MK74CG117AFT

更新时间： 2024-02-16 20:26:15

品牌	Logo	应用领域
艾迪悌 - IDT		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
7页	155K
描述
Clock Generator, 90MHz, CMOS, PDSO48, 0.300 INCH, SSOP-48

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MK74CG117AFT 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	SSOP
包装说明：	0.300 INCH, SSOP-48	针数：	48
Reach Compliance Code：	not_compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.85
JESD-30 代码：	R-PDSO-G48	JESD-609代码：	e0
长度：	15.875 mm	湿度敏感等级：	1
端子数量：	48	最高工作温度：	70 °C
最低工作温度：		最大输出时钟频率：	90 MHz
封装主体材料：	PLASTIC/EPOXY	封装代码：	SSOP
封装等效代码：	SSOP48,.4	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, SHRINK PITCH	峰值回流温度（摄氏度）：	225
电源：	3.3 V	主时钟/晶体标称频率：	50 MHz
认证状态：	Not Qualified	座面最大高度：	2.8 mm
子类别：	Clock Generators	最大供电电压：	3.47 V
最小供电电压：	3.14 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn85Pb15)
端子形式：	GULL WING	端子节距：	0.635 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	7.5 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

MK74CG117AFT 数据手册

MK74CG117A

16 Output Low Skew Clock Generator

Description

Features

The MK74CG117A is a monolithic CMOS high-speed,

low-skew clock driver that includes an on-chip PLL.

Ideal for communications and other systems that

require a large number of high-speed clocks, the

unique combination of PLL and 16 low-skew outputs

can eliminate oscillators and low-skew buffers from

systems.

• 48-pin SSOP (300 mil) package

• On-chip PLL generates output clocks up to 90 MHz

from a simple crystal or clock input

• 16 low-skew outputs

• Output skew less than 350 ps on rising edges

• Ability to configure as

The device has a number of built-in multipliers, making

it possible to run from one inexpensive, low-frequency

crystal, and produce high-frequency clock outputs.

Another selection allows the chip to run as a divider,

dividing the input clock by two (or 4 using the mode

select).

– 16 clocks at full-frequency

– 12 at full and 4 at half-frequency

– 8 at full and 8 at half-frequency

• Tri-state mode for Output Enable function

• 3.3 V 5ꢀ supply voltage

The device also has a buffered reference output,

allowing multiple devices to be easily driven from one

clock source.

Block Diagram

VDD

Clock 1

S2:0

Clock

Synthesis

and Mode

Select

Clock 2

M1:0

Circuitry

Clock 16

REF

X1/ICLK

Crystal or

clock input

Crystal

Ocsillator

The crystal requires external capacitors for

accurate tuning of the clock

GND

MDS 74CG117A D

Revision 051304

Integrated Circuit Systems, Inc. z 525 Race Street, San Jose, CA 95126 z tel (408) 297-1201 z www.icst.com

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