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MK1709AG

更新时间： 2024-02-18 11:38:22

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矽成 - ICSI		时钟发生器逻辑集成电路光电二极管驱动
页数	文件大小	规格书
9页	170K
描述
Low EMI Clock Generator

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MK1709AG 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	0.150 INCH, SOIC-8	针数：	8
Reach Compliance Code：	not_compliant	HTS代码：	8542.39.00.01
风险等级：	5.82	系列：	1709
输入调节：	STANDARD	JESD-30 代码：	R-PDSO-G8
JESD-609代码：	e0	长度：	4.9 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	最大I（ol）：	0.012 A
湿度敏感等级：	1	功能数量：	1
反相输出次数：		端子数量：	8
实输出次数：	1	最高工作温度：	85 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装等效代码：	SOP8,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	240	电源：	3.3 V
认证状态：	Not Qualified	座面最大高度：	1.75 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	3.465 V
最小供电电压 (Vsup)：	3.135 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	OTHER	端子面层：	Tin/Lead (Sn85Pb15)
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	3.9 mm	最小 fmax：	167 MHz
Base Number Matches：	1

MK1709AG 数据手册

MK1709

Low EMI Clock Generator

Description

Features

The MK1709 generates a low EMI output clock from a

clock input. The part is designed to dither the LCD

interface clock for flat panel graphics controllers. The

device uses ICS’ proprietary mix of analog and digital

Phase Locked Loop (PLL) technology to spread the

frequency spectrum of the output, thereby reducing the

frequency amplitude peaks by several dB.

• Packaged in 8-pin SOIC (MK1709S) and in 8-pin

TSSOP (MK1709AG)

• 8-pin TSSOP available in lead (Pb) free package

• Provides a spread spectrum output clock

• Supports flat panel controllers

• Guaranteed to +85°C operation

• Accepts a clock input, provides same frequency

The MK1709 offers centered spread from a high speed

clock input. Refer to the MK1714-01/02 for a crystal

input and the widest selection of input frequencies and

multipliers.

dithered output

• Good for all VGA modes from 80 to 167 MHz

• Peak reduction by 7dB - 14dB typical on 3rd - 19th

odd harmonics

ICS offers many other clocks for computers and

computer peripherals. Consult us when you need to

remove crystals and oscillators from your board.

• Low EMI feature can be disabled

• Includes power-down

• Operating voltage of 3.3 V

• Advanced, low-power CMOS process

Block Diagram

VDD

PLL Clock

Synthesis

Low EMI Enable

and Spread

Spectrum

Circuitry

Clock Out

Input

Buffer

ICLK

GND

MDS 1709 D

Revision 031204

Integrated Circuit Systems, Inc. ● 525 Race Street, San Jose, CA 95126 ● tel (408) 297-1201 ● www.icst.com

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