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MK1707SILF

更新时间： 2024-01-04 05:47:59

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矽成 - ICSI		时钟发生器
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描述
Low EMI Clock Generator

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MK1707SILF 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	SOIC-8	针数：	8
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.67
系列：	1707	输入调节：	STANDARD
JESD-30 代码：	R-PDSO-G8	JESD-609代码：	e3
长度：	4.9 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
最大I（ol）：	0.012 A	湿度敏感等级：	1
功能数量：	1	反相输出次数：
端子数量：	8	实输出次数：	1
最高工作温度：	85 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP8,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
电源：	3.3/5 V	认证状态：	Not Qualified
座面最大高度：	1.75 mm	子类别：	Clock Drivers
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	3.135 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	OTHER
端子面层：	Matte Tin (Sn) - annealed	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	3.9 mm
最小 fmax：	167 MHz	Base Number Matches：	1

MK1707SILF 数据手册

MK1707

Low EMI Clock Generator

Description

Features

The MK1707 generates a low EMI output clock from a

clock input. The part is designed to dither the LCD

interface clock for flat panel graphics controllers. The

device uses ICS’ proprietary mix of analog and digital

Phase Locked Loop (PLL) technology to spread the

frequency spectrum of the output, thereby reducing the

frequency amplitude peaks by several dB.

• Packaged in 8-pin SOIC

• Available in Pb-free package

• Industrial temperature range available

• Provides a spread spectrum output clock

• Supports ATI’s flat panel controllers

• Guaranteed to +85°C operation

The MK1707 offers both centered and down spread

from a high speed clock input. Refer to the

• Accepts a clock input, provides same frequency

dithered output

MK1714-01/02 for a crystal input and the widest

selection of input frequencies and multipliers.

• Good for all VGA modes from 80 to 167 MHz

• Peak reduction by 7dB - 14dB typical on 3rd - 19th

odd harmonics

ICS offers many other clocks for computers and

computer peripherals. Consult us when you need to

remove crystals and oscillators from your board.

• Low EMI feature can be disabled

• Includes Power-down

• Operating voltage of 3.3 V or 5 V

• Advanced, low-power CMOS process

Block Diagram

VDD

S1:0

Spread Direction

Low EMI Enable

PLL Clock

Synthesis

and Spread

Spectrum

Circuitry

Clock Out

Input

Buffer

ICLK

GND

MDS 1707 G

Revision 032204

Integrated Circuit Systems, Inc. ● 525 Race Street, San Jose, CA 95126 ● tel (408) 297-1201 ● www.icst.com

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