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MC74VHCT50ADG PDF预览

MC74VHCT50ADG

更新时间： 2024-11-04 05:22:07
品牌 Logo 应用领域
安森美 - ONSEMI 转换器电平转换器栅极触发器逻辑集成电路光电二极管
页数 文件大小 规格书
7页 92K
描述
Noninverting Buffer / CMOS Logic Level Shifter with LSTTL−Compatible Inputs

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MC74VHCT50ADG 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP, SOP14,.25针数：14
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.63Is Samacsys：N
系列：AHCT/VHCTJESD-30 代码：R-PDSO-G14
JESD-609代码：e3长度：8.65 mm
负载电容（CL）：50 pF逻辑集成电路类型：BUFFER
最大I（ol）：0.008 A功能数量：6
输入次数：1端子数量：14
最高工作温度：125 °C最低工作温度：-55 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP14,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：RAIL
峰值回流温度（摄氏度）：260电源：5 V
Prop。Delay @ Nom-Sup：10.5 ns传播延迟（tpd）：13 ns
认证状态：Not Qualified施密特触发器：NO
座面最大高度：1.75 mm子类别：Gates
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：MATTE TIN端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40宽度：3.9 mm
Base Number Matches：1

MC74VHCT50ADG 数据手册

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MC74VHCT50A  
Noninverting Buffer /  
CMOS Logic Level Shifter  
with LSTTL−Compatible Inputs  
The MC74VHCT50A is a hex noninverting buffer fabricated with  
silicon gate CMOS technology. It achieves high speed operation  
similar to equivalent Bipolar Schottky TTL while maintaining CMOS  
low power dissipation.  
http://onsemi.com  
The internal circuit is composed of three stages, including a buffered  
output which provides high noise immunity and stable output.  
The device input is compatible with TTL−type input thresholds and  
the output has a full 5 V CMOS level output swing. The input  
protection circuitry on this device allows overvoltage tolerance on the  
input, allowing the device to be used as a logic−level translator from  
3.0 V CMOS logic to 5.0 V CMOS Logic or from 1.8 V CMOS logic  
to 3.0 V CMOS Logic while operating at the high−voltage power  
supply.  
14−LEAD SOIC  
D SUFFIX  
CASE 751A  
14−LEAD TSSOP  
DT SUFFIX  
CASE 948G  
The MC74VHCT50A input structure provides protection when  
voltages up to 7 V are applied, regardless of the supply voltage. This  
allows the MC74VHCT50A to be used to interface 5 V circuits to 3 V  
circuits. The output structures also provide protection when  
14−LEAD SOIC EIAJ  
M SUFFIX  
CASE 965  
PIN CONNECTION AND  
MARKING DIAGRAM (Top View)  
V
= 0 V. These input and output structures help prevent device  
CC  
destruction caused by supply voltage − input/output voltage mismatch,  
battery backup, hot insertion, etc.  
V
A6  
13  
Y6  
12  
A5  
11  
Y5  
10  
A4  
9
Y4  
8
CC  
14  
• High Speed: t = 3.5 ns (Typ) at V = 5 V  
PD  
CC  
• Low Power Dissipation: I = 2 mA (Max) at T = 25°C  
CC  
A
• TTL−Compatible Inputs: V = 0.8 V; V = 2.0 V  
IL  
IH  
• CMOS−Compatible Outputs: V > 0.8 V ; V < 0.1 V @Load  
OH  
CC  
OL  
CC  
• Power Down Protection Provided on Inputs and Outputs  
• Pb−Free Packages are Available  
1
2
3
4
5
6
7
A1  
Y1  
A2  
Y2  
A3  
Y3 GND  
For detailed package marking information, see the Marking  
Diagram section on page 4 of this data sheet.  
LOGIC DIAGRAM  
LOGIC SYMBOL  
1
3
5
2
FUNCTION TABLE  
A1  
A2  
A3  
Y1  
Y2  
Y3  
1
1
1
1
1
1
A1  
A2  
A3  
A4  
A5  
A6  
Y1  
Y2  
Y3  
Y4  
Y5  
Y6  
A Input  
Y Output  
4
6
L
L
H
H
Y = A  
9
8
10  
12  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 4 of this data sheet.  
A4  
A5  
A6  
Y4  
Y5  
Y6  
11  
13  
©
Semiconductor Components Industries, LLC, 2007  
1
Publication Order Number:  
January, 2007− Rev. 6  
MC74VHCT50A/D  
1234567

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