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Datasheet > 逻辑 > 解码器/驱动器> MC74VHC138DR2G
MC74VHC138DR2G PDF预览

MC74VHC138DR2G

更新时间： 2024-01-24 08:11:44
品牌 Logo 应用领域
安森美 - ONSEMI 解码器驱动器逻辑集成电路光电二极管
页数 文件大小 规格书
8页 137K
描述
3-to-8 Line Decoder

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MC74VHC138DR2G 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：SOP, SOP16,.25针数：16
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：0.52
系列：AHC/VHC输入调节：STANDARD
JESD-30 代码：R-PDSO-G16JESD-609代码：e3
长度：9.9 mm负载电容（CL）：50 pF
逻辑集成电路类型：OTHER DECODER/DRIVER最大I（ol）：0.008 A
湿度敏感等级：1功能数量：1
端子数量：16最高工作温度：125 °C
最低工作温度：-55 °C输出极性：INVERTED
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP16,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TR
峰值回流温度（摄氏度）：260电源：2/5.5 V
Prop。Delay @ Nom-Sup：11.5 ns传播延迟（tpd）：18 ns
认证状态：Not Qualified座面最大高度：1.75 mm
子类别：Decoder/Drivers最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：3.9 mmBase Number Matches：1

MC74VHC138DR2G 数据手册

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MC74VHC138  
3-to-8 Line Decoder  
The MC74VHC138 is an advanced high speed CMOS 3−to−8  
decoder fabricated with silicon gate CMOS technology. It achieves  
high speed operation similar to equivalent Bipolar Schottky TTL  
while maintaining CMOS low power dissipation.  
When the device is enabled, three Binary Select inputs (A0 − A2)  
determine which one of the outputs (Y0 − Y7) will go Low. When  
enable input E3 is held Low or either E2 or E1 is held High, decoding  
function is inhibited and all outputs go high. E3, E2, and E1 inputs are  
provided to ease cascade connection and for use as an address decoder  
for memory systems.  
http://onsemi.com  
MARKING DIAGRAMS  
16  
9
VHC138G  
AWLYWW  
SOIC−16  
D SUFFIX  
CASE 751B  
1
8
The internal circuit is composed of three stages, including a buffer  
output which provides high noise immunity and stable output. The  
inputs tolerate voltages up to 7V, allowing the interface of 5V systems  
to 3V systems.  
16  
9
VHC  
138  
TSSOP−16  
DT SUFFIX  
CASE 948F  
• High Speed: t = 5.7ns (Typ) at V = 5 V  
PD  
CC  
ALYW G  
• Low Power Dissipation: I = 4 μA (Max) at T = 25°C  
CC  
A
G
1
• High Noise Immunity: V  
= V  
= 28% V  
NIH  
NIL CC  
8
• Power Down Protection Provided on Inputs  
• Balanced Propagation Delays  
VHC138 = Specific Device Code  
= Assembly Location  
WL, L = Wafer Lot  
= Year  
WW, W = Work Week  
G or G = Pb−Free Package  
A
• Designed for 2 V to 5.5 V Operating Range  
• Low Noise: V  
= 0.8 V (Max)  
Y
OLP  
• Pin and Function Compatible with Other Standard Logic Families  
• Latchup Performance Exceeds 300 mA  
• ESD Performance: HBM > 2000 V; Machine Model > 200 V  
• Chip Complexity: 122 FETs or 30.5 Equivalent Gates  
• These Devices are Pb−Free and are RoHS Compliant  
ORDERING INFORMATION  
Device  
Package  
Shipping  
48 Units/Rail  
MC74VHC138DG  
SOIC−16  
MC74VHC138DR2G SOIC−16 2500 Units/Reel  
MC74VHC138DTR2G TSSOP−16 2500 Units/Reel  
© Semiconductor Components Industries, LLC, 2011  
1
Publication Order Number:  
May, 2011 − Rev. 5  
MC74VHC138/D  
12345678

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MC74VHC138DR2G 替代型号

型号 品牌 替代类型 描述 数据表
MC74VHC138DG ONSEMI

完全替代

 3-to-8 Line Decoder
74VHC138M ONSEMI

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 		AHC/VHC SERIES, OTHER DECODER/DRIVER, INVERTED OUTPUT, PDSO16, EIAJ, PLASTIC, SOIC-16

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