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Datasheet > 逻辑 > 总线驱动器/收发器> MC74VHC125M
MC74VHC125M PDF预览

MC74VHC125M

更新时间： 2024-11-19 22:54:55
品牌 Logo 应用领域
安森美 - ONSEMI 总线驱动器总线收发器逻辑集成电路光电二极管
页数 文件大小 规格书
8页 168K
描述
Quad Bus Buffer

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MC74VHC125M 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：SOIC包装说明：EIAJ, SOIC-14
针数：14Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.5
Is Samacsys：N控制类型：ENABLE LOW
系列：AHC/VHCJESD-30 代码：R-PDSO-G14
JESD-609代码：e4长度：10.2 mm
逻辑集成电路类型：BUS DRIVER最大I（ol）：0.008 A
湿度敏感等级：3位数：1
功能数量：4端口数量：2
端子数量：14最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP14,.3
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
包装方法：RAIL峰值回流温度（摄氏度）：260
电源：2/5.5 VProp。Delay @ Nom-Sup：10.5 ns
传播延迟（tpd）：16 ns认证状态：Not Qualified
座面最大高度：2.05 mm子类别：Bus Driver/Transceivers
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40宽度：5.275 mm
Base Number Matches：1

MC74VHC125M 数据手册

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with 3–State Control Inputs  
The MC74VHC125 is a high speed CMOS quad bus buffer  
fabricated with silicon gate CMOS technology. It achieves high speed  
operation similar to equivalent Bipolar Schottky TTL while  
maintaining CMOS low power dissipation.  
http://onsemi.com  
The MC74VHC125 requires the 3–state control input (OE) to be set  
High to place the output into the high impedance state.  
The internal circuit is composed of three stages, including a buffer  
output which provides high noise immunity and stable output. The  
inputs tolerate voltages up to 7V, allowing the interface of 5V systems  
to 3V systems.  
14–LEAD SOIC  
14–LEAD TSSOP  
DT SUFFIX  
D SUFFIX  
CASE 751A  
CASE 948G  
• High Speed: t  
= 3.8ns (Typ) at V  
= 5V  
PD  
• Low Power Dissipation: I  
CC  
= 4µA (Max) at T = 25°C  
CC  
A
• High Noise Immunity: V  
= V  
= 28% V  
NIL CC  
NIH  
• Power Down Protection Provided on Inputs  
• Balanced Propagation Delays  
• Designed for 2V to 5.5V Operating Range  
14–LEAD SOIC EIAJ  
M SUFFIX  
CASE 965  
• Low Noise: V  
= 0.8V (Max)  
OLP  
PIN CONNECTION AND  
MARKING DIAGRAM (Top View)  
• Pin and Function Compatible with Other Standard Logic Families  
• Latchup Performance Exceeds 300mA  
• ESD Performance: HBM > 2000V; Machine Model > 200V  
• Chip Complexity: 72 FETs or 18 Equivalent Gates  
OE1  
A1  
1
2
14  
13 OE4  
12  
V
CC  
Y1  
3
4
A4  
LOGIC DIAGRAM  
OE2  
11 Y4  
Active–Low Output Enables  
A2  
Y2  
5
6
7
10 OE3  
2
1
3
6
A1  
9
8
A3  
Y3  
Y1  
GND  
OE1  
5
4
For detailed package marking information, see the Marking  
Diagram section on page 5 of this data sheet.  
A2  
Y2  
Y3  
OE2  
9
8
A3  
ORDERING INFORMATION  
10  
OE3  
Device  
Package  
SOIC  
Shipping  
12  
13  
11  
A4  
Y4  
MC74VHC125D  
MC74VHC125DT  
MC74VHC125M  
55 Units/Rail  
96 Units/Rail  
50 Units/Rail  
OE4  
TSSOP  
FUNCTION TABLE  
SOIC EIAJ  
VHC125  
Inputs Output  
A
OE  
Y
H
L
L
L
H
L
X
H
Z
Semiconductor Components Industries, LLC, 2000  
1
Publication Order Number:  
April, 2000 – Rev. 2  
MC74VHC125/D  
12345678

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MC74VHC125M 替代型号

型号 品牌 替代类型 描述 数据表
MC74VHC125MG ONSEMI

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 Quad Bus Buffer with 3−State Control Inputs
MC74VHC125MELG ONSEMI

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 AHC/VHC SERIES, QUAD 1-BIT DRIVER, TRUE OUTPUT, PDSO14, EIAJ, PLASTIC, SOIC-14
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型号 品牌 获取价格 描述 数据表
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 		Quad Bus Buffer with 3−State Control Inputs
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 		AHC/VHC SERIES, QUAD 1-BIT DRIVER, TRUE OUTPUT, PDSO14, EIAJ, SOIC-14
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