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MC74VHC02MEL PDF预览

MC74VHC02MEL

更新时间： 2024-11-16 13:11:19
品牌 Logo 应用领域
安森美 - ONSEMI 栅
页数 文件大小 规格书
5页 82K
描述
IC,LOGIC GATE,QUAD 2-INPUT NOR,AHC/VHC-CMOS,SOP,14PIN,PLASTIC

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MC74VHC02MEL 技术参数

是否Rohs认证： 符合生命周期：Obsolete
包装说明：SOP, SOP14,.3Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.5
系列：AHC/VHC/H/U/VJESD-30 代码：R-PDSO-G14
JESD-609代码：e4长度：10.2 mm
负载电容（CL）：50 pF逻辑集成电路类型：NOR GATE
最大I（ol）：0.008 A功能数量：4
输入次数：2端子数量：14
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP14,.3封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TAPE AND REEL
电源：2/5.5 VProp。Delay @ Nom-Sup：8.5 ns
传播延迟（tpd）：13 ns认证状态：Not Qualified
施密特触发器：NO座面最大高度：2.05 mm
子类别：Gates最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL宽度：5.275 mm
Base Number Matches：1

MC74VHC02MEL 数据手册

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MC74VHC02  
Quad 2−Input NOR Gate  
The MC74VHC02 is an advanced high speed CMOS 2−input NOR  
gate fabricated with silicon gate CMOS technology. It achieves high  
speed operation similar to equivalent Bipolar Schottky TTL while  
maintaining CMOS low power dissipation.  
The internal circuit is composed of three stages, including a buffer  
output which provides high noise immunity and stable output. The  
inputs tolerate voltages up to 7.0 V, allowing the interface of 5.0 V  
systems to 3.0 V systems.  
http://onsemi.com  
MARKING  
DIAGRAMS  
Features  
14  
SOIC−14  
D SUFFIX  
VHC02G  
AWLYWW  
• High Speed: t = 3.6 ns (Typ) at V = 5.0 V  
PD  
CC  
• Low Power Dissipation: I = 2 mA (Max) at T = 25°C  
CASE 751A  
CC  
A
1
1
• High Noise Immunity: V  
= V  
= 28% V  
NIL CC  
NIH  
• Power Down Protection Provided on Inputs  
• Balanced Propagation Delays  
14  
VHC  
02  
TSSOP−14  
DT SUFFIX  
CASE 948G  
• Designed for 2.0 V to 5.5 V Operating Range  
• Low Noise: V  
= 0.8 V (Max)  
ALYW  
ꢀ
OLP  
ꢀ
• Pin and Function Compatible with Other Standard Logic Families  
• Latchup Performance Exceeds 300mA  
1
1
• ESD Performance:  
A
WL, L  
Y
= Assembly Location  
= Wafer Lot  
= Year  
Human Body Model > 2000 V;  
Machine Model > 200 V  
WW, W = Work Week  
G or = Pb−Free Package  
• Chip Complexity: 40 FETs or 10 Equivalent Gates  
• Pb−Free Packages are Available*  
ꢀ
(Note: Microdot may be in either location)  
PIN ASSIGNMENT  
2
A1  
1
Y1  
3
Y1  
A1  
1
2
14  
V
CC  
B1  
13 Y4  
5
A2  
4
Y2  
B1  
Y2  
3
4
12 B4  
11 A4  
6
B2  
Y = A + B  
8
A3  
A2  
B2  
5
6
10 Y3  
10  
Y3  
9
9
8
B3  
A3  
B3  
GND  
7
11  
A4  
13  
Y4  
12  
B4  
FUNCTION TABLE  
Figure 1. LOGIC DIAGRAM  
Inputs  
Output  
A
B
Y
L
L
H
H
L
H
L
H
L
L
L
H
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 3 of this data sheet.  
*For additional information on our Pb−Free strategy and soldering details, please  
download the ON Semiconductor Soldering and Mounting Techniques  
Reference Manual, SOLDERRM/D.  
©
Semiconductor Components Industries, LLC, 2005  
1
Publication Order Number:  
November, 2005 − Rev. 4  
MC74VHC02/D  
12345

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型号 品牌 获取价格 描述 数据表
MC74VHC02ML1 ONSEMI

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