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MC74LVX86MELG PDF预览

MC74LVX86MELG

更新时间： 2024-09-27 13:11:19
品牌 Logo 应用领域
安森美 - ONSEMI /
页数 文件大小 规格书
5页 137K
描述
LV/LV-A/LVX/H SERIES, QUAD 2-INPUT XOR GATE, PDSO14, LEAD FREE, EIAJ, SO-14

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MC74LVX86MELG 技术参数

是否Rohs认证：符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOP, SOP14,.3
针数：14Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.15
Is Samacsys：N系列：LV/LV-A/LVX/H
JESD-30 代码：R-PDSO-G14JESD-609代码：e4
长度：10.2 mm负载电容（CL）：50 pF
逻辑集成电路类型：XOR GATE最大I（ol）：0.004 A
湿度敏感等级：3功能数量：4
输入次数：2端子数量：14
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP14,.3封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：260电源：3.3 V
Prop。Delay @ Nom-Sup：14.5 ns传播延迟（tpd）：21 ns
认证状态：Not Qualified施密特触发器：NO
座面最大高度：2.05 mm子类别：Gates
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：2.7 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：5.275 mm
Base Number Matches：1

MC74LVX86MELG 数据手册

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SEMICONDUCTOR TECHNICAL DATA  
The MC74LVX86 is an advanced high speed CMOS 2–input  
Exclusive–OR gate. The inputs tolerate voltages up to 7V, allowing the  
interface of 5V systems to 3V systems.  
• High Speed: t  
= 5.8ns (Typ) at V  
= 3.3V  
PD  
• Low Power Dissipation: I  
CC  
= 2µA (Max) at T = 25°C  
CC  
A
LOW–VOLTAGE CMOS  
• Power Down Protection Provided on Inputs  
• Balanced Propagation Delays  
• Low Noise: V  
= 0.5V (Max)  
OLP  
• Pin and Function Compatible with Other Standard Logic Families  
• Latchup Performance Exceeds 300mA  
• ESD Performance: HBM > 2000V; Machine Model > 200V  
D SUFFIX  
14–LEAD SOIC PACKAGE  
CASE 751A–03  
V
A2  
13  
B2  
12  
O2  
11  
A3  
10  
B3  
9
O3  
8
CC  
14  
DT SUFFIX  
14–LEAD TSSOP PACKAGE  
CASE 948G–01  
1
2
3
4
5
6
7
A0  
B0  
O0  
A1  
B1  
O1  
GND  
Figure 1. 14–Lead Pinout (Top View)  
M SUFFIX  
14–LEAD SOIC EIAJ PACKAGE  
CASE 965–01  
1
A0  
3
O0  
O1  
O2  
O3  
2
4
B0  
A1  
6
11  
8
PIN NAMES  
5
B1  
A2  
13  
Pins  
Function  
An, Bn  
On  
Data Inputs  
Outputs  
12  
10  
B2  
A3  
9
B3  
FUNCTION TABLE  
Inputs  
Figure 2. Logic Diagram  
Outputs  
On  
An  
Bn  
L
L
L
H
L
L
H
H
L
H
H
H
6/97  
Motorola, Inc. 1997  
REV 0  
12345

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