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Datasheet > 逻辑 > 总线驱动器/收发器> MC74HCT573ADWR2G
MC74HCT573ADWR2G PDF预览

MC74HCT573ADWR2G

更新时间： 2024-11-23 12:18:47
品牌 Logo 应用领域
安森美 - ONSEMI 总线驱动器总线收发器锁存器逻辑集成电路光电二极管PC
页数 文件大小 规格书
8页 153K
描述
Octal 3-State Noninverting Transparent Latch with LSTTL Compatible Inputs

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MC74HCT573ADWR2G 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Active零件包装代码：SOIC
包装说明：SOIC-20针数：20
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：1 week
风险等级：0.47Samacsys Confidence：3
Samacsys Status：ReleasedSamacsys PartID：225465
Samacsys Pin Count：20Samacsys Part Category：Integrated Circuit
Samacsys Package Category：Small Outline PackagesSamacsys Footprint Name：SOIC 20 WB CASE 751D-05
Samacsys Released Date：2015-08-11 08:39:57Is Samacsys：N
系列：HCTJESD-30 代码：R-PDSO-G20
JESD-609代码：e3长度：12.8 mm
负载电容（CL）：50 pF逻辑集成电路类型：BUS DRIVER
最大I（ol）：0.006 A湿度敏感等级：3
位数：8功能数量：1
端口数量：2端子数量：20
最高工作温度：125 °C最低工作温度：-55 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP20,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：260电源：5 V
Prop。Delay @ Nom-Sup：45 ns传播延迟（tpd）：45 ns
认证状态：Not Qualified座面最大高度：2.65 mm
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：7.5 mmBase Number Matches：1

MC74HCT573ADWR2G 数据手册

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MC74HCT573A  
Octal 3-State Noninverting  
Transparent Latch with  
LSTTL Compatible Inputs  
High−Performance Silicon−Gate CMOS  
http://onsemi.com  
MARKING  
The MC74HCT573A is identical in pinout to the LS573. This  
device may be used as a level converter for interfacing TTL or NMOS  
outputs to High−Speed CMOS inputs.  
These latches appear transparent to data (i.e., the outputs change  
asynchronously) when Latch Enable is high. When Latch Enable goes  
low, data meeting the setup and hold times becomes latched.  
The Output Enable input does not affect the state of the latches, but  
when Output Enable is high, all device outputs are forced to the  
high−impedance state. Thus, data may be latched even when the  
outputs are not enabled.  
DIAGRAMS  
20  
20  
PDIP−20  
N SUFFIX  
CASE 738  
MC74HCT573AN  
AWLYYWWG  
1
1
20  
The HCT573A is identical in function to the HCT373A but has the  
Data Inputs on the opposite side of the package from the outputs to  
facilitate PC board layout.  
SOIC−20  
DW SUFFIX  
CASE 751D  
20  
HCT573A  
AWLYYWWG  
1
• Output Drive Capability: 15 LSTTL Loads  
• TTL/NMOS−Compatible Input Levels  
• Outputs Directly Interface to CMOS, NMOS and TTL  
• Operating Voltage Range: 4.5 to 5.5 V  
• Low Input Current: 10 mA  
1
20  
HCT  
573A  
ALYWG  
G
TSSOP−20  
DT SUFFIX  
CASE 948E  
20  
• In Compliance with the Requirements Defined by JEDEC Standard  
1
No. 7 A  
1
• Chip Complexity: 234 FETs or 58.5 Equivalent Gates  
— Improved Propagation Delays  
— 50% Lower Quiescent Power  
• These Devices are Pb−Free and are RoHS Compliant  
20  
SOEIAJ−20  
F SUFFIX  
CASE 967  
20  
74HCT573A  
AWLYWWG  
1
1
A
WL, L  
YY, Y  
= Assembly Location  
= Wafer Lot  
= Year  
WW, W = Work Week  
G or G  
= Pb−Free Package  
(Note: Microdot may be in either location)  
ORDERING INFORMATION  
†
Device  
MC74HCT573ANG  
Package  
Shipping  
PDIP−20  
18 / Rail  
MC74HCT573ADWR2G SOIC−20 1000 / Reel  
MC74HCT573ADTR2G TSSOP−20 2500 / Reel  
MC74HCT573AFELG  
SOEIAJ−20 2000 / Reel  
†For information on tape and reel specifications,  
including part orientation and tape sizes, please  
refer to our Tape and Reel Packaging Specification  
Brochure, BRD8011/D.  
© Semiconductor Components Industries, LLC, 2011  
1
Publication Order Number:  
June, 2011 − Rev. 12  
MC74HCT573A/D  
12345678

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MC74HCT573ADWR2G 替代型号

型号 品牌 替代类型 描述 数据表
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MC74HCT573ADWG ONSEMI

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 Octal 3-State Noninverting Transparent Latch with LSTTL Compatible Inputs

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型号 品牌 获取价格 描述 数据表
MC74HCT573AFEL ONSEMI

获取价格

 		Octal 3-State Inverter Transceiver/Latch; Package: SOEIAJ-20; No of Pins: 20; Container: T
MC74HCT573AFELG ONSEMI

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 		Octal 3-State Noninverting Transparent Latch with LSTTL Compatible Inputs
MC74HCT573AN MOTOROLA

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 		Octal 3-State Noninverting Transparent Latch with LSTTL Compatible Inputs
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