MC74HC74ADT

更新时间： 2024-09-22 23:01:35

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摩托罗拉 - MOTOROLA		触发器逻辑集成电路光电二极管
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7页	233K
描述
Dual D Flip-Flop with Set and Reset

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MC74HC74ADT 技术参数

生命周期：	Transferred	零件包装代码：	TSSOP
包装说明：	TSSOP, TSSOP14,.25	针数：	14
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.11	系列：	HC/UH
JESD-30 代码：	R-PDSO-G14	JESD-609代码：	e0
长度：	5 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	D FLIP-FLOP	最大频率@ Nom-Sup：	20000000 Hz
最大I（ol）：	0.004 A	位数：	1
功能数量：	2	端子数量：	14
最高工作温度：	125 °C	最低工作温度：	-55 °C
输出极性：	COMPLEMENTARY	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP14,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
电源：	2/6 V	传播延迟（tpd）：	30 ns
认证状态：	Not Qualified	座面最大高度：	1.2 mm
子类别：	FF/Latches	最大供电电压 (Vsup)：	6 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	MILITARY	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	触发器类型：	POSITIVE EDGE
宽度：	4.4 mm	最小 fmax：	20 MHz
Base Number Matches：	1

MC74HC74ADT 数据手册

SEMICONDUCTOR TECHNICAL DATA

J SUFFIX

CERAMIC PACKAGE

CASE 632–08

High–Performance Silicon–Gate CMOS

The MC54/74HC74A is identical in pinout to the LS74. The device inputs

are compatible with standard CMOS outputs; with pullup resistors, they are

compatible with LSTTL outputs.

This device consists of two D flip–flops with individual Set, Reset, and

Clock inputs. Information at a D–input is transferred to the corresponding Q

output on the next positive going edge of the clock input. Both Q and Q

outputs are available from each flip–flop. The Set and Reset inputs are

asynchronous.

N SUFFIX

PLASTIC PACKAGE

CASE 646–06

D SUFFIX

SOIC PACKAGE

CASE 751A–03

•

Output Drive Capability: 10 LSTTL Loads

Outputs Directly Interface to CMOS, NMOS, and TTL

Operating Voltage Range: 2.0 to 6.0 V

DT SUFFIX

TSSOP PACKAGE

CASE 948G–01

Low Input Current: 1.0 µA

High Noise Immunity Characteristic of CMOS Devices

In Compliance with the Requirements Defined by JEDEC Standard

No. 7A

ORDERING INFORMATION

MC54HCXXAJ

MC74HCXXAN

MC74HCXXAD

MC74HCXXADT

Ceramic

Plastic

SOIC

•

Chip Complexity: 128 FETs or 32 Equivalent Gates

TSSOP

LOGIC DIAGRAM

PIN ASSIGNMENT

RESET 1

DATA 1

RESET 2

CLOCK 1

SET 1

DATA 2

CLOCK 2

CLOCK 1

SET 2

SET 1

RESET 2

GND

DATA 2

FUNCTION TABLE

CLOCK 2

SET 2

Inputs

Set Reset Clock Data

Outputs

PIN 14 = V

PIN 7 = GND

No Change

* Both outputs will remain high as long as

Set and Reset are low, but the output

states are unpredictable if Set and Reset

go high simultaneously.

10/95

REV 6

3–1

Motorola, Inc. 1995

12 3 4 5 6 7

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型号	品牌	获取价格	描述	数据表
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MC74HC74AF	ONSEMI	获取价格	Dual D Flip−Flop with Set and Reset High−Performance Silicon−Gate CMOS
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