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Datasheet > 逻辑 > 解码器/驱动器> MC74HC4514N
MC74HC4514N PDF预览

MC74HC4514N

更新时间： 2024-09-23 23:01:35
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 解码器解复用器
页数 文件大小 规格书
9页 247K
描述
1-of-16 Decoder/Demultiplexer with Address Latch

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MC74HC4514N 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP,
针数：24Reach Compliance Code：unknown
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.38其他特性：ADDRESS LATCHES
系列：HC/UHJESD-30 代码：R-PDIP-T24
JESD-609代码：e0长度：31.69 mm
负载电容（CL）：50 pF逻辑集成电路类型：OTHER DECODER/DRIVER
功能数量：1端子数量：24
最高工作温度：125 °C最低工作温度：-55 °C
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT SPECIFIED
传播延迟（tpd）：53 ns认证状态：Not Qualified
座面最大高度：4.44 mm最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：5 V
表面贴装：NO技术：CMOS
温度等级：MILITARY端子面层：Tin/Lead (Sn/Pb)
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.62 mmBase Number Matches：1

MC74HC4514N 数据手册

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SEMICONDUCTOR TECHNICAL DATA  
High–Performance Silicon–Gate CMOS  
N SUFFIX  
PLASTIC PACKAGE  
CASE 724–03  
The MC74HC4514 is identical in pinout to the MC14514B metal–gate  
CMOS device. The device inputs are compatible with standard CMOS  
outputs, with pullup resistors; they are compatible with LSTTL outputs.  
This device consists of a 4–bit storage latch with a Latch Enable and Chip  
Select input. When a low signal is applied to the Latch Enable input, the  
Address is stored, and decoded. When the Chip Select input is high, all  
sixteen outputs are forced to a low level.  
24  
1
DW SUFFIX  
SOIC PACKAGE  
CASE 751E–04  
24  
1
The Chip Select input is provided to facilitate the chip–select, demultiplex-  
ing, and cascading functions.  
ORDERING INFORMATION  
The demultiplexing function is accomplished by using the Address inputs  
to select the desired device output, and then by using the Chip Select as a  
data input.  
MC74HCXXXXN  
MC74HCXXXXDW  
Plastic  
SOIC  
•
•
•
•
•
•
Output Drive Capability: 10 LSTTL Loads  
Outputs Directly Interface to CMOS, NMOS, and TTL  
Operating Voltage Range: 2 to 6 V  
PIN ASSIGNMENT  
Low Input Current: 1 µA  
LATCH  
1
2
3
4
5
6
24  
23  
22  
21  
20  
19  
V
CC  
ENABLE  
High Noise Immunity Characteristic of CMOS Devices  
In Compliance with the Requirements Defined by JEDEC Standard  
No. 7A  
CHIP  
A0  
A1  
Y7  
Y6  
Y5  
SELECT  
A3  
•
Chip Complexity: 268 FETs or 67 Equivalent Gates  
A2  
Y10  
Y11  
LOGIC DIAGRAM  
Y4  
Y3  
7
18  
17  
16  
15  
14  
13  
Y8  
8
Y9  
11  
Y1  
9
Y14  
Y15  
Y12  
Y13  
Y0  
9
Y1  
Y2  
10  
11  
12  
10  
Y2  
8
Y0  
Y3  
7
Y4  
6
GND  
2
3
Y5  
Y6  
Y7  
Y8  
Y9  
A0  
A1  
A2  
A3  
5
4
BINARY  
ADDRESS  
INPUTS  
4–BIT  
STORAGE  
LATCH  
4–TO–16  
LINE  
DECODER  
ACTIVE–HIGH  
OUTPUTS  
18  
17  
20  
19  
14  
13  
16  
21  
Y10  
Y11  
Y12  
LATCH  
1
Y13  
Y14  
Y15  
ENABLE  
15  
CHIP  
SELECT  
PIN 24 = V  
CC  
PIN 12 = GND  
10/95  
REV 6  
Motorola, Inc. 1995  
1234567...9

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MC74HC4514N 替代型号

型号 品牌 替代类型 描述 数据表
MC74HC154N MOTOROLA

功能相似

 1-of-16 Decoder/Demultiplexer

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