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Datasheet > 逻辑 > 总线驱动器/收发器> MC74HC240ADWR2
MC74HC240ADWR2 PDF预览

MC74HC240ADWR2

更新时间： 2024-11-24 23:01:35
品牌 Logo 应用领域
安森美 - ONSEMI 总线驱动器总线收发器逻辑集成电路光电二极管
页数 文件大小 规格书
8页 184K
描述
Octal 3-State Inverting Buffer/Line Driver/Line Receiver

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MC74HC240ADWR2 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOIC-20
针数：20Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.03
Is Samacsys：N控制类型：ENABLE LOW
系列：HC/UHJESD-30 代码：R-PDSO-G20
JESD-609代码：e0长度：12.8 mm
负载电容（CL）：50 pF逻辑集成电路类型：BUS DRIVER
最大I（ol）：0.006 A湿度敏感等级：3
位数：4功能数量：2
端口数量：2端子数量：20
最高工作温度：125 °C最低工作温度：-55 °C
输出特性：3-STATE输出极性：INVERTED
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP20,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：240电源：2/6 V
Prop。Delay @ Nom-Sup：24 ns传播延迟（tpd）：120 ns
认证状态：Not Qualified座面最大高度：2.65 mm
子类别：Bus Driver/Transceivers最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：3 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：7.5 mmBase Number Matches：1

MC74HC240ADWR2 数据手册

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High–Performance Silicon–Gate CMOS  
The MC74HC240A is identical in pinout to the LS240. The device  
inputs are compatible with standard CMOS outputs; with pullup  
resistors, they are compatible with LSTTL outputs.  
This octal noninverting buffer/line driver/line receiver is designed  
to be used with 3–state memory address drivers, clock drivers, and  
other sub–oriented systems. The device has inverting outputs and two  
active–low output enables.  
http://onsemi.com  
MARKING  
DIAGRAMS  
20  
PDIP–20  
N SUFFIX  
CASE 738  
MC74HC240AN  
AWLYYWW  
The HC240A is similar in function to the HC244A.  
20  
1
• Output Drive Capability: 15 LSTTL Loads  
• Outputs Directly Interface to CMOS, NMOS, and TTL  
• Operating Voltage Range: 2 to 6 V  
1
20  
SOIC WIDE–20  
DW SUFFIX  
CASE 751D  
HC240A  
AWLYYWW  
20  
1
• Low Input Current: 1 µA  
1
• High Noise Immunity Characteristic of CMOS Devices  
• In Compliance with the Requirements Defined by JEDEC Standard  
No. 7A  
20  
HC  
240A  
ALYW  
TSSOP–20  
DT SUFFIX  
CASE 948E  
20  
1
• Chip Complexity: 120 FETs or 30 Equivalent Gates  
LOGIC DIAGRAM  
1
2
4
6
8
18  
16  
14  
12  
A
= Assembly Location  
A1  
A2  
A3  
A4  
YA1  
YA2  
YA3  
YA4  
WL = Wafer Lot  
YY = Year  
WW = Work Week  
PIN ASSIGNMENT  
ENABLE A  
A1  
1
2
3
4
5
6
7
8
9
20  
V
CC  
DATA  
INPUTS  
INVERTING  
OUTPUTS  
19 ENABLE B  
18 YA1  
17 B4  
11  
13  
15  
17  
9
7
5
3
B1  
B2  
B3  
B4  
YB1  
YB2  
YB3  
YB4  
YB4  
A2  
YB3  
A3  
16 YA2  
15 B3  
YB2  
A4  
14 YA3  
13 B2  
YB1  
12 YA4  
11 B1  
GND 10  
PIN 20 = V  
CC  
PIN 10 = GND  
1
ENABLE A  
ENABLE B  
OUTPUT  
ENABLES  
19  
ORDERING INFORMATION  
FUNCTION TABLE  
Device  
Package  
PDIP–20  
Shipping  
Inputs  
Enable A,  
Enable B A, B  
Outputs  
MC74HC240AN  
1440 / Box  
38 / Rail  
YA, YB  
MC74HC240ADW  
MC74HC240ADWR2  
MC74HC240ADT  
MC74HC240ADTR2  
SOIC–WIDE  
L
L
H
L
H
X
H
L
Z
SOIC–WIDE 1000 / Reel  
TSSOP–20 75 / Rail  
Z = high impedance  
TSSOP–20 2500 / Reel  
Semiconductor Components Industries, LLC, 2000  
1
Publication Order Number:  
May, 2000 – Rev. 9  
MC74HC240A/D  
12345678

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与MC74HC240ADWR2相关器件

型号 品牌 获取价格 描述 数据表
MC74HC240ADWR2G ONSEMI

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 		Octal 3-State Inverting Buffer/Line Driver/Line Receiver
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