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MC74HC175ADTEL PDF预览

MC74HC175ADTEL

更新时间： 2024-09-16 19:44:03
品牌 Logo 应用领域
安森美 - ONSEMI 光电二极管逻辑集成电路触发器
页数 文件大小 规格书
8页 191K
描述
IC,FLIP-FLOP,QUAD,D TYPE,HC-CMOS,TSSOP,16PIN,PLASTIC

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MC74HC175ADTEL 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：TSSOP, TSSOP16,.25Reach Compliance Code：not_compliant
风险等级：5.92JESD-30 代码：R-PDSO-G16
JESD-609代码：e0负载电容（CL）：50 pF
逻辑集成电路类型：D FLIP-FLOP最大频率@ Nom-Sup：6000000 Hz
最大I（ol）：0.0024 A功能数量：4
端子数量：16最高工作温度：125 °C
最低工作温度：-55 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP16,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：TAPE AND REEL电源：2/6 V
认证状态：Not Qualified子类别：FF/Latches
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Tin/Lead (Sn/Pb)
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL触发器类型：POSITIVE EDGE
Base Number Matches：1

MC74HC175ADTEL 数据手册

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High–Performance Silicon–Gate CMOS  
The MC74HC175A is identical in pinout to the LS175. The device  
inputs are compatible with standard CMOS outputs; with pullup  
resistors, they are compatible with LSTTL outputs.  
http://onsemi.com  
This device consists of four D flip–flops with common Reset and  
Clock inputs, and separate D inputs. Reset (active–low) is  
asynchronous and occurs when a low level is applied to the Reset  
input. Information at a D input is transferred to the corresponding Q  
output on the next positive going edge of the Clock input.  
MARKING  
DIAGRAMS  
16  
PDIP–16  
N SUFFIX  
CASE 648  
MC74HC175AN  
AWLYYWW  
16  
16  
1
• Output Drive Capability: 10 LSTTL Loads  
• Outputs Directly Interface to CMOS, NMOS, and TTL  
• Operating Voltage Range: 2 to 6 V  
1
16  
SO–16  
D SUFFIX  
CASE 751B  
HC175A  
AWLYWW  
• Low Input Current: 1 µA  
1
• High Noise Immunity Characteristic of CMOS Devices  
• In Compliance with the Requirements Defined by JEDEC Standard  
No. 7A  
1
16  
HC  
175A  
ALYW  
TSSOP–16  
DT SUFFIX  
CASE 948F  
• Chip Complexity 166 FETs or 41.5 Equivalent Gates  
16  
1
LOGIC DIAGRAM  
1
A
= Assembly Location  
9
2
3
CLOCK  
Q0  
Q0  
WL = Wafer Lot  
YY = Year  
WW = Work Week  
7
6
10  
Q1  
Q1  
Q2  
INVERTING  
AND  
NONINVERTING  
OUTPUTS  
4
5
D0  
D1  
DATA  
INPUTS  
PIN ASSIGNMENT  
11  
15  
14  
Q2  
Q3  
Q3  
12  
13  
D2  
D3  
RESET  
1
2
3
4
5
6
7
8
16  
V
CC  
Q0  
Q0  
15 Q3  
14 Q3  
13 D3  
12 D2  
11 Q2  
10 Q2  
1
RESET  
D0  
PIN 16 = V  
CC  
PIN 8 = GND  
D1  
Q1  
FUNCTION TABLE  
Q1  
Inputs  
Reset Clock  
Outputs  
GND  
9
CLOCK  
D
Q
Q
L
H
H
H
X
X
H
L
L
H
L
H
L
H
L
X
No Change  
ORDERING INFORMATION  
Device  
Package  
PDIP–16  
SOIC–16  
SOIC–16  
TSSOP–16  
Shipping  
MC74HC175AN  
2000 / Box  
48 / Rail  
MC74HC175AD  
MC74HC175ADR2  
MC74HC175ADT  
MC74HC175ADTR2  
2500 / Reel  
96 / Rail  
TSSOP–16 2500 / Reel  
Semiconductor Components Industries, LLC, 1999  
1
Publication Order Number:  
March, 2000 – Rev. 2  
MC74HC175A/D  
12345678

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型号 品牌 获取价格 描述 数据表
MC74HC175ADTR2 ONSEMI

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 		Quad D Flip-Flop with Common Clock and Reset
MC74HC175ADTR2G ONSEMI

获取价格

 		Quad D Flip−Flop with Common Clock and Reset High−Performance Silicon−Ga
MC74HC175ADTR2G ROCHESTER

获取价格

 		D Flip-Flop, HC/UH Series, 4-Func, Positive Edge Triggered, 1-Bit, Complementary Output, C
MC74HC175AFEL ONSEMI

获取价格

 		Quad D Flip−Flop with Common Clock and Reset High−Performance Silicon−Ga
MC74HC175AFELG ONSEMI

获取价格

 		Quad D Flip−Flop with Common Clock and Reset High−Performance Silicon−Ga
MC74HC175AN MOTOROLA

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MC74HC175AN ONSEMI

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 		Quad D Flip-Flop with Common Clock and Reset
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 		D Flip-Flop, HC/UH Series, 4-Func, Positive Edge Triggered, 1-Bit, Complementary Output, C
MC74HC175D MOTOROLA

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 		Quad D Flip-Flop with Common Clock and Reset

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