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Datasheet > 逻辑 > 触发器/锁存器> MC74HC107N
MC74HC107N PDF预览

MC74HC107N

更新时间： 2024-09-28 23:01:35
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 触发器锁存器逻辑集成电路光电二极管
页数 文件大小 规格书
5页 174K
描述
Dual J-K Flip-Flop with Reset

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MC74HC107N 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP,
针数：14Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.39
系列：HC/UHJESD-30 代码：R-PDIP-T14
JESD-609代码：e0长度：18.86 mm
负载电容（CL）：50 pF逻辑集成电路类型：J-K FLIP-FLOP
位数：2功能数量：2
端子数量：14最高工作温度：125 °C
最低工作温度：-55 °C输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装形状：RECTANGULAR封装形式：IN-LINE
峰值回流温度（摄氏度）：NOT SPECIFIED传播延迟（tpd）：38 ns
认证状态：Not Qualified座面最大高度：4.69 mm
最大供电电压 (Vsup)：6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：CMOS温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：NEGATIVE EDGE
宽度：7.62 mm最小 fmax：20 MHz
Base Number Matches：1

MC74HC107N 数据手册

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SEMICONDUCTOR TECHNICAL DATA  
High–Performance Silicon–Gate CMOS  
The MC74HC107 is identical in pinout to the LS107. The device inputs are  
compatible with standard CMOS outputs; with pullup resistors, they are  
compatible with LSTTL outputs.  
N SUFFIX  
PLASTIC PACKAGE  
CASE 646–06  
14  
Each flip flops negative edge clocked and has an active–low asynchro-  
nous reset.  
1
The HC107 is identical in function to the HC73, but has a different pinout.  
D SUFFIX  
SOIC PACKAGE  
CASE 751A–03  
•
•
•
•
•
•
Output Drive Capability: 10 LSTTL Loads  
Outputs Directly Interface to CMOS, NMOS, and TTL  
Operating Voltage Range: 2 to 6 V  
14  
1
Low Input Current: 1 µA  
High Noise Immunity Characteristic of CMOS Devices  
In Compliance with the Requirements Defined by JEDEC Standard  
No. 7A  
ORDERING INFORMATION  
MC74HCXXXN  
MC74HCXXXD  
Plastic  
SOIC  
•
Chip Complexity: 92 FETs or 23 Equivalent Gates  
PIN ASSIGNMENT  
LOGIC DIAGRAM  
J1  
1
2
14  
13  
V
CC  
Q1  
RESET 1  
1
J1  
3
2
3
4
12  
11  
Q1  
K1  
CLOCK 1  
K2  
Q1  
Q1  
12  
4
CLOCK 1  
Q2  
Q2  
5
6
10  
9
RESET 2  
CLOCK 2  
K1  
13  
RESET 1  
GND  
7
8
J2  
8
9
J2  
CLOCK 2  
K2  
5
6
Q2  
Q2  
11  
10  
FUNCTION TABLE  
Inputs  
Reset Clock  
Outputs  
RESET 2  
J
K
Q
Q
PIN 14 = V  
CC  
PIN 7 = GND  
L
X
X
L
L
H
H
X
X
X
X
L
H
L
H
X
X
X
L
H
H
H
H
H
H
H
H
No Change  
L
H
H
L
Toggle  
L
H
No Change  
No Change  
No Change  
10/95  
REV 6  
Motorola, Inc. 1995  
12345

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型号 品牌 获取价格 描述 数据表
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 		暂无描述
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 		Dual J-K Flip-Flop with Set and Reset
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 		HC/UH SERIES, DUAL POSITIVE EDGE TRIGGERED J-KBAR FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16,
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