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Datasheet > 逻辑 > 栅极> MC74HC03AFELG
MC74HC03AFELG PDF预览

MC74HC03AFELG

更新时间： 2024-11-04 05:09:55
品牌 Logo 应用领域
安森美 - ONSEMI 栅
页数 文件大小 规格书
9页 148K
描述
Quad 2−Input NAND Gate with Open−Drain Outputs High−Performance Silicon−Gate CMOS

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MC74HC03AFELG 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP, SOP14,.3针数：14
Reach Compliance Code：unknownHTS代码：8542.39.00.01
Factory Lead Time：1 week风险等级：5.17
系列：HC/UHJESD-30 代码：R-PDSO-G14
JESD-609代码：e4长度：10.2 mm
负载电容（CL）：50 pF逻辑集成电路类型：NAND GATE
最大I（ol）：0.004 A湿度敏感等级：3
功能数量：4输入次数：2
端子数量：14最高工作温度：125 °C
最低工作温度：-55 °C输出特性：OPEN-DRAIN
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP14,.3封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TAPE AND REEL
峰值回流温度（摄氏度）：260电源：2/6 V
Prop。Delay @ Nom-Sup：36 ns传播延迟（tpd）：180 ns
认证状态：Not Qualified施密特触发器：NO
座面最大高度：2.05 mm子类别：Gates
最大供电电压 (Vsup)：6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：3 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40宽度：5.275 mm
Base Number Matches：1

MC74HC03AFELG 数据手册

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MC74HC03A  
Quad 2−Input NAND Gate  
with Open−Drain Outputs  
High−Performance Silicon−Gate CMOS  
The MC74HC03A is identical in pinout to the LS03. The device  
inputs are compatible with Standard CMOS outputs; with pullup  
resistors, they are compatible with LSTTL outputs.  
The HC03A NAND gate has, as its outputs, a high−performance  
MOS N−Channel transistor. This NAND gate can, therefore, with a  
suitable pullup resistor, be used in wired−AND applications. Having  
the output characteristic curves given in this data sheet, this device can  
be used as an LED driver or in any other application that only requires  
a sinking current.  
http://onsemi.com  
MARKING  
DIAGRAMS  
14  
PDIP−14  
N SUFFIX  
CASE 646  
MC74HC03AN  
AWLYYWWG  
14  
1
Features  
1
• Output Drive Capability: 10 LSTTL Loads With Suitable Pullup  
Resistor  
• Outputs Directly Interface to CMOS, NMOS and TTL  
14  
SOIC−14  
D SUFFIX  
HC03AG  
14  
AWLYWW  
• High Noise Immunity Characteristic of CMOS Devices  
• Operating Voltage Range: 2.0 to 6.0 V  
CASE 751A  
1
1
• Low Input Current: 1mA  
• In Compliance With the JEDEC Standard No. 7A Requirements  
• Chip Complexity: 28 FETs or 7 Equivalent Gates  
• Pb−Free Packages are Available  
14  
TSSOP−14  
DT SUFFIX  
CASE 948G  
HC  
03  
14  
1
ALYWG  
G
LOGIC DIAGRAM  
1
V
CC  
A
= Assembly Location  
WL or L = Wafer Lot  
YY or Y = Year  
WW or W = Work Week  
OUTPUT  
PROTECTION  
DIODE  
PIN 14 = V  
CC  
PIN 7 = GND  
* Denotes open−drain outputs  
G or G  
= Pb−Free Package  
(Note: Microdot may be in either location)  
3,6,8,11  
Y*  
1,4,9,12  
A
B
FUNCTION TABLE  
2,5,10,13  
Inputs  
Output  
Y
A
B
L
L
L
H
L
Z
Z
Z
L
Pinout: 14−Lead Packages (Top View)  
V
CC  
B4  
13  
A4  
12  
Y4  
11  
B3  
10  
A3  
9
Y3  
8
H
H
14  
H
Z = High Impedance  
1
2
3
4
5
6
7
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 3 of this data sheet.  
A1  
B1  
Y1  
A2  
B2  
Y2 GND  
© Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
October, 2006 − Rev. 10  
MC74HC03A/D  
1234567...9

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MC74HC03AFELG 替代型号

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