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Datasheet > 逻辑 > 总线驱动器/收发器> MC54HC245AJ
MC54HC245AJ PDF预览

MC54HC245AJ

更新时间： 2024-11-14 00:01:07
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 总线驱动器总线收发器逻辑集成电路
页数 文件大小 规格书
7页 103K
描述
Octal 3-State Noninverting Bus Transceiver

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MC54HC245AJ 技术参数

是否Rohs认证：不符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP,
针数：20Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.26
Is Samacsys：N其他特性：WITH DIRECTION CONTROL
系列：HC/UHJESD-30 代码：R-CDIP-T20
JESD-609代码：e0长度：24.515 mm
负载电容（CL）：50 pF逻辑集成电路类型：BUS TRANSCEIVER
位数：8功能数量：1
端口数量：2端子数量：20
最高工作温度：125 °C最低工作温度：-55 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：CERAMIC, METAL-SEALED COFIRED封装代码：DIP
封装形状：RECTANGULAR封装形式：IN-LINE
峰值回流温度（摄氏度）：NOT SPECIFIED传播延迟（tpd）：22 ns
认证状态：Not Qualified座面最大高度：5.08 mm
最大供电电压 (Vsup)：6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：CMOS温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.62 mm
Base Number Matches：1

MC54HC245AJ 数据手册

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SEMICONDUCTOR TECHNICAL DATA  
High–Performance Silicon–Gate CMOS  
J SUFFIX  
CERAMIC PACKAGE  
CASE 732–03  
20  
20  
The MC54/74HC245A is identical in pinout to the LS245. The device  
inputs are compatible with standard CMOS outputs; with pullup resistors,  
they are compatible with LSTTL outputs.  
The HC245A is a 3–state noninverting transceiver that is used for 2–way  
asynchronous communication between data buses. The device has an  
active–low Output Enable pin, which is used to place the I/O ports into  
high–impedance states. The Direction control determines whether data  
flows from A to B or from B to A.  
1
N SUFFIX  
PLASTIC PACKAGE  
CASE 738–03  
1
•
•
•
•
•
•
Output Drive Capability: 15 LSTTL Loads  
Outputs Directly Interface to CMOS, NMOS, and TTL  
Operating Voltage Range: 2 to 6 V  
DW SUFFIX  
SOIC PACKAGE  
CASE 751D–04  
20  
1
Low Input Current: 1 µA  
ORDERING INFORMATION  
High Noise Immunity Characteristic of CMOS Devices  
In Compliance with the Requirements Defined by JEDEC Standard  
No. 7A  
MC54HCXXXAJ  
MC74HCXXXAN  
MC74HCXXXADW  
Ceramic  
Plastic  
SOIC  
•
Chip Complexity: 308 FETs or 77 Equivalent Gates  
LOGIC DIAGRAM  
PIN ASSIGNMENT  
2
3
4
5
6
7
8
9
18  
17  
16  
15  
14  
13  
12  
11  
DIRECTION  
1
20  
V
CC  
A1  
A2  
A3  
A4  
A5  
A6  
A7  
A8  
B1  
B2  
B3  
B4  
B5  
B6  
B7  
B8  
A1  
A2  
A3  
2
3
4
19  
18  
17  
OUTPUT ENABLE  
B1  
B2  
A
DATA  
PORT  
B
DATA  
PORT  
A4  
A5  
5
16  
15  
14  
13  
12  
11  
B3  
B4  
B5  
B6  
B7  
B8  
6
A6  
7
A7  
8
1
DIRECTION  
A8  
9
19  
OUTPUT ENABLE  
GND  
10  
PIN 10 = GND  
PIN 20 = V  
CC  
FUNCTION TABLE  
Control Inputs  
Output  
Enable  
Direction  
Operation  
L
L
L
H
X
Data Transmitted from Bus B to Bus A  
Data Transmitted from Bus A to Bus B  
Buses Isolated (High–Impedance State)  
H
X = don’t care  
10/95  
Motorola, Inc. 1995  
REV 6  
1234567

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