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MC10H210FNG PDF预览

MC10H210FNG

更新时间： 2024-02-24 12:34:55
品牌 Logo 应用领域
安森美 - ONSEMI 栅极触发器逻辑集成电路
页数 文件大小 规格书
6页 150K
描述
Dual 3−Input 3−Output OR Gate

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MC10H210FNG 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：DIP, DIP16,.3Reach Compliance Code：unknown
风险等级：5.92JESD-30 代码：R-PDIP-T16
JESD-609代码：e0逻辑集成电路类型：OR GATE
端子数量：16最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装等效代码：DIP16,.3
封装形状：RECTANGULAR封装形式：IN-LINE
认证状态：Not Qualified施密特触发器：NO
子类别：Gates表面贴装：NO
技术：ECL温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
Base Number Matches：1

MC10H210FNG 数据手册

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MC10H210  
Dual 3−Input 3−Output OR  
Gate  
Description  
The MC10H210 is designed to drive up to six transmission lines  
simultaneously. The multiple outputs of this device also allow the wire  
ORing of several levels of gating for minimization of gate and package  
count.  
The ability to control three parallel lines with minimum propagation  
delay from a single point makes the MC10H210 particularly useful in  
clock distribution applications where minimum clock skew is desired.  
http://onsemi.com  
MARKING DIAGRAMS*  
16  
Features  
MC10H210L  
AWLYYWW  
• Propagation Delay Average, 1.0 ns Typical  
• Power Dissipation, 160 mW Typical  
• Improved Noise Margin 150 mV (Over Operating Voltage and  
Temperature Range)  
1
CDIP−16  
L SUFFIX  
CASE 620A  
• Voltage Compensated  
• MECL 10K™ Compatible  
16  
1
• Pb−Free Packages are Available*  
MC10H210P  
AWLYYWWG  
16  
LOGIC DIAGRAM  
1
5
6
7
2
3
4
PDIP−16  
P SUFFIX  
CASE 648  
9
10  
11  
12  
13  
14  
10H210  
ALYWG  
V
V
V
= PINS 1, 15  
= PIN 16  
CC1  
CC2  
SOEIAJ−16  
CASE 966  
= PIN 8  
EE  
DIP  
1 20  
PIN ASSIGNMENT  
V
A
V
V
B
B
B
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
CC1  
CC2  
CC1  
OUT  
OUT  
OUT  
10H210G  
AWLYYWW  
20  
1
OUT  
OUT  
OUT  
PLLC−20  
FN SUFFIX  
CASE 775  
A
A
A
IN  
A
= Assembly Location  
= Year  
WL, L = Wafer Lot  
YY, Y  
WW, W = Work Week  
G
A
B
B
B
IN  
IN  
IN  
IN  
A
IN  
= Pb−Free Package  
V
EE  
Pin assignment is for Dual−in−Line Package.  
For PLCC pin assignment, see the Pin Conversion Tables on page 18  
of the ON Semiconductor MECL Data Book (DL122/D).  
*For additional marking information, refer to  
Application Note AND8002/D.  
*For additional information on our Pb−Free strategy and soldering details, please  
download the ON Semiconductor Soldering and Mounting Techniques  
Reference Manual, SOLDERRM/D.  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 3 of this data sheet.  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
February, 2006 − Rev. 7  
MC10H210/D  
123456

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MC10H210FNG 替代型号

型号 品牌 替代类型 描述 数据表
MC10H210FN ONSEMI

完全替代

 Dual 3−Input 3−Output OR Gate

与MC10H210FNG相关器件

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 		Dual 3-Input 3-Output OR Gate
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 		OR Gate, ECL, CDIP16
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 		OR Gate, ECL, CDIP16
MC10H210LS MOTOROLA

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 		IC,LOGIC GATE,DUAL 3-INPUT OR,ECL,DIP,16PIN,CERAMIC
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 		Dual 3−Input 3−Output OR Gate
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