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Datasheet > 驱动程序和接口 > 线路驱动器或接收器> MC10E416FN
MC10E416FN PDF预览

MC10E416FN

更新时间： 2024-10-31 22:34:47
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 线路驱动器或接收器驱动程序和接口接口集成电路
页数 文件大小 规格书
4页 112K
描述
QUINT DIFFERENTIAL LINE RECEIVER

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MC10E416FN 技术参数

生命周期：Transferred零件包装代码：QLCC
包装说明：QCCJ, LDCC28,.5SQ针数：28
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.29
差分输出：YES输入特性：DIFFERENTIAL
接口集成电路类型：LINE RECEIVER接口标准：GENERAL PURPOSE
JESD-30 代码：S-PQCC-J28JESD-609代码：e0
长度：11.5062 mm标称负供电电压：-5.2 V
功能数量：1端子数量：28
最高工作温度：85 °C最低工作温度：
输出特性：OPEN-EMITTER输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC28,.5SQ封装形状：SQUARE
封装形式：CHIP CARRIER电源：-5.2 V
认证状态：Not Qualified最大接收延迟：0.5 ns
接收器位数：5座面最大高度：4.57 mm
子类别：Line Driver or Receivers最大压摆率：162 mA
表面贴装：YES技术：ECL
温度等级：OTHER端子面层：Tin/Lead (Sn/Pb)
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD宽度：11.5062 mm
Base Number Matches：1

MC10E416FN 数据手册

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SEMICONDUCTOR TECHNICAL DATA  
The MC10E416/100E416 is a 5-bit differential line receiving device.  
The 2.0GHz of bandwidth provided by the high frequency outputs makes  
the device ideal for buffering of very high speed oscillators.  
A V  
BB  
pin is available to AC couple an input signal to the device. More  
information on AC coupling can be found in the design handbook section  
of this data book.  
QUINT DIFFERENTIAL  
LINE RECEIVER  
The design incorporates two stages of gain, internal to the device,  
making it an excellent choice for use in high bandwidth amplifier  
applications.  
The differential inputs have internal clamp structures which will force  
the Q output of a gate in an open input condition to go to a LOW state.  
Thus, inputs of unused gates can be left open and will not affect the  
operation of the rest of the device. Note that the input clamp will take  
affect only if both inputs fall 2.5V below V  
.
CC  
• Differential D and Q; V  
BB  
available  
• 600ps Max. Propagation Delay  
• High Frequency Outputs  
• 2 Stages of Gain  
FN SUFFIX  
PLASTIC PACKAGE  
CASE 776-02  
• Extended 100E V  
EE  
Range of – 4.2V to – 5.46V  
• Internal 75kΩ Input Pulldown Resistors  
Pinout: 28-Lead PLCC (Top View)  
D
D
D
V
Q
Q
V
3
4
4
CCO  
4
4
CCO  
25  
24  
23  
22  
21  
20  
19  
D
D
D
26  
27  
28  
1
18  
Q
Q
3
2
2
3
LOGIC DIAGRAM  
17  
16  
15  
14  
13  
12  
3
Q
D
0
0
V
CC  
V
V
Q
Q
EE  
2
Q
Q
D
D
0
0
2
BB  
2
1
1
D
D
3
V
CCO  
0
Q
Q
D
D
1
1
4
Q
1
0
2
2
5
6
7
8
9
10  
11  
Q
Q
D
D
2
2
D
D
V
Q
Q
V
Q
1
1
1
CCO  
0
0
CCO  
* All V  
and V  
pins are tied together on the die.  
3
3
CC  
CCO  
PIN NAMES  
Q
Q
D
D
3
3
Pin  
Function  
4
4
D[0:4], D[0:4]  
Q[0:4], Q[0:4]  
Differential Data Inputs  
Differential Data Outputs  
Q
D
4
4
V
BB  
12/93  
Motorola, Inc. 1996  
REV 2  
1234

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